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?CDCVF855 2.5V鎖相環(huán)時(shí)鐘驅(qū)動(dòng)器技術(shù)文檔總結(jié)

科技綠洲 ? 2025-09-19 10:01 ? 次閱讀
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該CDCVF855是一款高性能、低偏斜、低抖動(dòng)、零延遲緩沖器,可將差分時(shí)鐘輸入對(duì)(CLK、CLK)分配給4個(gè)差分時(shí)鐘輸出對(duì)(Y[0:3]、Y[0:3])和1對(duì)差分反饋時(shí)鐘輸出(FBOUT、FBOUT)。時(shí)鐘輸出由時(shí)鐘輸入(CLK、CLK)、反饋時(shí)鐘(FBIN、FBIN)和模擬電源輸入(AV DD ).當(dāng)PWRDWN為高電平時(shí),輸出與CLK在相位和頻率上切換。當(dāng)PWRDWN為低電平時(shí),所有輸出都被禁用到高阻抗?fàn)顟B(tài)(3狀態(tài)),PLL關(guān)閉(低功耗模式)。當(dāng)輸入頻率低于低于 20 MHz(典型值 10 MHz)的建議檢測(cè)頻率時(shí),器件也會(huì)進(jìn)入這種低功耗模式。輸入頻率檢測(cè)電路檢測(cè)低頻條件,在施加>20 MHz輸入信號(hào)后,該檢測(cè)電路導(dǎo)通PLL并使能輸出。
*附件:cdcvf855.pdf

當(dāng) AVDD捆扎低,則 PLL 關(guān)閉并旁路用于測(cè)試目的。該CDCVF855還能夠跟蹤擴(kuò)頻時(shí)鐘以降低 EMI。

由于CDCVF855基于PLL電路,因此需要穩(wěn)定時(shí)間才能實(shí)現(xiàn)PLL的鎖相。通電后需要此穩(wěn)定時(shí)間。該CDCVF855適用于商業(yè)和工業(yè)溫度范圍。

特性

  • 兼容擴(kuò)頻時(shí)鐘
  • 工作頻率:60 MHz 至 220 MHz
  • 低抖動(dòng)(周期間):±60 ps(200 MHz時(shí)為±40 ps)
  • 低靜態(tài)相位偏移:±50 ps
  • 低抖動(dòng)(周期):±60 ps(200 MHz時(shí)為±30 ps)
  • 1 到 4 差分時(shí)鐘分配 (SSTL2)
  • 同類最佳 V = V DD /2 ±0.1 伏
  • 采用雙通道 2.6V 或 2.5V 電源供電
  • 采用28引腳TSSOP封裝
  • 消耗<100μA靜態(tài)電流
  • 外部反饋引腳(FBIN、FBIN)用于將輸出與輸入時(shí)鐘同步
  • 符合/超過(guò)DDRI-200/266/333規(guī)范的JEDEC標(biāo)準(zhǔn)(JESD82-1)
  • 達(dá)到/超過(guò)建議的DDRI-400規(guī)范(JESD82-1A)
  • 當(dāng)未施加CLK輸入信號(hào)或PWRDWN為低電平時(shí),進(jìn)入低功耗模式
  • 應(yīng)用
    • DDR內(nèi)存模塊(DDR400/333/266/200)
    • 零延遲扇出緩沖器

參數(shù)

image.png
?一、核心特性?

  1. ?性能參數(shù)?
    • 工作頻率范圍:60MHz至220MHz
    • 低抖動(dòng)特性:周期抖動(dòng)±60ps(200MHz時(shí)±30ps),周期間抖動(dòng)±60ps(200MHz時(shí)±40ps)
    • 靜態(tài)相位偏移:±50ps
    • 支持?jǐn)U頻時(shí)鐘(SSC)以降低EMI
  2. ?功能設(shè)計(jì)?
    • 1路差分時(shí)鐘輸入(CLK/CLK)轉(zhuǎn)換為4路差分輸出(Y[0:3]/Y[0:3])及1路反饋輸出(FBOUT/FBOUT)
    • 外部反饋引腳(FBIN/FBIN)實(shí)現(xiàn)輸入與輸出時(shí)鐘同步
    • 低功耗模式:無(wú)輸入信號(hào)或PWRDWN為低電平時(shí)關(guān)閉輸出

?二、應(yīng)用場(chǎng)景?

  • DDR內(nèi)存模塊(DDR400/333/266/200)
  • 零延遲扇出緩沖器

?三、電氣特性?

  1. ?供電要求?
    • 雙電源供電:2.5V或2.6V(VDDQ與AVDD)
    • 靜態(tài)電流:<100μA
  2. ?信號(hào)規(guī)范?
    • 差分輸入電壓范圍:0.36V至VDDQ+0.6V
    • 輸出驅(qū)動(dòng)能力:支持120Ω終端負(fù)載,14pF容性負(fù)載

?四、封裝與可靠性?

  • 28引腳TSSOP封裝(PW型號(hào))
  • 工作溫度范圍:-40°C至85°C
  • 符合JEDEC DDR標(biāo)準(zhǔn)(JESD82-1/1A)

?五、關(guān)鍵注意事項(xiàng)?

  • PLL穩(wěn)定時(shí)間:上電后需10μs鎖定相位
  • 推薦AVDD電源濾波電路:包含4.7μF、0.1μF及2200pF電容
  • 絕對(duì)最大額定值:輸入/輸出電壓不超過(guò)VDDQ+0.5V
聲明:本文內(nèi)容及配圖由入駐作者撰寫(xiě)或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場(chǎng)。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問(wèn)題,請(qǐng)聯(lián)系本站處理。 舉報(bào)投訴
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