在電子工程師的設(shè)計世界里，數(shù)模轉(zhuǎn)換器（DAC）是連接數(shù)字世界和模擬世界的重要橋梁。今天，我們要深入探討一款性能卓越的20位低功耗數(shù)模轉(zhuǎn)換器——DAC1220，它來自德州儀器（TI），具有諸多令人矚目的特性和廣泛的應(yīng)用場景。

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一、DAC1220概述

1.1 關(guān)鍵特性

DAC1220是一款20位的數(shù)模轉(zhuǎn)換器，能夠在 -40°C 至 +85°C 的指定溫度范圍內(nèi)確保20位的單調(diào)性。它采用了delta - sigma技術(shù)，在小封裝內(nèi)以極低的功耗實現(xiàn)了固有的線性性能。其分辨率可編程為20位全量程，典型情況下在15ms內(nèi)穩(wěn)定到0.003%；或16位全量程，最大在2ms內(nèi)穩(wěn)定到0.012%。輸出范圍是外部參考電壓的兩倍，片上校準(zhǔn)電路顯著降低了低失調(diào)和增益誤差，功耗僅為2.5mW，具有電壓輸出特性。

1.2 應(yīng)用領(lǐng)域

DAC1220的應(yīng)用領(lǐng)域十分廣泛，涵蓋了過程控制、自動測試設(shè)備（ATE）引腳電子、閉環(huán)伺服控制、智能變送器以及便攜式儀器等。它的同步串行接口在單轉(zhuǎn)換器應(yīng)用中僅需兩根線即可完成，便于實現(xiàn)低成本隔離；對于多轉(zhuǎn)換器應(yīng)用，通過CS信號可以選擇合適的D/A轉(zhuǎn)換器。

二、電氣特性分析

2.1 精度指標(biāo)

在精度方面，DAC1220表現(xiàn)出色。在不同模式下，能保證16位或20位的單調(diào)性，線性誤差最大為±0.0015% FSR，單極性失調(diào)誤差和增益誤差、雙極性零失調(diào)誤差等都控制在較小范圍內(nèi)，并且具有較低的誤差漂移。

2.2 模擬輸出

輸出電壓范圍為0至2×VREF，最大輸出電流為0.5mA，可承受的電容性負(fù)載為500pF，短路電流為 +20mA，短路持續(xù)時間可至地或電源。

2.3 動態(tài)性能

在動態(tài)性能上，16位模式下達(dá)到±0.012%的穩(wěn)定時間為2ms，20位模式下達(dá)到±0.003%的穩(wěn)定時間為15ms，輸出噪聲電壓在0.1Hz至10Hz范圍內(nèi)為1μVRMS。

2.4 參考輸入和數(shù)字接口

參考輸入電壓范圍為2.25V至2.75V，輸入阻抗為100kΩ。數(shù)字輸入/輸出采用TTL兼容的CMOS邏輯電平，時鐘頻率范圍為0.5MHz至2.5MHz，數(shù)據(jù)格式可用戶編程。

三、工作原理與操作模式

3.1 工作原理

DAC1220的核心由插值濾波器和二階delta - sigma調(diào)制器組成。調(diào)制器的輸出經(jīng)過一階開關(guān)電容濾波器和二階連續(xù)時間濾波器，最終生成輸出電壓。為了提高穩(wěn)定時間，當(dāng)檢測到輸出電壓階躍大于約40mV時，它可以調(diào)整濾波器的截止頻率，并且這一功能可以禁用。

3.2 自校準(zhǔn)系統(tǒng)

其自校準(zhǔn)系統(tǒng)通過測量DAC輸出并計算適當(dāng)?shù)脑鲆婧褪д{(diào)校準(zhǔn)常數(shù)來補償內(nèi)部失調(diào)和增益誤差。校準(zhǔn)值可以根據(jù)需要進行外部存儲和加載。

3.3 操作模式

DAC1220具有三種操作模式：睡眠模式、正常模式和自校準(zhǔn)模式。睡眠模式下，輸出斷開，功耗降至約0.45mW；正常模式下，設(shè)備完全激活，輸出開啟；自校準(zhǔn)模式下，設(shè)備運行自校準(zhǔn)序列，完成后切換到正常模式。

四、基本連接與注意事項

4.1 輸出特性

輸出電壓范圍標(biāo)稱在0V至2×VREF之間，輸出放大器最大驅(qū)動電流為0.5mA。在開機和睡眠模式下，放大器斷開，輸出呈高阻抗?fàn)顟B(tài)。輸出并非完全線性到電源軌，最大線性度在(AGND + 20mV)至(AVDD - 20mV)范圍內(nèi)。

4.2 濾波器電容

連續(xù)時間輸出濾波器需要兩個外部電容，其推薦值根據(jù)16位或20位模式有所不同。電容應(yīng)選擇穩(wěn)定的高品質(zhì)類型，如薄膜電容，并且C1和C2引腳非常敏感，需要用參考電壓的保護環(huán)包圍以獲得最佳噪聲性能。

4.3 電壓參考和數(shù)字連接

電壓參考輸入設(shè)計為 +2.5V，此時輸出范圍約為0V至5V。數(shù)字線路除晶體振蕩器線路外，采用TTL兼容的CMOS邏輯電平，可由3.3V邏輯源驅(qū)動。在對噪聲敏感的應(yīng)用中，應(yīng)降低數(shù)字線路的電平轉(zhuǎn)換速率，以減少噪聲耦合。

4.4 時鐘振蕩器

DAC1220內(nèi)置晶體振蕩器，使用時需連接晶體和負(fù)載電容。負(fù)載電容值主要取決于晶體和布局，典型頻率為2.5MHz，偏離該頻率可能會影響噪聲、穩(wěn)定時間和時序特性。也可以連接外部時鐘信號，此時XOUT應(yīng)保持未連接狀態(tài)。

4.5 串行接口和電源供應(yīng)

串行接口可由大多數(shù)SPI外設(shè)操作，若SDIO雙向操作，可能需要上拉電阻。串行時鐘頻率限制為系統(tǒng)時鐘頻率的十分之一。DAC1220具有獨立的模擬和數(shù)字電源連接，均為 +5V，數(shù)字電源不得超過模擬電源300mV，否則可能損壞設(shè)備。

五、編程與操作

5.1 命令與寄存器

與DAC1220的通信通過命令完成，命令由命令字節(jié)和一至三個數(shù)據(jù)字節(jié)組成，可對寄存器進行讀寫操作。DAC1220有四個寄存器，分別是數(shù)據(jù)輸入寄存器（DIR）、命令寄存器（CMR）、偏移校準(zhǔn)寄存器（OCR）和滿量程校準(zhǔn)寄存器（FCR）。

5.2 位和字節(jié)順序

數(shù)據(jù)字節(jié)的位順序和字節(jié)順序均可配置，命令字節(jié)始終以MSB優(yōu)先傳輸。

5.3 啟動序列和校準(zhǔn)

啟動時，應(yīng)等待振蕩器啟動后再進行通信，可選擇應(yīng)用SCLK復(fù)位模式，設(shè)置命令寄存器并進行校準(zhǔn)。校準(zhǔn)由OCR和FCR兩個寄存器控制，校準(zhǔn)結(jié)果可以平均以提高精度。

5.4 設(shè)置輸出電壓

通過向DIR寫入代碼來設(shè)置輸出電壓，代碼可以是直二進制或偏移二進制補碼格式。在20位模式下，需寫入DIR的三個字節(jié)；在16位模式下，只需寫入兩個高字節(jié)。

5.5 快速穩(wěn)定模式

為了加快穩(wěn)定速度，DAC1220可以改變輸出濾波器的截止頻率，通過命令寄存器中的ADPT和DISF位控制自適應(yīng)濾波模式。

六、應(yīng)用信息與注意事項

6.1 布局建議

在布局方面，應(yīng)在C1和C2引腳周圍設(shè)置保護環(huán)，將電容靠近引腳放置，避免數(shù)字和模擬走線相互耦合。如果使用晶體，應(yīng)盡量避免通過過孔連接晶體，保持走線短，并考慮寄生電容的影響。

6.2 軟件考慮

與DAC1220通信時，要注意接口時序圖中的延遲，違反延遲可能導(dǎo)致輸出錯誤或通信損壞。在使用SPI外設(shè)的微控制器固件中，要確保延遲程序從字節(jié)傳輸完成后開始。

6.3 只寫接口和隔離

在某些情況下，DAC1220可以采用只寫接口，啟動后等待一段時間以確保之前的通信被取消。其串行接口便于實現(xiàn)隔離連接，在需要電隔離的應(yīng)用中具有優(yōu)勢。

七、版本差異與術(shù)語定義

7.1 版本差異

截至目前，DAC1220有兩個版本，主要差異在于命令寄存器的第13位。早期版本該位可寫且默認(rèn)值為0，當(dāng)前版本固定為1且不可寫。對于早期版本芯片，應(yīng)將該位設(shè)置為1以確保最佳性能。

7.2 術(shù)語定義

文檔中對一些關(guān)鍵術(shù)語進行了定義，如差分非線性誤差、漂移、增益誤差、線性誤差等，這些定義有助于工程師更好地理解和應(yīng)用DAC1220。

DAC1220以其高精度、低功耗和豐富的功能特性，為電子工程師在工業(yè)過程控制、測試測量等領(lǐng)域的設(shè)計提供了一個優(yōu)秀的選擇。在實際應(yīng)用中，工程師需要根據(jù)具體需求合理配置和使用該器件，同時注意布局、軟件和操作等方面的細(xì)節(jié)，以充分發(fā)揮其性能優(yōu)勢。大家在使用DAC1220的過程中遇到過哪些問題呢？歡迎在評論區(qū)分享交流。