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GPS 的干擾與抗干擾問題具有十分重要的研究意義。本文提出了一種GPS 干擾源的
設(shè)計方案，并重點分析了干擾源中頻信號的產(chǎn)生方法。中頻信號的產(chǎn)生基于FPGA 硬件平臺，頂層設(shè)計以直接數(shù)字頻率合成器(DDS)為核心模塊，可以產(chǎn)生單頻、掃頻、寬/窄帶等三種模式的低中頻干擾信號。利用AD9777 芯片同時完成對低中頻信號的數(shù)字上變頻和數(shù)模轉(zhuǎn)換，在將數(shù)字波形轉(zhuǎn)換為模擬信號的同時得到了較高中頻的干擾信號輸出。DDS 產(chǎn)生低中頻信號保證了信號失真小，AD9777 的使用節(jié)省了硬件資源。文中給出了FPGA 設(shè)計的仿真波形和最后的實測結(jié)果，結(jié)果表明該設(shè)計方案正確、可行。
設(shè)計方案，并重點分析了干擾源中頻信號的產(chǎn)生方法。中頻信號的產(chǎn)生基于FPGA 硬件平臺，頂層設(shè)計以直接數(shù)字頻率合成器(DDS)為核心模塊，可以產(chǎn)生單頻、掃頻、寬/窄帶等三種模式的低中頻干擾信號。利用AD9777 芯片同時完成對低中頻信號的數(shù)字上變頻和數(shù)模轉(zhuǎn)換，在將數(shù)字波形轉(zhuǎn)換為模擬信號的同時得到了較高中頻的干擾信號輸出。DDS 產(chǎn)生低中頻信號保證了信號失真小，AD9777 的使用節(jié)省了硬件資源。文中給出了FPGA 設(shè)計的仿真波形和最后的實測結(jié)果，結(jié)果表明該設(shè)計方案正確、可行。
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