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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA的數(shù)字量采集模塊設(shè)計(jì)

      基于FPGA的數(shù)字量采集模塊設(shè)計(jì)

      2010-12-16 | rar | 702 | 次下載 | 5積分

      資料介紹

      ?
      ?針對(duì)測(cè)控系統(tǒng)中監(jiān)測(cè)信號(hào)較多的情況，提出了一種基于FPGA的多路數(shù)字信號(hào)采集模塊設(shè)計(jì)。采集數(shù)字信號(hào)的高低狀態(tài)和測(cè)量其中一路信號(hào)的頻率，并采集脈沖信號(hào)的脈寬和時(shí)延，通過(guò)FPGA將數(shù)據(jù)編幀上傳給上位機(jī)。結(jié)合FPGA、大容量FIFO的特點(diǎn)，設(shè)計(jì)了光電隔離電路、FIFO電路、FPGA配置電路等。實(shí)現(xiàn)了USB2.0與上位機(jī)通信，通過(guò)上位機(jī)應(yīng)用軟件和驅(qū)動(dòng)程序?qū)崿F(xiàn)模塊與PC機(jī)實(shí)時(shí)通信和控制。該設(shè)計(jì)方案結(jié)構(gòu)靈活、控制簡(jiǎn)單、可靠性較高。
      Abstract:
      ?Aiming at the condition that there are many the momitoring signals in the monitor system,this paper introduces a multi-channel digital signal collecting module which takes FPGA.This module collects low or high state of the digital signals and one of the signals’ frequency,collects the pulse signals’ delay and width.The FPGA makes data into frame structure then uploads to the computer.With the characteristic of FPGA and mass capability FIFO,we design the circuit of optoelectronic coupler, FIFO and configure of FPGA.We can control and communicate the module with PC real-time within USB2.0 interface. The design scheme is easily modified, controlled and high reliability.
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