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Harris公司的工程師們經(jīng)常在緊迫的時限內(nèi)交付基于FPGA的復(fù)雜信號處理系統(tǒng)。為了滿足客戶時常十分嚴(yán)格的要求以及自身的質(zhì)量標(biāo)準(zhǔn)，工程師們會在綜合各個系統(tǒng)前徹底驗證HDL設(shè)計。
在過去，HDL驗證需要多步手工操作現(xiàn)在，Harris工程師們使用EDASimulatoLink?實現(xiàn)了MATLAB?系統(tǒng)模型與在Cadence Incisive中進行仿真的HDL設(shè)計之間的雙向鏈接，從而實現(xiàn)了驗證流程的自動化。這種新的流程消除了算法規(guī)范和HDL驗證之間的不明確性，減少了重復(fù)工作量，并改進了系統(tǒng)與HDL工程師之間的通訊。
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