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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA的頻偏估計(jì)方法的設(shè)計(jì)與實(shí)現(xiàn)

      基于FPGA的頻偏估計(jì)方法的設(shè)計(jì)與實(shí)現(xiàn)

      2011-10-11 | pdf | 63 KB | 次下載 | 免費(fèi)

      資料介紹

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      為解決直接序列擴(kuò)頻系統(tǒng)的數(shù)字收發(fā)機(jī)中初始頻率的捕獲問題，提出了一種通過DFT變換，在頻域上進(jìn)行拋物插值運(yùn)算的頻偏估計(jì)的算法。該算法可適應(yīng)低信噪比、寬頻率偏移范圍的惡劣通信環(huán)境和突發(fā)的通信模式，且算法復(fù)雜度較低。該算法已在FPGA 中實(shí)現(xiàn)。
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