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衡量FPGA設(shè)計(jì)的兩個(gè)重要指標(biāo)是吞吐率和延遲。
吞吐率：指系統(tǒng)每一個(gè)時(shí)鐘周期內(nèi)能夠處理的數(shù)據(jù)數(shù)量，為了獲得更高的吞吐率就需要減少組合邏輯延遲，在組合邏輯中間插入寄存器，也就是流水線設(shè)計(jì)。
延遲：指數(shù)據(jù)從輸入系統(tǒng)到輸出系統(tǒng)總共需要的時(shí)間，為了獲得更短的延遲，可以減少組合邏輯延遲，或者刪減路徑上的寄存器，第二種方法顯然不利于系統(tǒng)獲得更好的性能。
時(shí)序優(yōu)化的幾種方法
這里說(shuō)的優(yōu)化是讓FPGA設(shè)計(jì)獲得更高的工作頻率，也就是通常說(shuō)的性能和吞吐率。
1. 插入寄存器（pipeline）
這種方式會(huì)增加設(shè)計(jì)的時(shí)滯（clock latency）。插入了幾個(gè)寄存器，結(jié)果輸出就會(huì)延長(zhǎng)幾個(gè)周期，在不違反設(shè)計(jì)規(guī)格（對(duì)clock latency有要求）以及功能沒(méi)有影響的時(shí)滯情況之下可以這么做。舉例說(shuō)明，如果下面一個(gè)FIR濾波器的設(shè)計(jì)沒(méi)能滿足時(shí)序要求。
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