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      電子發(fā)燒友網(wǎng)>電子資料下載>C語(yǔ)言|源代碼>基于FPGA數(shù)字頻率計(jì)的設(shè)計(jì)

      基于FPGA數(shù)字頻率計(jì)的設(shè)計(jì)

      2017-08-04 | doc | 229KB | 次下載 | 1積分

      資料介紹

      數(shù)字頻率計(jì)設(shè)計(jì)要點(diǎn)，代碼（電子設(shè)計(jì)競(jìng)賽編程、寫論文時(shí)可用）

      　　2 對(duì)FPGA數(shù)字頻率計(jì)的制作規(guī)劃

      　　2.1 設(shè)計(jì)的目的

      　　掌握VHDL語(yǔ)言的基本結(jié)構(gòu)及編程思想，掌握數(shù)字頻率計(jì)的工作原理，掌握數(shù)字頻率計(jì)的VHDL語(yǔ)言編程方法。

      　　2.2 數(shù)字頻率計(jì)的基本原理

      　　數(shù)字頻率計(jì)的主要功能是測(cè)量周期信號(hào)的頻率。頻率是單位時(shí)間（ 1S ）內(nèi)信號(hào)發(fā)生周期變化的次數(shù)。如果我們能在給定的 1S 時(shí)間內(nèi)對(duì)信號(hào)波形計(jì)數(shù)，并將計(jì)數(shù)結(jié)果顯示出來(lái)，就能讀取被測(cè)信號(hào)的頻率。數(shù)字頻率計(jì)首先必須獲得相對(duì)穩(wěn)定與準(zhǔn)確的時(shí)間，同時(shí)將被測(cè)信號(hào)轉(zhuǎn)換成幅度與波形均能被數(shù)字電路識(shí)別的脈沖信號(hào)，然后通過(guò)計(jì)數(shù)器計(jì)算這一段時(shí)間間隔內(nèi)的脈沖個(gè)數(shù)，將其換算后顯示出來(lái)［3］。這就是數(shù)字頻率計(jì)的基本原理。
      基于FPGA數(shù)字頻率計(jì)的設(shè)計(jì)

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