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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>嵌入式技術論文>基于硬件加速系統(tǒng)的PCIe-SRIO橋的邏輯結構

      基于硬件加速系統(tǒng)的PCIe-SRIO橋的邏輯結構

      2017-11-03 | rar | 1.02 MB | 次下載 | 免費

      資料介紹

      　　基于混合架構的硬件加速是計算機領域中很重要的研究方向之一。它是指將一些特定的任務從通用CPU移植到硬件處理模塊上并進行相應的算法優(yōu)化。由于硬件設備的專用結構，這些硬件處理模塊往往比在基于順序指令集的CPU上運行同樣功能的軟件在速度上有大幅度的提升。

      　　文中的主要研究內(nèi)容是通用CPU和嵌入式計算硬件之間的橋接。這是硬件加速系統(tǒng)的關鍵技術問題之一，既要求較高的傳輸速率，也要求數(shù)據(jù)類型、長度、通道數(shù)量的靈活性。當前，計算機系統(tǒng)多采用PCI Express（PCIe）與外設進行數(shù)據(jù)交互。而高性能的分布式嵌入式處理系統(tǒng)則多采用SerialRapidl0 （SRIO）作為接口標準。實現(xiàn)PCIe總線到Rapidl0橋，意味著實現(xiàn)了通用計算機與多結點、多類型的分布式硬件計算子系統(tǒng)的接口能力，為硬件加速系統(tǒng)提供了跨架構的數(shù)據(jù)傳輸通道。文中介紹了一種基于FPCA的PCIe-SRIO橋接方法，在性能和功能上有效的支撐了大規(guī)模硬件加速系統(tǒng)的實現(xiàn)。

      基于硬件加速系統(tǒng)的PCIe-SRIO橋的邏輯結構

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