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      CMOS電路中抗Latch-up的保護環(huán)結構研究

      2010-05-28 | rar | 159 | 次下載 | 5積分

      資料介紹

      摘要：閂鎖是CMOS集成電路中的一種寄生效應，這種PNPN結構一旦被觸發(fā)，從電源到地會產(chǎn)生大電流，導致整個芯片的失效。針對芯片在實際測試中發(fā)現(xiàn)的閂鎖問題，介紹了閂鎖的測試方法，并且利用軟件Tsuprem4和Medici模擬整個失效過程，在對2類保護環(huán)(多子環(huán)／少子環(huán))作用的分析，以廈各種保護結構的模擬基礎之上，通過對比觸發(fā)電壓和電流．得到一種最優(yōu)的抗Latch—up版圖設計方法。通過進一步的流片、測試，解決了芯片中的閂鎖失效問題，驗證了這種結構的有效性。
      關鍵詞：寄生雙極型晶體管；保護環(huán)；閂鎖；CM0S集成電路
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