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用于移動寬帶基礎(chǔ)設(shè)施的新一代無線電數(shù)字前端解決方案
本文分析賽靈思提供的新型器件Zynq?可擴展處理平臺(EPP)將如何幫助設(shè)備制造商解決高集成度、低功耗和成本但靈活性更高方面的需求問題。
Xilinx Platform Studio(XPS)是一款普遍使用的嵌入式開發(fā)套件(EDK),其升級版XPS 8.2版本新增加了獨特的功能和性能,可進...
一邊是眾多自動駕駛玩家熱情投身其中,一邊是完全無人駕駛實現(xiàn)“遙遙無期”的不確定性。
騰訊云推出國內(nèi)首款高性能異構(gòu)計算基礎(chǔ)設(shè)施——FPGA云服務(wù)器,以云服務(wù)方式將大型公司才能長期支付使用的FPGA推廣到更多企業(yè)。
5G 可在幾乎任何地方更快、更可靠地連接數(shù)十億設(shè)備。它將遠遠超越目前的移動體驗,將為 100 倍的互聯(lián)設(shè)備與機器帶來 1000 倍的網(wǎng)絡(luò)容量,從而可改善...
采用串行IO分析器IBERT設(shè)計的賽靈思 FPGA驅(qū)動CEI-28G-VSR到插入Finisar公司CFP4 ER4f模塊的一個主機卡。 一個JDSU ...
新型RFSoC器件能將功耗和封裝尺寸減少50-75%,對高效部署5G Massive-MIMO無線電和毫米波無線回傳至關(guān)重要
Linear DC/DC微型模塊穩(wěn)壓器產(chǎn)品適用于高速串行器/解串器系統(tǒng)中
Linear宣布4 個低噪聲 DC/DC 微型模塊 (uModule) 穩(wěn)壓器已經(jīng)過賽靈思 (Xilinx) 公司檢驗,適合驅(qū)動多千兆位 RocketI...
2020-12-09 標(biāo)簽:轉(zhuǎn)換器穩(wěn)壓器賽靈思 1.2k 0
解密業(yè)界首款16nm產(chǎn)品核心技術(shù)
以賽靈思 20nm UltraScale 系列的成功為基礎(chǔ),賽靈思現(xiàn)又推出了全新的 16nm UltraScale+ 系列 FPGA、3D IC 和 M...
Xilinx可編程邏輯器件設(shè)計與開發(fā)(基礎(chǔ)篇)連載30:Spartan
Xilinx針對不同類型的調(diào)試IP核,提供了不同的核生成器。本節(jié)重點介紹Xilinx Core Generator Tool(Xilinx IP核生成器...
Xilinx可編程邏輯器件設(shè)計與開發(fā)(基礎(chǔ)篇)連載16:Spartan
Spartan-6器件具有2或4個專用嵌入式多端口存儲器控制器模塊(MCB),實現(xiàn)了到4個常見存儲器標(biāo)準(zhǔn)的簡單連接:DDR3、DDR2、DDR 和LPD...
Xilinx可編程邏輯器件設(shè)計與開發(fā)(基礎(chǔ)篇)連載33:Spartan
下面通過一個簡單8位計數(shù)器的例子,了解如何在工程中添加ChipScope Pro內(nèi)核生成器的各個IP核,對FPGA內(nèi)部節(jié)點和邏輯進行觀測。在該實例中,我...
Xilinx可編程邏輯器件設(shè)計與開發(fā)(基礎(chǔ)篇)連載26:Spartan
Virtex-6支持多種高速串行接口,其中高速串行模塊GTX收發(fā)器可以實現(xiàn)150Mbit/s~6.5Gbit/s的線速率。GTX收發(fā)器是芯片與芯片之間、...
賽靈思重點發(fā)展領(lǐng)域 高效率視頻編碼是什么
視頻無處不在。它一直是用于娛樂、信息與教育的工具,為賽靈思帶來了大量極好的機遇,特別是在涉及到更多、更好、更快像素時。我們已經(jīng)看到分辨率超過 1080p...
Xilinx可編程邏輯器件設(shè)計與開發(fā)(基礎(chǔ)篇)連載45:Spartan
本節(jié)將簡單介紹在PlanAhead工具中如何應(yīng)用ChipScope核和分析工具進行邏輯調(diào)試與驗證。先通過一個向?qū)hipScope核插入設(shè)計中,選擇待...
Xilinx可編程邏輯器件設(shè)計與開發(fā)(基礎(chǔ)篇)連載49:Spartan
通常情況下,如果對性能要求不是太高,最好是讓PicoBlaze在低頻下工作,因為它所處理的外設(shè)一般為低速設(shè)備,例如,串行通信,按鍵等。另外,低頻工作也會...
Xilinx可編程邏輯器件設(shè)計與開發(fā)(基礎(chǔ)篇)連載10:Spartan
Spartan-6的時鐘布線網(wǎng)絡(luò)包括由BUFGMUX驅(qū)動的全局時鐘網(wǎng)絡(luò)和由I/O時鐘緩沖器(BUFIO2)、PLL時鐘緩沖器(BUFPLL)驅(qū)動的I/O...
Xilinx可編程邏輯器件設(shè)計與開發(fā)(基礎(chǔ)篇)連載40:Spartan
最大化【Package Pins】,如圖10-45 所示, 和按鈕配合,完成對器件引腳的排序,如圖中我們將所有VREF 引腳排在一起,選中所有VREF ...
Xilinx可編程邏輯器件設(shè)計與開發(fā)(基礎(chǔ)篇)連載37:Spartan
這里介紹如何用PlanAhead進行RTL代碼開發(fā)與分析。需要說明一點,本章所用的所有實例都可以在PlanAhead的安裝目錄E:\Xilinx\11....
Xilinx可編程邏輯器件設(shè)計與開發(fā)(基礎(chǔ)篇)連載32:Spartan
雙擊【Xilinx Core Generator】,打開現(xiàn)有的IP核工程項目或者創(chuàng)建一個新的IP核工程。
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