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標(biāo)簽 > altera
自二十年前發(fā)明世界上第一個(gè)可編程邏輯器件開始,Altera公司(阿爾特拉)(NASDAQ:ALTR)秉承了創(chuàng)新的傳統(tǒng),是世界上“可編程芯片系統(tǒng)”(SOPC)解決方案倡導(dǎo)者。Altera結(jié)合帶有軟件工具的可編程邏輯技術(shù)、知識(shí)產(chǎn)權(quán)(IP)和技術(shù)服務(wù),在世界范圍內(nèi)為14,000多個(gè)客戶提供高質(zhì)量的可編程解決方案。
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可編程硬件發(fā)展路線分析:eFPGA還是FPGA SoC
eFPGA IP和FPGA SoC,誰(shuí)將在未來更受歡迎呢?筆者認(rèn)為,這兩種生態(tài)都表明了SoC在摩爾定律遇到瓶頸的今天走向可配置的潮流,只是eFPGA從S...
Are you interested in the new generation of high-speed ADCs with serial inte...
Fujisoft公司在Altera SoC合作伙伴研討會(huì)上演講的主題:Fujisoft Android SoC FPGA解決方案
目前,大多數(shù) FPGA 芯片是基于 SRAM 的結(jié)構(gòu)的, 而 SRAM 單元中的數(shù)據(jù)掉電就會(huì)丟失,因此系統(tǒng)上電后,必須要由配置電路將正確的配置數(shù)據(jù)加載到...
Altera 的 MAX? 10 FPGA 在低成本、單芯片小外形封裝可編程邏輯器件中實(shí)現(xiàn)了先進(jìn)的處理功能,是革命性的非易失集成器件。繼承了前一代 MA...
介紹MAX 10 FPGA的特點(diǎn)及應(yīng)用
此次培訓(xùn)涉及到MAX 10 FPGA所支持的配置方法,介紹非易失集成、瞬時(shí)接通配置和雙配置鏡像的價(jià)值所在。
關(guān)于MAX 10 FPGA PLL和時(shí)鐘特性選項(xiàng)的培訓(xùn)
MAX 10 FPGA PLL和時(shí)鐘培訓(xùn),此次培訓(xùn)涉及到器件系列的時(shí)鐘特性和選項(xiàng)。有20個(gè)全局時(shí)鐘網(wǎng)絡(luò),全局CLK輸入引腳數(shù)量也可以加倍,用作通用IO引...
如何設(shè)計(jì)32位Nios OS II嵌入式處理器
You may know about the cost and performance advantages of designing systems ...
MAX 10 FPGA GPIO的特點(diǎn)優(yōu)勢(shì)
MAX 10 FPGA GPIO培訓(xùn),可編程邏輯一般用作膠合邏輯,連接電路板上的大量數(shù)字邏輯器件,這些器件通常有不同的I/O標(biāo)準(zhǔn)、電壓電平和協(xié)議。這里列...
Xilinx FPGA的組成部分 本文是以Xilinx Kintex UltraScale+ 系列為參考所寫,其他系列有所不同,可以參考相應(yīng)的user ...
簡(jiǎn)述 Stratix 10 外部存儲(chǔ)器接口作用
Stratix 10外部存儲(chǔ)器接口指南
2018-06-20 標(biāo)簽:altera外部存儲(chǔ)器 2832 0
基于Altera FPGA高清晰視頻去隔行功能的實(shí)現(xiàn)
對(duì)于很多基礎(chǔ)設(shè)施、軍事應(yīng)用以及工業(yè)系統(tǒng), FPGA是實(shí)現(xiàn)高質(zhì)量視頻去隔行功能的理想平臺(tái)。系統(tǒng)需求決定了所采用的去隔行算法的復(fù)雜度,而Altera Cyc...
Altera以太網(wǎng)路IP核心 降低FPGA設(shè)計(jì)難度
Altera推出40Gbit/s以太網(wǎng)路(40GbE)和100Gbit/s以太網(wǎng)路(100GbE)矽智財(cái)(IP)核心產(chǎn)品。這些核心能高效率的建構(gòu)需大傳輸...
怎樣為自己的設(shè)計(jì)選擇Altera Cyclone V FPGA?
Altera的Cyclone V FPGA目前是業(yè)界系統(tǒng)總成本和功耗最低的FPGA,那我們?cè)撛鯓訛樽约旱脑O(shè)計(jì)選擇Altera Cyclone V FPG...
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