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DDR=Double Data Rate雙倍速率同步動態(tài)隨機存儲器。嚴(yán)格的說DDR應(yīng)該叫DDR SDRAM，人們習(xí)慣稱為DDR，其中，SDRAM 是Synchronous Dynamic Random Access Memory的縮寫，即同步動態(tài)隨機存取存儲器。

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ddr技術(shù)

一種數(shù)字delayline的設(shè)計方案

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2024-01-07 標(biāo)簽：接口 DDR 時鐘信號 2213 0

聊一聊以太網(wǎng)的各個接口

當(dāng)今，隨著互聯(lián)網(wǎng)技術(shù)的迅速發(fā)展，采用以太網(wǎng)實現(xiàn)數(shù)據(jù)采集和控制方面的應(yīng)用，成為了電子系統(tǒng)設(shè)計的熱點。

2024-01-03 標(biāo)簽：DDR PHY RMII 8100 0

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2024-01-02 標(biāo)簽：DDR PDA 仿真分析 1577 0

DDR終端匹配電阻的長度多少合適？

上次我們對不加端接電阻和加端接電阻之后的仿真結(jié)果做了分析之后我們得出在DDR采用菊花鏈拓?fù)浣Y(jié)構(gòu)的時候是需要加端接電阻的，這次我們看看DDR末端的端接電阻...

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多片DDR菊花鏈拓?fù)溥B接時末端的電阻都是起什么作用的呢？

大家如果做過DDR的設(shè)計可能會發(fā)現(xiàn)在進行多片DDR連線時，通常在信號的末端會放置很多的電阻(如下圖所示)，那么這些電阻都是起什么作用的呢？

2023-12-18 標(biāo)簽：二極管驅(qū)動器阻抗匹配 1163 0

介紹五種不同類型的存儲器

DDR是指雙倍數(shù)據(jù)速率的同步動態(tài)隨機訪問內(nèi)存（Double Data Rate Synchronous Dynamic Random Access Me...

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什么是幀緩存？在FPGA上關(guān)于DDR的幀緩存介紹

在視頻處理系統(tǒng)中，將輸入的圖像以幀為單位儲存到存儲器（DDR）中，再根據(jù)輸出時序需求，讀取圖像并輸出，達到幀率變換、暫停顯示的目的。

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基于5納米技術(shù)的SoC設(shè)計功能挑戰(zhàn)

沿著從 SoC 到高級封裝技術(shù)（如 InFo/Feveros/X-Cube）的路徑，需要一種整體方法來同時解決項目的規(guī)劃、編輯和優(yōu)化環(huán)境問題。以及向后考...

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復(fù)位那些小事—典型的軟復(fù)位流程

在聊到復(fù)位的時候總會區(qū)分兩個概念：硬復(fù)位和軟復(fù)位。

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DDR仿真和測試完美對應(yīng)的經(jīng)典案例

不知道現(xiàn)在大家做的DDR4系統(tǒng)的指標(biāo)是怎么樣了？從高速先生和最近眾多客戶的配合來看，從一個通道的總?cè)萘亢退俾噬隙蓟旧侠搅藰O限，從單個顆粒的容量，很多...

2023-12-04 標(biāo)簽：芯片 DDR DDR4 1500 0

淺談DDR SDRAM的Timing具體時序參數(shù)

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2023-12-02 標(biāo)簽：SDRAM 寄存器 DDR 5568 0

AXI通道讀寫DDR的阻塞問題？

基于vivado2020.1和zcu102開發(fā)板(rev1.1)開發(fā)項目，工程涉及DDR4（MIG）和PL端多個讀寫接口交互的問題，通過AXI inte...

2023-12-01 標(biāo)簽：HDMI DDR AXI總線 1519 0

硬件電路設(shè)計之DDR電路設(shè)計(4)

DDR4(第四代雙倍數(shù)據(jù)速率同步動態(tài)隨機存取存儲器)是一種高帶寬的存儲器，今天主要講述一下DDR4在Layout過程中的一些細(xì)節(jié)。在DDR的設(shè)計過程中，...

2023-11-29 標(biāo)簽：存儲器電路設(shè)計 DDR 1.2萬 0

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本文主要講述一下DDR從0到1設(shè)計的整個設(shè)計的全過程，有需要的朋友可先安排收藏。

2023-11-29 標(biāo)簽：電路圖電路設(shè)計 DDR 6111 0

硬件電路設(shè)計之DDR電路設(shè)計(1)

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2023-11-24 標(biāo)簽：SDRAM 存儲器電路設(shè)計 6458 0

低功耗雙倍速率同步動態(tài)隨機存取存儲器介紹

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簡單認(rèn)識雙倍速率同步動態(tài)隨機存取存儲器

在同步動態(tài)隨機存取存儲器（SDRAM)的工作模式中，以數(shù)據(jù)讀取速率來分類，有單倍數(shù)據(jù)速率 (Single Data Rate, SDR) SDRAM、雙...

2023-11-20 標(biāo)簽：SDRAM 存儲器 DDR 1483 0

如何處理cache miss問題以提高加速器效率呢？

帶寬是影響FPGA加速器的重要因素，因為大量的并行計算對數(shù)據(jù)量要求很大。

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高性能SoC的“雙引擎”—DDR與PCIe

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用生成式AI設(shè)計芯片：解讀時序圖

在其眾多應(yīng)用中，一個特別有趣的領(lǐng)域是生成式AI 解釋數(shù)字設(shè)計波形并在調(diào)試過程中充當(dāng)硬件工程師輔助的能力。

2023-11-07 標(biāo)簽：DDR 人工智能調(diào)試器 902 0

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802.11ac與11基站測試（base station tests）在基站設(shè)備安裝完畢后，對基站設(shè)備電氣性能所進行的測量。n的區(qū)別，802.11n無線網(wǎng)卡驅(qū)動，802.11n怎么安裝。
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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進行靜電中和等。
OBD

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