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FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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三輸出和雙輸出微型模塊穩(wěn)壓器對(duì)基于FPGA的系統(tǒng)優(yōu)化方案
盡管 FPGA 的通用和可配置特性對(duì)系統(tǒng)設(shè)計(jì)師來說很有吸引力,但是影響這些器件內(nèi)部運(yùn)行方式及其外部接口協(xié)議的設(shè)計(jì)規(guī)則非常復(fù)雜,需要大量的培訓(xùn)、參考設(shè)計(jì)評(píng)...
Microchip在Microchip PolarFire SoC和基于SRAM的競爭性FPGA SoC上實(shí)現(xiàn)了相同的設(shè)計(jì)。在這兩款器件上,使用供應(yīng)商特...
采用可編輯邏輯器件實(shí)現(xiàn)智能變送器的應(yīng)用方案
在工業(yè)自動(dòng)化控制系統(tǒng)中,過程參數(shù)壓力、差壓、絕對(duì)壓力、流量等工藝參數(shù)均要嚴(yán)格控制,而這類參數(shù)的測量與監(jiān)控大多使用變送器。變送器是玉業(yè)過程重要的基礎(chǔ)自動(dòng)化...
在FPGA設(shè)計(jì)中如何充分利用NoC資源去支撐創(chuàng)新應(yīng)用設(shè)計(jì)
Achronix 在其最新基于臺(tái)積電(TSMC)7nm FinFET工藝的Speedster7t FPGA器件中包含了革命性的創(chuàng)新型二維片上網(wǎng)絡(luò)(2D ...
2020-08-21 標(biāo)簽:fpga存儲(chǔ)器數(shù)據(jù)傳輸 937 0
如何使用 FPGA 實(shí)現(xiàn)深度學(xué)習(xí)
本次針對(duì)的 MNIST 數(shù)據(jù)集是一個(gè)非常小的數(shù)據(jù)集,圖像大小為 28×28。此外,該模型是一個(gè)非常輕量級(jí)的網(wǎng)絡(luò)模型。如果將這些做成更真實(shí)的數(shù)據(jù)模型,計(jì)算...
2023-05-11 標(biāo)簽:fpga深度學(xué)習(xí) 936 0
現(xiàn)場可編程門陣列(FPGA)是一種由半導(dǎo)體材料制成的集成電路,用戶購買后可以重新編程或配置,以滿足特定功能或應(yīng)用需求。其控制程序存儲(chǔ)在內(nèi)存中,加電后,程...
FPGA設(shè)計(jì)高級(jí)技巧(Xilinx篇)
隨著HDL (Hardware Description Language,硬件描述語言)語言、綜合工具及其它相關(guān)工具的推廣,使廣大設(shè)計(jì)工程師從以往煩瑣的...
"FPGA的優(yōu)勢(shì)加上實(shí)時(shí)信號(hào)處理功能,有助于提高測試速度。 同時(shí),F(xiàn)PGA編程的靈活性可以快速響應(yīng)新協(xié)議的測試需求。"- Chun Zhang, Ins...
如何使用Verilog實(shí)現(xiàn)具有預(yù)生成系數(shù)的簡單FIR濾波器?
不起眼的 FIR 濾波器是 FPGA 數(shù)字信號(hào)處理中最基本的模塊之一,因此了解如何將具有給定抽頭數(shù)及其相應(yīng)系數(shù)值的基本模塊組合在一起非常重要。
為什么需要高速轉(zhuǎn)換器轉(zhuǎn)FPGA串行接口
通道數(shù)據(jù)速率定義為312.5 Mbps與3.125 Gbps之間,源阻抗與負(fù)載阻抗定義為100 Ω ±20%。差分電平定義為標(biāo)稱800 mV峰峰值、共模...
由于定點(diǎn)的四則運(yùn)算比較簡單,如加減法只要注意符號(hào)擴(kuò)展,小數(shù)點(diǎn)對(duì)齊等問題即可。在本文中,運(yùn)用在前一節(jié)中描述的自定義浮點(diǎn)格式FPGA中數(shù)的表示方法(下),完...
創(chuàng)意耳紋識(shí)別系統(tǒng)的研究與實(shí)現(xiàn)方案
基于FPGA與傳感技術(shù)的耳紋識(shí)別系統(tǒng)的研究與實(shí)現(xiàn)。
2014-07-24 標(biāo)簽:FPGA傳感器技術(shù) 931 0
FPGA原型驗(yàn)證的原理是將芯片RTL代碼綜合到FPGA上來驗(yàn)證芯片的功能。對(duì)于目前主流行業(yè)應(yīng)用而言,芯片規(guī)模通常達(dá)到上億門甚至數(shù)十億門,一顆FPGA的容...
封裝寄存器進(jìn)VO緩沖器的概念及其優(yōu)點(diǎn)簡析
許多FPGA有構(gòu)造在輸入和輸出緩沖器中的觸發(fā)器來優(yōu)化芯片的時(shí)序入和出。同時(shí)這些專門的IO緩沖器是使能或禁止把這些寄存器封裝進(jìn)V0的一個(gè)優(yōu)化。
FPGA時(shí)序約束一如何查看具體錯(cuò)誤的時(shí)序路徑
時(shí)間裕量包括建立時(shí)間裕量和保持時(shí)間裕量(setup slack和hold slack)。從字面上理解,所謂“裕量”即富余的、多出的。什么意思呢?即保持最...
2022-08-04 標(biāo)簽:fpga 931 0
本文將助力于你規(guī)避FPGA選型和設(shè)計(jì)過程中的許多難題
如果你在采用FPGA的電路板設(shè)計(jì)方面的經(jīng)驗(yàn)很有限或根本沒有,那么在新的項(xiàng)目中使用FPGA的前景就十分堪憂——特別是如果FPGA是一個(gè)有1000個(gè)引腳的大...
2019-01-21 標(biāo)簽:FPGA 931 0
FPGA電源系統(tǒng)設(shè)計(jì)師面臨的設(shè)計(jì)復(fù)雜性和不確定性根源淺析
如果設(shè)計(jì)師可以在開發(fā)過程早期就滿足基于FPGA的設(shè)計(jì),提出的功耗要求和約束條件,那么在系統(tǒng)的最終實(shí)現(xiàn)階段就能形成極具競爭力的優(yōu)勢(shì)。然而,根據(jù)整個(gè)技術(shù)文獻(xiàn)...
2019-02-25 標(biāo)簽:FPGA 930 0
FPGA的可重構(gòu)測控系統(tǒng)應(yīng)用設(shè)計(jì)的研究
本文根據(jù)測控系統(tǒng)的通用結(jié)構(gòu)模型和FPGA的可重構(gòu)功能特點(diǎn),提出了一種基于FPGA器件,針對(duì)嵌入式應(yīng)用有效縮短開發(fā)周期和設(shè)計(jì)與應(yīng)用成本,滿足并行性、多任務(wù)...
這個(gè)項(xiàng)目的目標(biāo)是創(chuàng)建一個(gè)交互式的熱擴(kuò)散模擬器,它使用離散域上的熱方程,允許用戶在VGA屏幕上選擇熱源和熱匯,并在VGA屏幕上實(shí)時(shí)模擬出隨之產(chǎn)生的反應(yīng)。
FPGA+DSPs+ARM的數(shù)字信號(hào)處理系統(tǒng)對(duì)比
信號(hào)處理系統(tǒng)一般不單單是模擬信號(hào)或者數(shù)字信號(hào),一般兩者都會(huì)有。信號(hào)的處理關(guān)注的是信號(hào)以及信號(hào)所包含的信息的表示、變換及運(yùn)算。
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