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RTL在電子科學(xué)中指的是寄存器轉(zhuǎn)換級(jí)電路（Register Transfer Level）的縮寫(xiě)，也叫暫存器轉(zhuǎn)移層次。

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rtl技術(shù)

基于R828D調(diào)諧器芯片接收器RTL-SDR BLOG V4短波和濾波改善

改進(jìn)短波接收。現(xiàn)在使用一個(gè)內(nèi)置的上變頻器，而不是使用直接采樣電路。這意味著沒(méi)有更多的奈奎斯特折疊約14.4 MHz的信號(hào)，提高靈敏度，和可調(diào)的高頻增益。

2023-08-22 標(biāo)簽：接收器 SDR 調(diào)諧器 5971 0

數(shù)字IC前端設(shè)計(jì)+后端設(shè)計(jì)流程實(shí)現(xiàn)

RTL 設(shè)計(jì)** ：芯片功能設(shè)計(jì)。硬件描述語(yǔ)言如 Verilog、VHDL、SystemVerilog。

2023-11-08 標(biāo)簽：緩沖器 IC設(shè)計(jì)EDA工具 5856 0

【紫光同創(chuàng)國(guó)產(chǎn)FPGA教程】【第六章】PDS下按鍵消抖實(shí)驗(yàn)

按鍵做為基本的人機(jī)輸入接口，在很多電子設(shè)計(jì)中都能見(jiàn)到，由于機(jī)械特性，在按鍵按下或松開(kāi)的時(shí)候，按鍵輸入值是有抖動(dòng)的，無(wú)論按下去是多平穩(wěn)，都難以消除抖動(dòng)，按...

2021-02-04 標(biāo)簽：fpga RTL 按鍵 5754 0

用Elaborated Design優(yōu)化RTL的代碼

在Vivado FlowNavigator中有一個(gè)Elaborated Design，如下圖所示，屬于RTL Analysis這一步對(duì)應(yīng)的設(shè)計(jì)。可能很多...

2020-10-21 標(biāo)簽：RTL design 5686 0

如何調(diào)試設(shè)計(jì)中的時(shí)鐘域交匯問(wèn)題

本篇博文中的分析是根據(jù)客戶(hù)真實(shí)問(wèn)題撰寫(xiě)的，該客戶(hù)發(fā)現(xiàn)即使時(shí)序已得到滿(mǎn)足的情況下，硬件功能仍出現(xiàn)錯(cuò)誤。最后發(fā)現(xiàn)，問(wèn)題與時(shí)鐘域交匯（Clock Domai...

2021-08-20 標(biāo)簽：寄存器 RTL CDC 5591 0

JK觸發(fā)器與T觸發(fā)器的Verilog代碼實(shí)現(xiàn)和RTL電路實(shí)現(xiàn)

JK 觸發(fā)器的 Verilog 代碼實(shí)現(xiàn)和 RTL 電路實(shí)現(xiàn)

2023-10-09 標(biāo)簽：RTL JK觸發(fā)器觸發(fā)器 5521 0

談?wù)凢ormal驗(yàn)證中的Equivalence Checking

Lec形式驗(yàn)證想必ICer們都很熟悉，尤其是中后端的IC工程師，在正常邏輯綜合生成網(wǎng)表過(guò)后或DFT插入mbist等可測(cè)試邏輯綜合后，需要對(duì)綜合后產(chǎn)生的網(wǎng)...

2023-04-08 標(biāo)簽：IC eda RTL 5386 0

偽隨機(jī)數(shù)和真隨機(jī)數(shù)的區(qū)別是什么呢？

隨機(jī)驗(yàn)證中的隨機(jī)其實(shí)都是基于偽隨機(jī)發(fā)生器的，即每次都使用一個(gè)唯一的種子生成相應(yīng)的激勵(lì)。

2023-04-17 標(biāo)簽：EDA工具發(fā)生器 RTL 5345 0

推薦一個(gè)Joules里十分好用的小功能—Xreplay.Joules

設(shè)計(jì)團(tuán)隊(duì)會(huì)提供給實(shí)現(xiàn)團(tuán)隊(duì)RTL 跟RTL 對(duì)應(yīng)的仿真波形，而RTL 仿真波形中只有 “state points” 的信息<所謂state poin...

2022-11-25 標(biāo)簽：VCD RTL 5193 0

Clock Gating的特點(diǎn)、原理和初步實(shí)現(xiàn)

當(dāng)下這社會(huì)，沒(méi)有幾萬(wàn)個(gè)Clock Gating，出門(mén)都不好意思和別人打招呼！

2023-07-17 標(biāo)簽：驅(qū)動(dòng)器寄存器 RTL 5137 0

芯片設(shè)計(jì)進(jìn)階之路—Reset深入理解

復(fù)位信號(hào)在數(shù)字電路里面的重要性?xún)H次于時(shí)鐘信號(hào)。對(duì)一個(gè)芯片來(lái)說(shuō)，復(fù)位的主要目的是使芯片電路進(jìn)入一個(gè)已知的，確定的狀態(tài)。

2023-06-18 標(biāo)簽：寄存器仿真器 RTL 5117 0

Vivado里如何手動(dòng)調(diào)整編譯順序

通常情況下，一旦創(chuàng)建好Vivado工程，添加了相應(yīng)的RTL文件，Vivado會(huì)自動(dòng)找到設(shè)計(jì)的頂層文件，正確地顯示設(shè)計(jì)層次。在這個(gè)過(guò)程中，Vivado會(huì)自...

2023-01-06 標(biāo)簽：文件 RTL 編譯 4960 0

探討一下SDC的各種語(yǔ)法構(gòu)成和整體結(jié)構(gòu)

SDC是一個(gè)設(shè)計(jì)從RTL到netlist的橋梁，是FE/ME/BE都需要掌握的一項(xiàng)基本技能。通常情況來(lái)說(shuō)，由前端工程師（designer）提供SDC文件...

2023-07-06 標(biāo)簽：EDA工具 RTL DRC 4956 0

TTL三態(tài)門(mén)輸出電路優(yōu)點(diǎn) TTL三態(tài)門(mén)輸出電路圖

TTL三態(tài)門(mén)輸出電路是一種重要的接口元件，它能夠提供三種輸出狀態(tài)：高電平、低電平和高阻態(tài)。這種電路在實(shí)現(xiàn)數(shù)字系統(tǒng)之間的連接和數(shù)據(jù)傳輸時(shí)起著至關(guān)重要的作用。

2024-02-18 標(biāo)簽：TTL電路逆變器晶體管 4915 0

脫離代碼談芯片驗(yàn)證關(guān)鍵指標(biāo)：覆蓋率

驗(yàn)證覆蓋率（Verification Coverage）的存在是為了試圖回答這樣一個(gè)問(wèn)題：“你怎么知道驗(yàn)證已經(jīng)完成？”

2023-04-17 標(biāo)簽：EDA工具 RTL fsm 4883 0

通過(guò)ModelSim-Altera生成測(cè)試臺(tái)并通過(guò)NativeLink運(yùn)行RTL仿真的步驟

如何通過(guò)ModelSim-Altera生成測(cè)試臺(tái)，并通過(guò)NativeLink運(yùn)行RTL仿真

2018-06-22 標(biāo)簽：altera 仿真 rtl 4798 0

X態(tài)是什么？X態(tài)有什么危害？如何避免X態(tài)的產(chǎn)生？X態(tài)怎么處理？

Verilog 和 SV 定義了四種邏輯狀態(tài)：0，1，Z 及 X

2023-11-15 標(biāo)簽：仿真器 vhdl 鎖存器 4760 0

SDC是如何煉成的？怎么去驗(yàn)收SDC呢？

STA是由SDC驅(qū)動(dòng)的，所以SDC的完整性、正確性和一致性直接決定著綜合、布局布線(xiàn)以及STA的有效性。

2023-06-28 標(biāo)簽：RTL STA SDC 4750 0

如何運(yùn)行內(nèi)存接口生成器GUI以生成RTL

通過(guò)使用流量生成器創(chuàng)建示例設(shè)計(jì)，運(yùn)行綜合和實(shí)現(xiàn)以及查看摘要報(bào)告（利用率，功率等），了解如何運(yùn)行內(nèi)存接口生成器（MIG）GUI以生成RTL和約束文件

2018-11-23 標(biāo)簽：賽靈思內(nèi)存 rtl 4709 0

低功耗之門(mén)控時(shí)鐘設(shè)計(jì)

clock gating和power gating是降低芯片功耗的常用手段，相比power gating設(shè)計(jì)，clock gating的設(shè)計(jì)和實(shí)現(xiàn)更為簡(jiǎn)...

2023-06-29 標(biāo)簽：寄存器鎖存器 RTL 4625 0

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廣東高云半導(dǎo)體科技股份有限公司提供編程設(shè)計(jì)軟件、IP核、參考設(shè)計(jì)、演示板等服務(wù)的完整FPGA芯片解決方案。
Zedboard

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ZedBoard是基于Xilinx Zynq?-7000擴(kuò)展式處理平臺(tái)（EPP）的低成本開(kāi)發(fā)板。此板可以運(yùn)行基于Linux，Android，Windows?或其他OS/ RTOS的設(shè)計(jì)。
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I2S總線(xiàn)，又稱(chēng) 集成電路內(nèi)置音頻總線(xiàn)，是飛利浦公司為數(shù)字音頻設(shè)備之間的音頻數(shù)據(jù)傳輸而制定的一種總線(xiàn)標(biāo)準(zhǔn)，該總線(xiàn)專(zhuān)門(mén)用于音頻設(shè)備之間的數(shù)據(jù)傳輸，廣泛應(yīng)用于各種多媒體系統(tǒng)。
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邏輯芯片又叫可編程邏輯器件，英文全稱(chēng)為：programmable logic device 即 PLD。PLD是做為一種通用集成電路產(chǎn)生的，他的邏輯功能按照用戶(hù)對(duì)器件編程來(lái)確定。一般的PLD的集成度很高，足以滿(mǎn)足設(shè)計(jì)一般的數(shù)字系統(tǒng)的需要。
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Samtec(申泰)公司是一家總部位于美國(guó)，致力于研發(fā)和生產(chǎn)高速數(shù)據(jù)通信連接器的供應(yīng)商，Samtec連接器使用100%液晶聚合物以及純磷青銅和鈹銅制造，擁有軍品級(jí)的技術(shù)參數(shù)，其產(chǎn)品包括各種通用標(biāo)準(zhǔn)的連接器以及通信線(xiàn)纜，并且為客戶(hù)提供解決方案。
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eFPGA，全稱(chēng)為嵌入式FPGA（Embedded FPGA），顧名思義是將類(lèi)似于FPGA的可編程邏輯陣列“嵌入”到ASIC或SoC中。
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