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標簽 > rtl
RTL在電子科學中指的是寄存器轉換級電路(Register Transfer Level)的縮寫,也叫暫存器轉移層次。
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英諾達(成都)電子科技有限公司隆重推出芯片設計早期RTL級功耗優(yōu)化工具—EnFortius RTL Power Explorer(ERPE),該工具可以...
Cadence Verisium Debug:統(tǒng)一調試平臺,加速SoC設計
Cadence的統(tǒng)一調試平臺Verisium Debug,為從IP到SoC級別的復雜設計提供了全面的調試解決方案。該平臺集成了多種調試功能,包括RTL調...
2025-02-17 標簽:CadenceSoC設計數(shù)據(jù)庫 544 0
立芯董事長陳建利入選2024上海青年科技創(chuàng)業(yè)十大先鋒
5月18日,第五屆上海創(chuàng)新創(chuàng)業(yè)青年50人論壇在上海中心舉辦,本屆論壇重磅推出了今年的上海青年科技創(chuàng)業(yè)年度十大先鋒,上海立芯董事長陳建利入選。
上海立芯亮相ISEDA 2024,共話EDA發(fā)展“芯”問題
2024年5月10日至13日,2024 International Symposium of EDA(ISEDA 2024)在西安陜西賓館成功舉辦。
當CPU算力趨近極限,GPU能否替代CPU滿足數(shù)字芯片設計的算力需求?
就數(shù)字設計實現(xiàn)而言,RTL-to-GDSII流程中的每一步都涉及海量計算。在SoC級別,開發(fā)者需要評估數(shù)百個分區(qū)的各種版圖規(guī)劃選項,從而更大限度減少互連...
奇捷科技Function ECO解決方案助力企業(yè)降本增效
2024年3月28日-29日,奇捷科技(Easy-Logic Technology),作為EDA行業(yè)邏輯功能變更領域的技術引領者,受邀參加2024國際集...
上海立芯自主研發(fā)項目入圍“上海市高新技術成果轉化項目”
上海科學技術委員會發(fā)布2024年第一批上海市高新技術成果轉化項目名單,立芯“LePlace布局及物理優(yōu)化軟件”項目成功通過認定。
Multi-Die系統(tǒng)驗證很難嗎?Multi-Die系統(tǒng)驗證的三大挑戰(zhàn)
在當今時代,摩爾定律帶來的收益正在不斷放緩,而Multi-Die系統(tǒng)提供了一種途徑,通過在單個封裝中集成多個異構裸片(小芯片),能夠為計算密集型應用降低...
驗證開發(fā)者大約把三分之一的時間都用于提高驗證覆蓋率以發(fā)現(xiàn)缺陷的任務上。
西門子發(fā)布Tessent RTL Pro加速下一代關鍵可測試性設計任務
西門子數(shù)字化工業(yè)軟件近日推出Tessent RTL Pro 創(chuàng)新軟件解決方案,旨在幫助集成電路(IC) 設計團隊簡化和加速下一代設計的關鍵可測試性設計(...
英諾達發(fā)布了自主研發(fā)的EnFortius?凝鋒?RTL級功耗分析工具,可以在IC設計流程早期對電路設計進行優(yōu)化。
如果在數(shù)據(jù)中心和邊緣設備中部署上人工智能(AI)加速器,那么它們將能夠快速處理PB級的數(shù)據(jù)量,還能幫助克服傳統(tǒng)的馮·諾依曼瓶頸。
國產(chǎn)DSP芯片廠商蘇州洪芯完成千萬級Pre-A輪融資
蘇州洪芯擁有soc/dsp架構設計、rtl實現(xiàn)和驗證、版圖設計成套測試設計及軟件開發(fā)等完善的芯片設計團隊。公司的核心成員曾參與世界上最早的4g基礎soc...
時序仿真與功能仿真的區(qū)別有哪些? 時序仿真和功能仿真都是電子設計自動化(EDA)過程中的常見任務,它們都是為了驗證或驗證電路設計的正確性。然而,它們之間...
Timer測試方案 Timer測試平臺實現(xiàn) 測試平臺debug注意事項
IC驗證,一般也稱“功能驗證”,我們今天要講的,不是這個,是它的簡化版:模塊測試,是設計工程師完成代碼設計后,需要自己做的這部分驗證工作。IC驗證,我們...
異步電路特點:電路中沒有統(tǒng)一的時鐘(可以有多個時鐘),有些觸發(fā)器的時鐘輸入端與時鐘脈沖源相連(與時鐘脈沖源同步),其余觸發(fā)器狀態(tài)變化不與時鐘脈沖源同步;...
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