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Xilinx是全球領先的可編程邏輯完整解決方案的供應商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級集成電路、軟件設計工具以及作為預定義系統(tǒng)級功能的IP(Intellectual Property)核。
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對于FPGA調試,主要以Intel FPGA為例,在win10 Quartus ii 17.0環(huán)境下進行仿真和調試,開發(fā)板類型EP4CE15F17。
Xilinx可編程邏輯器件設計與開發(fā)(基礎篇)連載21:Spartan
為了更好的控制時鐘,Virtex-6器件分成若干個時鐘區(qū)域,最小器件有6個區(qū)域,最大器件有18個區(qū)域。每個時鐘區(qū)域高40個CLB。在時鐘設計中,推薦使用...
本文涵蓋了在 Versal GTY 和 GTYP 中使用模式生成器和檢查器時對以下操作的限制
最近幾天讀了Xilinx網(wǎng)站上一個很有意思的白皮書(white paper,wp272.pdf),名字叫《Get Smart About Reset:T...
賽靈思(Xilinx)如何實現(xiàn)更出色的工業(yè)自動化應用?
Xilinx All Programmable 平臺和解決方案可實現(xiàn)更出色的工業(yè)自動化和工業(yè)成像應用。Xilinx FPGA 和 Zynq-7000 A...
Xilinx可編程邏輯器件設計與開發(fā)(基礎篇)連載22:Spartan
除了豐富的時鐘網(wǎng)絡以外,Xilinx還提供了強大的時鐘管理功能,提供更多更靈活的時鐘。Xilinx在時鐘管理上不斷改進,從Virtex-4的純數(shù)字管理單...
如何解決MPSoC萬兆以太網(wǎng)應用中UDP接收丟包問題
本文介紹如何使能 Linux 網(wǎng)絡協(xié)議棧中的 RFS(receive flow steering)功能以優(yōu)化 MPSoC APU 的并行處理能力,解決丟包問題。
Suhel?Dhanani AMD 自適應 SoC 與 FPGA 事業(yè)部軟件營銷總監(jiān) 在設計規(guī)模和復雜性不斷增長的世界里,SoC 和 FPGA 設計需要...
Xilinx SRL16E如何實現(xiàn)16移位寄存器
在做FPGA的開發(fā)過程中經(jīng)常會使用到移位寄存器,一般我們使用移位寄存器的目的都是為了將某個信號進行打拍,使得時序符合我們的需求。
FPGA設計全流程:ModelsimSynplify.ProISE
介紹如何編譯HDL必須的Xilinx庫和結構仿真。創(chuàng)建將被編譯庫的目錄在編譯庫之前,最好先建立一個目錄(事實上必須建立一個目錄),步驟如下
無任是用CPU作為系統(tǒng)的主要器件,還是用FPGA作為系統(tǒng)的主要器件,系統(tǒng)設計中首先要考慮到的問題就是處理器的啟動加載問題。
AMD-Xilinx MPSoC的Watchdog在Linux中使用的簡明教程
AMD-Xilinx MPSoC的器件里,提供了內置的Watchdog
在X86處理器上跑嵌入式應用程序的Software Emulation
在 Vitis 流程中,編譯的目標分為軟件仿真(software emultion),硬件仿真(hardware emulation)以及硬件(hard...
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