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標(biāo)簽 > xilinx
Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級(jí)集成電路、軟件設(shè)計(jì)工具以及作為預(yù)定義系統(tǒng)級(jí)功能的IP(Intellectual Property)核。
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XILINX是可編程邏輯芯片,由多個(gè)系列的性能可以滿足一般的邏輯設(shè)計(jì)要求,如賽靈思7系列,Xilinx?7系列FPGA由四個(gè)FPGA系列組成 7A ...
AMD XILINX全新推出了Vivado ML Editions 2022.2版
智能設(shè)計(jì)運(yùn)行 (IDR) 是基本無需用戶干預(yù)的一鍵式時(shí)序收斂流程。在 2022.2 版中,我們首次為 Versal 器件提供 IDR 增強(qiáng)功能。使用 I...
2022-11-03 標(biāo)簽:amd電源設(shè)計(jì)Xilinx 3786 0
PDM支持兩種使用流程:手工流程和導(dǎo)入流程。手工流程要求工程師手動(dòng)輸入各種參數(shù),如時(shí)鐘頻率、翻轉(zhuǎn)率、各類資源使用量以及使用模式等。導(dǎo)入模式可直接導(dǎo)入.x...
Xilinx FPGA的電源設(shè)計(jì)和實(shí)現(xiàn)方案
本篇主要介紹Xilinx FPGA的電源設(shè)計(jì),主要包括電源種類、電壓要求、功耗需求,上下電時(shí)序要求,常見的電源實(shí)現(xiàn)方案等。
Xilinx Zynq-7015 SoC嵌入式工業(yè)級(jí)核心板
?SOM-XQ7Z15是廣州星嵌電子科技有限公司推出的一款基于Xilinx Zynq-7000系列XC7Z015高性能低功耗處理器設(shè)計(jì)的異構(gòu)多核工業(yè)級(jí)核...
簡化Xilinx FPGA的電源系統(tǒng)設(shè)計(jì)
自 1985 年 Xilinx 開發(fā)出第一個(gè)商業(yè)上可行的 FPGA 以來,F(xiàn)PGA 細(xì)分市場的價(jià)值已經(jīng)增長到數(shù)十億美元。Xilinx 本身的年收入超過 ...
2022-08-05 標(biāo)簽:fpgaXilinx電源系統(tǒng) 1354 0
Xilinx推出低功耗-小容量-小封裝ZYNQ Ultrascale+ MPSoC
前段時(shí)間看到Xilinx發(fā)布了新的差異化ZYNQ Ultrascale+ MPSoC ZU1和Artix Ultrascale+FPGA,熊貓君趁著國家...
構(gòu)建BittWare的數(shù)據(jù)包解析器
BittWare的SmartNIC Shell和BittWare的Loopback Example的功能之一是一個(gè)數(shù)據(jù)包解析器/分類器,它可以從數(shù)據(jù)包中...
在一個(gè)項(xiàng)目中,當(dāng)你使用microblaze作為控制器來進(jìn)行系統(tǒng)調(diào)度的時(shí)候,一般是建議將所有模塊封裝成AXI形式的IP核,這樣好管理,也容易調(diào)試。
表1-1列出了7系列FPGA封裝中的管腳定義。注意:表1-12有單獨(dú)列出的專用通用用戶I/O,也有標(biāo)記IO_LXXY_ZZZ#或者I/O_XX_ZZZ_...
真正的AI邊緣計(jì)算出現(xiàn)在高度集成的處理器和IP中
現(xiàn)在對(duì) AI 邊緣計(jì)算的期望與我們幾年前對(duì)物聯(lián)網(wǎng)的預(yù)測相似。就像數(shù)以萬億計(jì)的“事物”將被連接起來一樣,我們假設(shè)其中絕大多數(shù)將是(人工)智能的。
2022-07-08 標(biāo)簽:asic物聯(lián)網(wǎng)Xilinx 889 0
之前很多人問我有沒有好的代碼可以參考,我之前一直推薦的是官方的IP參考例程/IP源碼,但是不知道大家有沒有看過官方的項(xiàng)目例程,看下下圖:
在開發(fā)平臺(tái)上使用VITIS AI加速AI應(yīng)用
在運(yùn)行量化器時(shí),我們可以使用更大的校準(zhǔn)圖像、迭代和檢測來調(diào)整輸出,視頻輸入的準(zhǔn)確率約為 96%。我們還嘗試使用 AI 分析器識(shí)別管道中的瓶頸,然后采取糾...
LVDS電平以及LVDS25電平能否約束到這個(gè)BANK上呢?
當(dāng)兩個(gè)banks的I/O口作為LVDS電平時(shí),HR banks的I/O電壓VCCO只能為2.5V,HP banks的I/O口電壓為1.8V。兩個(gè)bank...
AMD 的小芯片戰(zhàn)略基于臺(tái)積電的 CoWoS(Chip-on-Wafer-on-Substrate)封裝技術(shù),該技術(shù)也得到了 Nvidia 和 Appl...
AMD Xilinx 如何滿足金融行業(yè)對(duì)超低時(shí)延的需求
日期:2022年7月7日 時(shí)間:14:00-16:00 金融領(lǐng)域行情數(shù)據(jù)瞬息萬變,具有交易時(shí)間相對(duì)集中、交易指令和數(shù)據(jù)密集的特點(diǎn),盈利的機(jī)會(huì)往往轉(zhuǎn)瞬即逝...
生產(chǎn)和驗(yàn)證高質(zhì)量的FPGA IP
需要對(duì)端口驅(qū)動(dòng)程序和監(jiān)視器進(jìn)行編碼以預(yù)測接口變化。當(dāng)需要快速適應(yīng)時(shí),允許這些模塊連接到不同數(shù)據(jù)寬度的端口和接口的前期工作可以在設(shè)計(jì)和驗(yàn)證周期的后期獲得回報(bào)。
RapidIO:一種高性能、 低引腳數(shù)、 基于數(shù)據(jù)包交換的互連體系結(jié)構(gòu)
PCI是廣泛用于計(jì)算機(jī)內(nèi)器件互連的技術(shù)。傳統(tǒng)PCI技術(shù)也采樣類似于上述存儲(chǔ)器接口的并行總線方式,如TMS320C6455 DSP的PCI接口,有32bi...
2022-06-14 標(biāo)簽:嵌入式系統(tǒng)XilinxRapidIO 1870 0
xilinx的FPGA時(shí)鐘結(jié)構(gòu)
HROW:水平時(shí)鐘線,從水平方向貫穿每個(gè)時(shí)鐘區(qū)域的中心區(qū)域,將時(shí)鐘區(qū)域分成上下完全一致的兩部分。全局時(shí)鐘線進(jìn)入每個(gè)時(shí)鐘區(qū)域的邏輯資源時(shí),必須經(jīng)過水平時(shí)鐘線。
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