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如何減少PCB布局中的串?dāng)_

PCB設(shè)計(jì) ? 2020-09-19 15:47 ? 次閱讀
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當(dāng)電路板上出現(xiàn)串?dāng)_時(shí),電路板可能無(wú)法正常工作,并且在那里也可能會(huì)丟失重要信息。為了避免這種情況,PCB設(shè)計(jì)人員的最大利益在于找到消除其設(shè)計(jì)中潛在串?dāng)_的方法。讓我們談?wù)劥當(dāng)_和一些不同的設(shè)計(jì)技術(shù),這些技術(shù)可以回答如何減少PCB布局中的串?dāng)_。

印刷電路板上的串?dāng)_

電路板上的活動(dòng)過(guò)多會(huì)導(dǎo)致信號(hào)傳輸困難??紤]一下電路板上并排在一起的兩條走線(xiàn)。如果一條跡線(xiàn)的信號(hào)比另一條跡線(xiàn)的信號(hào)具有更大的幅度,可能會(huì)使另一條跡線(xiàn)過(guò)載。就像在嘈雜的房間中試圖講話(huà)時(shí)保持自己的直覺(jué)很難一樣,PCB上的“受害者”走線(xiàn)也同樣會(huì)受到響亮信號(hào)的影響。然后的問(wèn)題是,受害信號(hào)將開(kāi)始像侵略者信號(hào)那樣運(yùn)行,而不是表現(xiàn)出應(yīng)有的方式。

串?dāng)_定義為印刷電路板上跡線(xiàn)之間的意外電磁耦合。即使兩條跡線(xiàn)彼此之間沒(méi)有物理接觸,也可能是這種耦合導(dǎo)致的結(jié)果是一條跡線(xiàn)中的一個(gè)信號(hào)被另一信號(hào)強(qiáng)過(guò)。這種情況可能發(fā)生在具有可接受的走線(xiàn)間距但對(duì)于串?dāng)_不可接受的PCB上。

除了在同一層上并排的兩條走線(xiàn)之間可能產(chǎn)生串?dāng)_之外,走線(xiàn)在兩層之間垂直平行延伸的風(fēng)險(xiǎn)更大。這種效應(yīng)被稱(chēng)為寬邊耦合,是由于兩個(gè)信號(hào)層之間僅被很小厚度的芯材分開(kāi)而產(chǎn)生的。該距離通常小于同一層上兩條跡線(xiàn)之間的間隔。

PCB設(shè)計(jì)工具如何幫助您解決串?dāng)_問(wèn)題

這些天來(lái),您在減少和消除電路板上的串?dāng)_方面擁有非常好的盟友,這就是PCB設(shè)計(jì)工具中的功能。一方面,設(shè)計(jì)工具可以為您提供的幫助極少,但現(xiàn)在情況已不再如此。

您可以設(shè)置各種各樣的設(shè)計(jì)規(guī)則,以指定走線(xiàn)之間以及走線(xiàn)到電路板上其他對(duì)象的間距。您甚至可以根據(jù)特定的網(wǎng)或穿過(guò)這些網(wǎng)的區(qū)域設(shè)置不同的間隙值。這將極大地幫助您設(shè)置設(shè)計(jì),以避免可能發(fā)生串?dāng)_的情況。

設(shè)計(jì)工具還具有用于按特定寬度和間距布線(xiàn)差分對(duì)的特定功能,并且您可以設(shè)置走線(xiàn)長(zhǎng)度以及將特定走線(xiàn)長(zhǎng)度相互匹配的規(guī)則。您還可以指定可以在其上路由某些網(wǎng)絡(luò)的板的哪些層以及這些層上的走線(xiàn)的首選方向。您還可以使用串?dāng)_計(jì)算器以及其他仿真和分析工具。今天我們可以使用的設(shè)計(jì)工具包含各種設(shè)計(jì)約束功能,可以幫助解決諸如串?dāng)_之類(lèi)的問(wèn)題,我們只需要使它們起作用即可。

如何減少串?dāng)_的設(shè)計(jì)方法

現(xiàn)在我們已經(jīng)討論了什么是串?dāng)_以及您的PCB設(shè)計(jì)工具如何為您提供幫助,讓我們看一下一些基本的PCB設(shè)計(jì)技巧,這些技巧可以避免設(shè)計(jì)中潛在的串?dāng)_區(qū)域:

l 配置您的電路板層,以使兩個(gè)相鄰的信號(hào)層具有相互交叉而不是相互平行的首選布線(xiàn)方向。如果第二層從“北到南”運(yùn)行,則確保第三層從“東到西”運(yùn)行。這樣,您可以將寬邊耦合的可能性降到最低。

l 在兩個(gè)相鄰信號(hào)層之間使用接地層,以進(jìn)一步減少寬邊耦合的機(jī)會(huì)。這不僅會(huì)增加各層之間的距離,而且這種配置還可以為您提供更好的接地平面返回路徑。

l 在高速路由(差分對(duì),時(shí)鐘路由等)和其他路由之間保持盡可能多的空間。這里的一般原理是通過(guò)以線(xiàn)寬的三倍隔開(kāi)走線(xiàn)(測(cè)得的中心到中心),可以阻止70%的電場(chǎng)相互干擾。

串?dāng)_會(huì)在您的設(shè)計(jì)中引起嚴(yán)重的問(wèn)題,您將需要盡可能多地了解它。我們?yōu)槟峁┑倪@是朝著這個(gè)方向邁出的偉大的第一步,以使您走上正確的道路。

聲明:本文內(nèi)容及配圖由入駐作者撰寫(xiě)或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀(guān)點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場(chǎng)。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問(wèn)題,請(qǐng)聯(lián)系本站處理。 舉報(bào)投訴
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    高速AC耦合電容挨得很近,PCB會(huì)不會(huì)很大……

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