Allegro和 Sigrity 軟件最新發(fā)布了一系列的產(chǎn)品更新（SPB17.4 QIR4 release）。我們將通過實(shí)例講解、視頻演示讓您深入了解 Allegro PCB Editor、Allegro System Capture、Allegro Package Designer Plus（本期內(nèi)容）、Sigrity Aurora（本期內(nèi)容）、Sigrity SystemSI、Sigrity SystemPI等產(chǎn)品的新功能及用法，助力提升設(shè)計(jì)質(zhì)量和設(shè)計(jì)效率。

Cadence Sigrity Aurora 為 PCB 設(shè)計(jì)前、設(shè)計(jì)中和布局后提供傳統(tǒng)的信號和電源完整性 (SI/PI) 分析，結(jié)合 Cadence Allegro PCB 編輯和布線技術(shù)，Sigrity Aurora用戶在設(shè)計(jì)初期就可以使用 “What-if” 探索環(huán)境進(jìn)行分析，從而獲得更準(zhǔn)確的設(shè)計(jì)約束并減少設(shè)計(jì)迭代。

Sigrity Aurora 直接讀寫 Allegro PCB 數(shù)據(jù)庫，可快速準(zhǔn)確地整合設(shè)計(jì)和分析結(jié)果。它提供了一個基于 SPICE 仿真器和獲得專利的 Sigrity 嵌入式混合場求解器，用于二維和三維結(jié)構(gòu)提取。同時支持兼顧電源影響（Power-Aware）的 IBIS 模型，如需要還支持晶體管級別的模型。高速信號可以在布局階段中或布局階段后，對比備選方案進(jìn)行研究，以便對所有相關(guān)信號進(jìn)行全面分析。

在最新的 SPB 17.4 版本中，Cadence Sigrity Aurora 主要在以下幾個方面對互連建模的仿真功能進(jìn)行了更新：

支持對未布線網(wǎng)絡(luò)的拓?fù)涮崛〖敖＃?/strong>支持布線前按照預(yù)拉線曼哈頓長度拓?fù)涮崛?，并進(jìn)行信號互連搭建，進(jìn)行信號完整性仿真分析。

支持 Clarity 3D Solver 和 Sigrity PowerSI 引擎直接集成：在 Aurora 環(huán)境中，可以通過選擇需要提取的網(wǎng)絡(luò)調(diào)用 Clarity3D Solver 和 Sigrity PowerSI 引擎進(jìn)行 S參數(shù) 的仿真建模。

IR Drop 直流電壓降仿真支持自動剪切功能：自動剪切功能，可以加快仿真的速度，針對大型 PCB 的區(qū)域分析及部分電路仿真提升仿真的速度。

新增生成同軸電纜和雙絞線電纜的模型：生成同軸電纜和雙絞線建模，支持框架及及參數(shù)建模和自定義參數(shù)建模的辦法，通過修改編輯支持直接進(jìn)行信號互連拓?fù)浼靶盘柣ミB仿真。

Sigrity Aurora

互連建模仿真亮點(diǎn)——

#2 支持 Clarity 3D Solver 和 Sigrity PowerSI 引擎直接集成

Aurora_TopWbench_SPB17.4 更新之后，Clarity 3D Solver 和 Sigrity PowerSI 引擎直接集成到 Allegro 環(huán)境中，可以通過選擇需要提取的網(wǎng)絡(luò)調(diào)用 Clarity3D Solver 和 Sigrity PowerSI 引擎進(jìn)行 S參數(shù) 的仿真建模。

接下來我們使用一個實(shí)例文件來講解 S參數(shù) 的仿真建模方法。

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實(shí)例講解 · 視頻版

建議在WIFI環(huán)境下觀看，并注意調(diào)整音量

2?

實(shí)例講解 · 圖文版

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在 Analysis Workflows 流程中選擇 Interconnect Model Extraction Workflows 傳輸線提取流程，進(jìn)行S參數(shù)提取。

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Analisis Engine Selection 選擇分析的引擎為 Sigrity PowerSI。

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Component Model Setup 用來設(shè)置元件模型的參數(shù)配置， Set up Default Models 用來配置默認(rèn)的元件模型。Single Ended Pin Use 設(shè)置單端口網(wǎng)絡(luò)引腳設(shè)置， IN 輸入引腳模式設(shè)置， OUT 輸出模型設(shè)置， BI/Other 橋接其他模型設(shè)置。Differential Pin Use 設(shè)置差分端口網(wǎng)絡(luò)引腳設(shè)置，允許瀏覽 IBIS 文件修改輸入、輸出、橋接的 GPIO 引腳模型。

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支持修改模型，點(diǎn)擊 Browse 瀏覽默認(rèn)的模型文件，點(diǎn)擊 Set Search Path 可以支持設(shè)置 IBIS 的路徑，允許在修改后的 IBIS 路徑下查找新的 IBIS 文件進(jìn)行模型的配置和參數(shù)設(shè)置。

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Manage Analysis Model Libraries 用來配置和管理模型庫，允許支持對本地項(xiàng)目庫的修改和編輯管理，也允許調(diào)用 AMM 外部系統(tǒng)庫。能導(dǎo)入 AMM 外部庫，導(dǎo)入庫的清單，打開和管理分析庫文件等。

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Launch Analysis Model Manager 用來啟動元件的模型管理器，在模型管理器窗口中，能夠?qū)?xiàng)目庫和外部的庫文件進(jìn)行查閱、編輯、刪除、修改等操作。并且可以分析模型庫中元件的參數(shù)，包括電容、電阻、電感、VRM、連接器、封裝、SPICE 模型等。

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Asign Models 用來給元件添加賦予模型，在 Analysis Model Management 窗口中可以查看。允許對元件自動生成賦予模型，也支持手動對模型進(jìn)行設(shè)置。允許從 AMM 文件元件的模型管理器選中模型，和調(diào)用 IBIS 模型文件進(jìn)行模型的設(shè)置。

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選中需要添加模型的元件，然后選擇 Browse Model按鈕，在元件的模型管理器中選取模型文件和對模型參數(shù)進(jìn)行設(shè)置。

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Reference Net 設(shè)置參考網(wǎng)絡(luò)，在例子中該處文件要設(shè)置成 GND 網(wǎng)絡(luò)，提取信號網(wǎng)絡(luò)是以 GND 網(wǎng)絡(luò)作為參考進(jìn)行網(wǎng)絡(luò)設(shè)置。

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Select Nets 選取需要分析的網(wǎng)絡(luò)，在 Net Selection 中選擇需要分析的網(wǎng)絡(luò)，點(diǎn)擊右側(cè)圖標(biāo)按鈕確認(rèn)，支持單網(wǎng)絡(luò)和差分網(wǎng)絡(luò)的提取分析。若分析網(wǎng)絡(luò)中存在直流電源網(wǎng)絡(luò)或者 GND 網(wǎng)絡(luò)可以點(diǎn)擊 Excluded DC Nets 按鈕進(jìn)行 DC 直流網(wǎng)絡(luò)的設(shè)置。

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Set Up Frequencies 設(shè)置仿真提取的頻率參數(shù)等， Sigrity PowerSI 設(shè)置仿真頻率范圍、開始和截至頻率、掃描頻點(diǎn)模式、頻點(diǎn)數(shù)量等。

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Set Up Analysis Options 是分析的可選設(shè)置項(xiàng)，Translator 設(shè)置文件轉(zhuǎn)換的參數(shù)，Layout 設(shè)置 PCB 的裁切區(qū)域，Simulation 設(shè)置仿真的參數(shù)，比如端口、挖空區(qū)域、電氣模型、銅皮和 NET 的選擇以及遠(yuǎn)場結(jié)果。

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View 3D Geometry 用來預(yù)覽顯示選中分析網(wǎng)絡(luò)的互連通路，可以查看分析網(wǎng)絡(luò)的所在層及網(wǎng)絡(luò)通道的屬性顯示結(jié)果。

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Set up Computer Resources 設(shè)置計(jì)算機(jī)資源，支持多核心的資源調(diào)用，這里可以按照計(jì)算機(jī) CPU 的核心數(shù)量來選擇執(zhí)行的資源配置。

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設(shè)置完成后選擇 Start Extraction 命令可以開始進(jìn)行 S參數(shù) 提取。

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S參數(shù) 提取完成后軟件會自動打開 BNP Viewer 界面，彈出提取完成的 S參數(shù) 結(jié)果。

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報(bào)告可以對 S參數(shù) 的結(jié)果進(jìn)行分析，顯示出插損、回?fù)p、串?dāng)_的分析結(jié)果。

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還可以支持 S參數(shù) 的結(jié)果報(bào)告，支持 BNP、Touchstone 格式文件保存。

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文件保存完成以后，可以看到提取到的參數(shù)文件已經(jīng)保存在硬盤的文件目錄下。

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選擇 Launch Topology Explorer 按鈕，可以將已經(jīng)生成的 S參數(shù) 結(jié)果文件，自動加載到 Topology Workbench 拓?fù)浞抡娼缑嬷?，并形?BLOCK 圖標(biāo)。