時序分析基本概念介紹<Combinational logic>
今天我們要介紹的時序分析概念是 Combinational logic . 中文名組合邏輯單元。這是邏輯單元的基本組成器件。比如我們常見的and, or, not, nand,nor等門電路。
對于組合邏輯來說，輸出只是當前輸入邏輯電平的函數(shù)（有延時），與電路的原始狀態(tài)無關。當前電路輸入信號任何一個發(fā)生改變，輸出都將發(fā)生改變。
AND, OR, NOT是最基本的門電路，NAND與NOR是通用門電路，可以實現(xiàn)任何其他組合邏輯電路。還有一些常見的復雜組合邏輯電路，比如全加器，數(shù)據(jù)選擇器，譯碼器等等。
下表是常見的邏輯門電路示意圖：
對于組合邏輯單元，每個輸入pin和輸出pin都會存在一個timing arc關系，這也是我們平時說的cell的delay.
如下圖所示：
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