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LMK5B12204 具有網(wǎng)絡(luò)同步和 BAW 技術(shù)的超低抖動(dòng)時(shí)鐘發(fā)生器技術(shù)手冊(cè)

科技綠洲 ? 2025-09-12 10:14 ? 次閱讀
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該LMK5B12204是高性能網(wǎng)絡(luò)同步器時(shí)鐘器件,可提供抖動(dòng)清除、時(shí)鐘生成、高級(jí)時(shí)鐘監(jiān)控和卓越的無中斷開關(guān)性能,以滿足通信基礎(chǔ)設(shè)施和工業(yè)應(yīng)用的嚴(yán)格時(shí)序要求。該器件的超低抖動(dòng)和高電源噪聲抑制 (PSNR) 可降低高速串行鏈路中的誤碼率 (BER)。

該器件可以使用 TI 專有的體聲波 (BAW) VCO 技術(shù)生成具有 50 fs RMS 抖動(dòng)的輸出時(shí)鐘,與 XO 和基準(zhǔn)輸入的抖動(dòng)和頻率無關(guān)。
*附件:lmk5b12204.pdf

特性

  • 一個(gè)數(shù)字鎖相環(huán) (DPLL),具有:
    • 無中斷開關(guān):±50ps 相位瞬變
    • 帶 Fastlock 的可編程環(huán)路帶寬
    • 使用低成本 TCXO/OCXO 實(shí)現(xiàn)符合標(biāo)準(zhǔn)的同步和保持
  • 兩個(gè)模擬鎖相環(huán) (APLL),具有行業(yè)領(lǐng)先的抖動(dòng)性能:
    • 312.5 MHz時(shí)的50 fs RMS抖動(dòng)(APLL1)
    • 155.52 MHz時(shí)的125fs RMS抖動(dòng)(APLL2)
  • 兩個(gè)參考時(shí)鐘輸入
    • 基于優(yōu)先級(jí)的輸入選擇
    • 失去參考的數(shù)字滯留
  • 4個(gè)時(shí)鐘輸出,帶可編程驅(qū)動(dòng)器
    • 多達(dá)四種不同的輸出頻率
    • AC-LVDS、AC-CML、AC-LVPECL、HCSL和1.8V LVCMOS輸出格式
  • EEPROM / ROM,用于上電時(shí)自定義時(shí)鐘
  • 靈活的配置選項(xiàng)
    • 輸入時(shí) 1 Hz (1 PPS) 至 800 MHz
    • XO/TCXO/OCXO 輸入:10 至 100 MHz
    • DCO 模式:< 0.001 ppb/步,用于精確時(shí)鐘控制(IEEE 1588 PTP 從機(jī))
    • 高級(jí)時(shí)鐘監(jiān)控和狀態(tài)
    • 我^2^C 或 SPI 接口
  • PSNR:–83 dBc(3.3V電源時(shí)噪聲為50 mVpp)
  • 3.3V電源,1.8V、2.5V或3.3V輸出
  • 工業(yè)溫度范圍:–40 °C 至 +85 °C

參數(shù)

image.png
?1. 產(chǎn)品概述?
LMK5B12204是德州儀器(TI)推出的高性能網(wǎng)絡(luò)同步時(shí)鐘芯片,專為通信基礎(chǔ)設(shè)施和工業(yè)應(yīng)用設(shè)計(jì),具有超低抖動(dòng)(50-fs RMS @312.5 MHz)和卓越的電源噪聲抑制(PSNR: -83 dBc)。核心特性包括:

  • ? 數(shù)字鎖相環(huán)(DPLL) ?:支持無中斷切換(±50 ps瞬態(tài))、可編程帶寬及符合SyncE/SONET/IEEE 1588等標(biāo)準(zhǔn)的同步功能。
  • ? 模擬鎖相環(huán)(APLL) ?:集成兩個(gè)APLL(APLL1/APLL2),分別采用BAW VCO和LC VCO技術(shù),支持多頻域輸出。
  • ?時(shí)鐘輸出?:4個(gè)可編程驅(qū)動(dòng)輸出,支持AC-LVDS/CML/LVPECL/HCSL/1.8V LVCMOS格式,最高1250 MHz頻率。

?2. 關(guān)鍵特性?

  • ?抖動(dòng)性能?:APLL1輸出50-fs RMS(312.5 MHz),APLL2輸出125-fs RMS(155.52 MHz)。
  • ?輸入靈活性?:2路參考時(shí)鐘輸入(PRIREF/SECREF),支持差分/LVCMOS,帶優(yōu)先級(jí)選擇和監(jiān)控功能。
  • ?電源管理?:3.3V核心供電,1.8/2.5/3.3V輸出供電,集成LDO提升PSNR。
  • ?工作溫度?:工業(yè)級(jí)(-40°C至+85°C),48引腳VQFN封裝(7mm×7mm)。

?3. 應(yīng)用場景?

  • ?通信設(shè)備?:400G線卡、以太網(wǎng)交換機(jī)/路由器、無線基站(BTS)及回傳。
  • ?測試與醫(yī)療?:高速串行鏈路(56G/112G PAM-4 PHY)、醫(yī)療成像設(shè)備。
  • ?同步系統(tǒng)?:SyncE(G.8262)、SONET/SDH(Stratum 3)、IEEE 1588 PTP從時(shí)鐘。

?4. 功能模塊詳解?

  • ?DPLL模式?:支持?jǐn)?shù)字保持(Holdover)和DCO模式(頻率步進(jìn)<0.001 ppb),適用于精密時(shí)鐘校準(zhǔn)。
  • ?APLL模式?:APLL1鎖定至XO輸入,APLL2可級(jí)聯(lián)或獨(dú)立運(yùn)行,支持分?jǐn)?shù)分頻。
  • ?監(jiān)控與診斷?:集成輸入時(shí)鐘質(zhì)量檢測(幅度/頻率/脈沖丟失)、PLL鎖定狀態(tài)指示及中斷輸出。

?5. 設(shè)計(jì)支持?

  • ?配置工具?:TICS Pro軟件生成寄存器配置,支持EEPROM/ROM啟動(dòng)模式。
  • ?參考設(shè)計(jì)?:提供優(yōu)化布局指南(如熱增強(qiáng)型PCB設(shè)計(jì))、電源去耦方案及接口電路示例。
聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請(qǐng)聯(lián)系本站處理。 舉報(bào)投訴
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