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      XILINX開發(fā)者社區(qū)

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      在Versal里實(shí)現(xiàn)cache一致性傳輸

      Versal與MPSoC在cache維護(hù)數(shù)據(jù)的架構(gòu)上，有一定的相似性。所以在Versal器件里，我們....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 04-21 10:19 ?1375次閱讀

      HDMI_1.4_2.0_RX_Subsystem_IP介紹和基礎(chǔ)debug建議

      Xilinx HDMI 1.4/2.0 RX的解決方案是由HDMI 1.4/2.0 Receiver....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 03-25 09:13 ?4680次閱讀

      移植VMK180 TRD的PetaLinux工程

      所有工具和參考設(shè)計(jì)使用2021.2。X86編譯主機(jī)的操作系統(tǒng)是Ubuntu 18.04.6 LTS。....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 03-18 13:43 ?2017次閱讀

      如何做到在VPK120里實(shí)現(xiàn)MRMAC以太網(wǎng)IP

      ? 本文作者：賽靈思工程師 Gray Pan ? Step 1 ? 首先，打開最新版本的Vivado....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 03-16 15:51 ?1448次閱讀

      利用ORAN IP的例子工程來(lái)做仿真

      一個(gè)是新建Block Design，添加IP之后，通過(guò)運(yùn)行Block Automation來(lái)產(chǎn)生一個(gè)....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 03-11 09:42 ?1824次閱讀

      采用PYNQ和Vitis AI的智能辦公解決方案

      本文投稿作者： zst123 （github.com/zst123） 信息通信和電子愛好者， 熱衷于....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 11-12 10:08 ?2836次閱讀
      采用PYNQ和Vitis AI的智能辦公解決方案

      Vitis視頻分析SDK構(gòu)建自己的智能視頻分析解決方案

      Vitis 視頻分析 SDK構(gòu)建自己的智能視頻分析解決方案 Vitis 視頻分析 SDK 旨在 Xi....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 11-08 10:35 ?4554次閱讀

      Kria KV260開發(fā)板開箱指南

      Kria KV260 開發(fā)板開箱指南 ★ 目錄 ★ 第一章KV260 硬件接口 第二章鏡像下載和燒寫....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 11-02 14:39 ?3675次閱讀
      Kria KV260開發(fā)板開箱指南

      賽靈思2021自適應(yīng)計(jì)算挑戰(zhàn)賽技術(shù)講解分享會(huì)

      賽靈思2021自適應(yīng)計(jì)算挑戰(zhàn)賽自9月7日正式開賽以來(lái)，收到了來(lái)自全球各地區(qū)的FPGA軟硬件開發(fā)者們的....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-27 17:16 ?4398次閱讀

      基于PYNQ RFSoC框架的開源量子位控制器

      費(fèi)米實(shí)驗(yàn)室，普林斯頓大學(xué)，芝加哥大學(xué)等科研機(jī)構(gòu)聯(lián)合發(fā)表了基于PYNQ RFSoC框架的開源量子位控制....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-27 16:47 ?2392次閱讀

      賽靈思全新Test Drive試用體驗(yàn)

      賽靈思應(yīng)用商店提供一個(gè)強(qiáng)大的平臺(tái)，其可使用一個(gè)簡(jiǎn)單易用的安全數(shù)字版權(quán)管理 （DRM） 基礎(chǔ)架構(gòu)來(lái)發(fā)布....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-19 09:41 ?1937次閱讀

      賽靈思2021自適應(yīng)計(jì)算挑戰(zhàn)賽問(wèn)題匯總

      賽靈思2021自適應(yīng)計(jì)算挑戰(zhàn)賽自9月7日正式開賽以來(lái)，收到了來(lái)自全球各地區(qū)的FPGA軟硬件開發(fā)者們的....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-11 17:08 ?2040次閱讀

      如何用10行代碼輕松在ZYNQ MP上實(shí)現(xiàn)圖像識(shí)別

      本文來(lái)自賽靈思高級(jí)產(chǎn)品應(yīng)用工程師，張超。如今各種機(jī)器學(xué)習(xí)框架的普及使得個(gè)人搭建和訓(xùn)練一個(gè)機(jī)器學(xué)習(xí)模型....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-09 10:47 ?5021次閱讀
      如何用10行代碼輕松在ZYNQ MP上實(shí)現(xiàn)圖像識(shí)別

      XILINX使用方法論設(shè)計(jì)無(wú)法連貫布線

      本篇博文中的分析是根據(jù)真實(shí)客戶問(wèn)題撰寫的，該客戶的 DFX 設(shè)計(jì)無(wú)法連貫布線，存在布線重疊。本篇博文....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-28 10:41 ?1991次閱讀

      硬件中存在DDR4校準(zhǔn)后數(shù)據(jù)錯(cuò)誤

      本篇博文中的分析是根據(jù)真實(shí)客戶問(wèn)題撰寫的，該客戶發(fā)現(xiàn)硬件中存在 DDR4 校準(zhǔn)后數(shù)據(jù)錯(cuò)誤，此問(wèn)題顯示....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-16 09:30 ?2966次閱讀

      由于時(shí)鐘域交匯處理不當(dāng)所導(dǎo)致罕見的比特翻轉(zhuǎn)

      本篇博文中的分析是根據(jù)真實(shí)客戶問(wèn)題撰寫的，該客戶發(fā)現(xiàn)在現(xiàn)場(chǎng)出現(xiàn)罕見的比特翻轉(zhuǎn)， 本篇博文旨在演示用于....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-10 09:44 ?1649次閱讀

      如何修復(fù)硬件中存在DDR4校準(zhǔn)錯(cuò)誤

      本篇博文中的分析是根據(jù)真實(shí)客戶問(wèn)題撰寫的，該客戶發(fā)現(xiàn)硬件中存在 DDR4 校準(zhǔn)錯(cuò)誤，不同板以及不同構(gòu)....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-03 09:33 ?3417次閱讀

      HLS導(dǎo)出的.xo文件如何導(dǎo)入到Vitis里面

      Q1 HLS導(dǎo)出的.xo文件如何導(dǎo)入到Vitis里面？需要把.xo文件解壓，然后把文件夾導(dǎo)入到Vit....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-26 17:03 ?2995次閱讀

      如何基于Vitis中把設(shè)置信息傳遞到底層的Vivado

      在Vitis 統(tǒng)一軟件平臺(tái)中使用v++ -link命令，可以把各種類型Kernel（C， C++， ....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 07-28 10:12 ?2492次閱讀
      如何基于Vitis中把設(shè)置信息傳遞到底層的Vivado

      如何在訓(xùn)練過(guò)程中正確地把數(shù)據(jù)輸入給模型

      機(jī)器學(xué)習(xí)中一個(gè)常見問(wèn)題是判定與數(shù)據(jù)交互的最佳方式。 在本文中，我們將提供一種高效方法，用于完成數(shù)據(jù)的....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 07-01 10:47 ?2888次閱讀

      如何使用ICAP在Spartan-3AN FPGA內(nèi)運(yùn)行多重啟動(dòng)應(yīng)用

      (UG332) 即為《Spartan-3 系列配置用戶指南》 在此用戶指南中，并未涵蓋有關(guān)從 SPI....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 06-25 17:25 ?2248次閱讀

      教你們?cè)趺丛O(shè)置或獲取BITSTREAM屬性信息

      首先我們看一下如何在Vivado下設(shè)置BITSTREAM配置信息。這可以在綜合之后進(jìn)行。借助如下操作....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 06-18 10:24 ?2564次閱讀
      教你們?cè)趺丛O(shè)置或獲取BITSTREAM屬性信息

      一個(gè)工程可以同時(shí)使用.edf和IP嗎

      Q1 一個(gè)synplify綜合得到的.edf，和vivado生成的RAM IP，（synplify綜....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 06-18 10:21 ?3148次閱讀
      一個(gè)工程可以同時(shí)使用.edf和IP嗎

      怎么在Vitis加速設(shè)計(jì)中為Kernel創(chuàng)建面積約束

      本文來(lái)自賽靈思高級(jí)產(chǎn)品應(yīng)用工程師 Hong Han Alveo系列開發(fā)板上的平臺(tái)其實(shí)是一個(gè)DFX設(shè)計(jì)....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 06-18 10:15 ?37130次閱讀