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      XILINX開發(fā)者社區(qū)

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      全新AMD Spartan UltraScale+FPGA低成本系列解決方案

      在構(gòu)建嵌入式應(yīng)用的過程中，硬件設(shè)計人員長期以來面臨著艱難的取舍，為推動產(chǎn)品快速上市，他們必須在成本、....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 03-06 09:07 ?1164次閱讀

      AMD MPSoC器件中啟用SEM IP的策略與方法

      IP 在初始化階段就卡住了。從 Uart 口的 log 看 ‘ICAP’ 后續(xù)無字符輸出，這是典型的....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 03-01 09:53 ?1965次閱讀
      AMD MPSoC器件中啟用SEM IP的策略與方法

      如何在下載Bitstream后自動觸發(fā)ILA采集

      在硬件調(diào)試時，經(jīng)常需要用 ILA 采集一些 FPGA 內(nèi)部或者對外的初始化信號，然而在下載完 Bit....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 02-23 09:45 ?1921次閱讀
      如何在下載Bitstream后自動觸發(fā)ILA采集

      AMD Kria KR260 DPU配置教程3

      最后我們需要生成能夠在 AMD Kria KR260 上運(yùn)行的固件。
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 01-26 09:33 ?2774次閱讀
      AMD Kria KR260 DPU配置教程3

      AMD Kria KR260 DPU配置教程2

      在上一篇文章中 開發(fā)者分享｜AMD Kria KR260 DPU 配置教程 1 我們導(dǎo)出了 plat....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 01-19 10:16 ?3397次閱讀
      AMD Kria KR260 DPU配置教程2

      AMD Kria KR260 DPU配置教程

      這篇文章我們將為 AMD Kria KR260 在 AMD Vitis 上創(chuàng)建硬件加速平臺。 我們將....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 01-12 09:36 ?2369次閱讀
      AMD Kria KR260 DPU配置教程

      AMD Vitis? Libraries Vision L3 Isppipeline U50流程示例

      Vitis Vision 庫是一組 90 多個內(nèi)核，基于 OpenCV 計算機(jī)視覺庫，針對 AMD ....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 01-03 10:10 ?1931次閱讀
      AMD Vitis? Libraries Vision L3 Isppipeline U50流程示例

      通過JTAG啟動Linux的方法和腳本

      在 AMD SoC 器件（AMD Zynq 7000 SoC，AMD Zynq UltraScal....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 12-22 10:27 ?3181次閱讀
      通過JTAG啟動Linux的方法和腳本

      AMD Vivado Design Suite 2023.2的優(yōu)勢

      由于市場環(huán)境日益復(fù)雜、產(chǎn)品競爭日趨激烈，為了加快推出新型自適應(yīng) SoC 和 FPGA 設(shè)計，硬件設(shè)計....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 11-23 15:09 ?1662次閱讀

      使用PCIE更新AMD ZYNQ的QSPI Flash參考設(shè)計

      AMD ZYNQ 7000 的 S_AXI 端口提供了外設(shè)訪問 PS 內(nèi)部外設(shè)控制器的接口，這其中包....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 11-17 10:02 ?2146次閱讀
      使用PCIE更新AMD ZYNQ的QSPI Flash參考設(shè)計

      什么是COP？能為開發(fā)者帶來哪些優(yōu)勢？如何選擇最佳COP器件？

      使用可編程邏輯器件進(jìn)行設(shè)計時，最關(guān)鍵的步驟之一就是為應(yīng)用選擇最佳的器件。
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 11-15 10:03 ?3760次閱讀
      什么是COP？能為開發(fā)者帶來哪些優(yōu)勢？如何選擇最佳COP器件？

      CPRI的數(shù)據(jù)幀結(jié)構(gòu)與初始化流程

      CPRI 是無線通信里的一個標(biāo)準(zhǔn)協(xié)議，連接 REC 和 RE 的通信。AMD 有提供 CPRI IP....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-20 09:55 ?3206次閱讀
      CPRI的數(shù)據(jù)幀結(jié)構(gòu)與初始化流程

      設(shè)置AMD以太網(wǎng)IP核的Pause幀處理

      目前 AMD 的以太網(wǎng) IP 核，如軟核 10G/25G，40G/50G 或者硬核 CMAC，MRM....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-18 09:15 ?1958次閱讀
      設(shè)置AMD以太網(wǎng)IP核的Pause幀處理

      SEM IP多種工作模式的區(qū)別和選擇指導(dǎo)

      UltraScale / UlraScale+系列的SEM IP一共有6種工作模式
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-13 10:06 ?2031次閱讀
      SEM IP多種工作模式的區(qū)別和選擇指導(dǎo)

      節(jié)省編譯時間的解決方法

      影響編譯時間的因素有很多，包括工具流程、工具設(shè)置選項(xiàng)、RTL 設(shè)計、約束編輯、目標(biāo)器件以及設(shè)計實(shí)現(xiàn)期....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-27 09:52 ?1332次閱讀
      節(jié)省編譯時間的解決方法

      為多個Vivado?工程復(fù)用遠(yuǎn)程IP高速緩存

      在設(shè)計周期中，您可保留多個版本的工程，這些工程使用相同的 IP 和相同的配置。重新運(yùn)行整個工程會導(dǎo)致....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-22 09:39 ?1724次閱讀
      為多個Vivado?工程復(fù)用遠(yuǎn)程IP高速緩存

      利用Tcl腳本節(jié)省編譯時間

      這篇博文介紹了多種自動生成報告的有效途徑，以便您在嘗試對設(shè)計中特定階段所耗用的編譯時間進(jìn)行調(diào)試時使用....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-15 10:44 ?1680次閱讀
      利用Tcl腳本節(jié)省編譯時間

      使用增量綜合節(jié)省編譯時間

      增量綜合的工作方式與增量實(shí)現(xiàn)流程相似，但僅適用于綜合階段，并且不會對緊隨其后的實(shí)現(xiàn)階段給予引導(dǎo)。
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-08 11:01 ?1078次閱讀
      使用增量綜合節(jié)省編譯時間

      Power Design Manager (PDM) 2023.1的新增功能

      PDM 已經(jīng)與其它 AMD FPGA 和自適應(yīng) SoC 工具一起集成到統(tǒng)一的安裝程序中。這是一款獨(dú)立....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-06 10:18 ?1642次閱讀
      Power Design Manager (PDM) 2023.1的新增功能

      節(jié)省編譯時間系列-使用增量實(shí)現(xiàn)

      增量實(shí)現(xiàn)自從首次獲得支持以來，不斷升級演變，在此過程中已添加了多項(xiàng)針對性能和編譯時間的增強(qiáng)功能。
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-01 09:36 ?1196次閱讀
      節(jié)省編譯時間系列-使用增量實(shí)現(xiàn)

      如何獲取和使用Github上的Vitis開放資源

      自從 Vitis 的發(fā)布，AMD 在 Github 上也開源了很多資源，方便開發(fā)者進(jìn)行自己的設(shè)計，減....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-23 09:41 ?1872次閱讀
      如何獲取和使用Github上的Vitis開放資源

      Versal GTM如何用Tcl命令在IBERT生成QPRBS13序列

      目前對于 Vivado 2023.1 版本的 IBERT GUI 界面暫時不支持 QPRBS13 的....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-18 09:53 ?2524次閱讀
      Versal GTM如何用Tcl命令在IBERT生成QPRBS13序列

      如何在Vitis HLS GUI中使用庫函數(shù)？

      Vitis? HLS 2023.1 支持新的 L1 庫向?qū)В疚膶⒅v解如何下載 L1 庫、查看所有可....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-16 10:26 ?2043次閱讀
      如何在Vitis HLS GUI中使用庫函數(shù)？

      Vitis HLS相關(guān)問答詳解

      需要手工在 C++ 代碼里明確指定可并行執(zhí)行的任務(wù)（用 task，添加頭文件 hls_task.h)....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-11 11:23 ?1232次閱讀

      在X86處理器上跑嵌入式應(yīng)用程序的Software Emulation

      在 Vitis 流程中，編譯的目標(biāo)分為軟件仿真(software emultion)，硬件仿真(ha....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-09 10:32 ?1750次閱讀
      在X86處理器上跑嵌入式應(yīng)用程序的Software Emulation

      使用VVAS調(diào)用HLS生成硬件加速器的主要流程

      本篇博客介紹 VVAS 框架所支持調(diào)用的 H/W(HLS) 內(nèi)核。 H/W 內(nèi)核指的是使用 HLS ....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-04 11:00 ?1537次閱讀
      使用VVAS調(diào)用HLS生成硬件加速器的主要流程

      使用VVAS開發(fā)軟件應(yīng)用

      Vitis 視頻分析 SDK 是在 AMD 平臺上構(gòu)建 AI 驅(qū)動的智能視頻分析解決方案的完整軟件棧....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-02 09:28 ?1577次閱讀
      使用VVAS開發(fā)軟件應(yīng)用

      RQS_CLOCK-12時鐘設(shè)置建議

      在本篇博文中，我們來聊聊“RQS_CLOCK-12”時鐘設(shè)置建議以及它如何幫助達(dá)成時序收斂。
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 07-26 09:53 ?1468次閱讀
      RQS_CLOCK-12時鐘設(shè)置建議

      在Vivado中利用Report QoR Suggestions提升QoR

      Report QoR Suggestions (RQS) 可識別設(shè)計問題，并提供工具開關(guān)和可影響工具....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 07-19 10:38 ?2205次閱讀
      在Vivado中利用Report QoR Suggestions提升QoR

      淺談Vitis AI 3.5發(fā)布亮點(diǎn)

      Vitis AI 平臺是為 AMD 器件、板卡及 Alveo 數(shù)據(jù)中心加速卡提供的一款綜合 AI 推....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 07-14 10:59 ?1616次閱讀