? ? ? 什么是同步邏輯和異步邏輯？

　　異步電路：主要是組合邏輯電路，用于產(chǎn)生地址譯碼器、FIFO或RAM的讀寫控制信號脈沖，但它同時也用在時序電路中，此時它沒有統(tǒng)一的時鐘，狀態(tài)變化的時刻是不穩(wěn)定的，通常輸入信號只在電路處于穩(wěn)定狀態(tài)時才發(fā)生變化。也就是說一個時刻允許一個輸入發(fā)生變化，以避免輸入信號之間造成的競爭冒險。電路的穩(wěn)定需要有可靠的建立時間和持時間

　　同步電路：是由時序電路（寄存器和各種觸發(fā)器）和組合邏輯電路構成的電路，其所有操作都是在嚴格的時鐘控制下完成的。這些時序電路共享同一個時鐘CLK，而所有的狀態(tài)變化都是在時鐘的上升沿（或下降沿）完成的。比如D觸發(fā)器，當上升延到來時，寄存器把D端的電平傳到Q輸出端。在同步電路設計中一般采用D觸發(fā)器，異步電路設計中一般采用Latch修改

　　整個設計中只有一個全局時鐘成為同步邏輯。只有時鐘脈沖同時到達各記憶元件的時鐘端，才能發(fā)生預期改變。多時鐘系統(tǒng)邏輯設計成為異步邏輯。電路狀態(tài)改變由輸入信號引起

　　同步邏輯是時鐘之間有固定的因果關系。異步邏輯是各時鐘之間沒有固定的因果關系。

? ? ? 同步電路和異步電路的區(qū)別

? ? ? 同步邏輯是時鐘之間有固定的因果關系。異步邏輯是各時鐘之間沒有固定的因果關系。

　　電路設計可分類為同步電路和異步電路設計。同步電路利用時鐘脈沖使其子系統(tǒng)同步運作，而異步電路不使用時鐘脈沖做同步，其子系統(tǒng)是使用特殊的“開始”和 “完成”信號使之同步。由于異步電路具有下列優(yōu)點--無時鐘歪斜問題、低電源消耗、平均效能而非最差效能、模塊性、可組合和可復用性--因此近年來對異步 電路研究增加快速，論文發(fā)表數(shù)以倍增，而Intel Pentium 4處理器設計，也開始采用異步電路設計。

　　異步電路主要是組合邏輯電路，用于產(chǎn)生地址譯碼器、FIFO或RAM的讀寫控制信號脈沖，其邏輯輸出與任何時鐘信號都沒有關系，譯碼輸出產(chǎn)生的毛刺通常是 可以監(jiān)控的。同步電路是由時序電路（寄存器和各種觸發(fā)器）和組合邏輯電路構成的電路，其所有操作都是在嚴格的時鐘控制下完成的。這些時序電路共享同一個時 鐘CLK，而所有的狀態(tài)變化都是在時鐘的上升沿（或下降沿）完成的。

　　通俗來講，同步電路是需要時鐘控制的，即它的邏輯變化是在下一個時鐘到來時才改變，而異步電路則不然。

　　線與邏輯是兩個輸出信號相連可以實現(xiàn)與的功能。在硬件上，要用oc門來實現(xiàn)（漏極或者集電極開路），由于不用oc門可能使灌電流過大，而燒壞邏輯門，同時在輸出端口應加一個上拉電阻。（線或則是下拉電阻）