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淺析異步復(fù)位同步釋放與同步復(fù)位打拍模塊

sanyue7758 ? 來源:IC的世界 ? 2023-08-21 09:27 ? 次閱讀
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1、異步復(fù)位同步釋放

5da6eff4-3f6a-11ee-ac96-dac502259ad0.png

異步復(fù)位同步釋放:rst_synchronizer.v

采用3級同步打拍模塊

異步復(fù)位async_rst_n連接到3級同步寄存器復(fù)位端

時(shí)鐘采用目的時(shí)鐘dst_clk

第一個(gè)寄存器輸入D端接高電平,Q端驅(qū)動下一級寄存器的D端,

最后一級reg的Q端就是作為模塊輸出的已同步到dst_clk時(shí)鐘域的復(fù)位信號

模塊特點(diǎn):

采用3級同步器減少亞穩(wěn)定發(fā)生概率(7nm,5nm時(shí)鐘頻率一般在1GHz左右會采用3級同步器)

一般設(shè)計(jì)會采用定制模塊實(shí)現(xiàn),保證3級寄存器的上一級Q端和下一級D端延時(shí)很小

2、同步復(fù)位打拍模塊 同步復(fù)位同步打拍:rst_multi_pipeline.v

采用多個(gè)寄存器實(shí)現(xiàn)

所有寄存器輸入D端接高電平

輸出q端作為復(fù)位連接到下一級寄存器的復(fù)位端rst_n

首個(gè)寄存器復(fù)位端來自rst_synchronizer.v的輸出復(fù)位信號

模塊特點(diǎn):

采用多級寄存器同步打拍,便于時(shí)序收斂,布局布線以及增加驅(qū)動能力

采用多級寄存器打拍,還能便于芯片整理復(fù)位平衡的。





審核編輯:劉清

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原文標(biāo)題:異步復(fù)位同步釋放與同步復(fù)位打拍

文章出處:【微信號:處芯積律,微信公眾號:處芯積律】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

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    的頭像 發(fā)表于 01-24 09:32 ?2619次閱讀
    <b class='flag-5'>異步</b><b class='flag-5'>復(fù)位</b><b class='flag-5'>異步</b><b class='flag-5'>釋放</b>會有什么問題?FPGA<b class='flag-5'>異步</b><b class='flag-5'>復(fù)位</b>為什么要<b class='flag-5'>同步</b><b class='flag-5'>釋放</b>呢?

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    異步復(fù)位,同步釋放的理解目錄目錄 同步復(fù)位異步
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    【FPGA】<b class='flag-5'>異步</b><b class='flag-5'>復(fù)位</b>,<b class='flag-5'>同步</b><b class='flag-5'>釋放</b>的理解

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    FPGA學(xué)習(xí)-<b class='flag-5'>異步</b><b class='flag-5'>復(fù)位</b>,<b class='flag-5'>同步</b><b class='flag-5'>釋放</b>