verilog

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Verilog HDL是一種硬件描述語(yǔ)言（HDL:Hardware Description Language），以文本形式來(lái)描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語(yǔ)言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

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verilog技術(shù)

Verilog與VHDL的比較 Verilog HDL編程技巧

Verilog 與 VHDL 比較 1. 語(yǔ)法和風(fēng)格 Verilog ：Verilog 的語(yǔ)法更接近于 C 語(yǔ)言，對(duì)于有 C 語(yǔ)言背景的工程師來(lái)說(shuō)，學(xué)習(xí)...

2024-12-17 標(biāo)簽：Verilog 編程 vhdl 2.4k 0

Verilog賦值和結(jié)構(gòu)說(shuō)明語(yǔ)句

從仿真結(jié)果可以看出：在順序塊中，15ns的時(shí)候，l1被賦值為8’h2，在25ns的時(shí)候，l2被賦值為8’h8；而在并行塊中，10ns的時(shí)候，k2被賦值為...

2022-03-15 標(biāo)簽：Verilog 2.4k 0

在FPGA設(shè)計(jì)中怎么應(yīng)用ChatGPT？

科技即生產(chǎn)力，最近，OpenAI 發(fā)布了 ChatGPT，在各大論壇和許多網(wǎng)站上受到了廣泛關(guān)注，ChatGPT是由 OpenAI 提出的大型預(yù)訓(xùn)練語(yǔ)言模...

2023-03-14 標(biāo)簽：fpga Verilog 代碼 2.4k 0

verilog雙向端口的使用

在Verilog硬件描述語(yǔ)言中，端口是指連接模塊（Module）與其他模塊、寄存器或是物理設(shè)備的輸入或輸出接口。單向端口可以作為輸入或輸出使用，而雙向端...

2024-02-23 標(biāo)簽：模塊接口硬件 2.4k 0

Interface接口的優(yōu)勢(shì)和使用示例

將設(shè)計(jì)和驗(yàn)證從邏輯上和時(shí)間上分開，使得兩個(gè)小組可以相對(duì)獨(dú)立。

2023-09-01 標(biāo)簽：接口 IC設(shè)計(jì)Verilog 2.4k 0

SystemVerilog中class的基本概念

class，是面向?qū)ο缶幊蹋╫bject-oriented programming (OOP)）的基礎(chǔ)，而OOP可以讓你創(chuàng)建更高抽象級(jí)別的驗(yàn)證環(huán)境(如UVM)。

2022-11-14 標(biāo)簽：Verilog System Class 2.3k 0

verilog可綜合的語(yǔ)法子集

可綜合的語(yǔ)法是指硬件能夠?qū)崿F(xiàn)的一些語(yǔ)法，這些語(yǔ)法能夠被EDA工具支持，能夠通過(guò)編譯最終生成用于燒錄到FPGA器件中的配置數(shù)據(jù)流。

2023-07-23 標(biāo)簽：fpga Verilog RTL 2.3k 0

SystemVerilog中枚舉類型的使用建議

SystemVerilog中枚舉類型雖然屬于一種“強(qiáng)類型”，但是枚舉類型還是提供了一些“不正經(jīng)”的用法可以實(shí)現(xiàn)一些很常見的功能，本文將示例一些在枚舉類型...

2022-09-01 標(biāo)簽：Verilog System 枚舉 2.3k 0

FPGA入門之模塊結(jié)構(gòu)

模塊（ module）是 Verilog 的基本描述單位，是用于描述某個(gè)設(shè)計(jì)的功能或結(jié)構(gòu)及與其他模塊通信的外部端口。模塊在概念上可等同一個(gè)器件...

2023-03-21 標(biāo)簽：模塊 cpu Verilog 2.3k 0

Verilog基本語(yǔ)法概述

Verilog 是一種用于數(shù)字邏輯電路設(shè)計(jì)的硬件描述語(yǔ)言，可以用來(lái)進(jìn)行數(shù)字電路的仿真驗(yàn)證、時(shí)序分析、邏輯綜合。

2023-06-10 標(biāo)簽：邏輯電路電路設(shè)計(jì)Verilog 2.3k 0

verilog中的task用法介紹

任務(wù)就是一段封裝在“task-endtask”之間的程序。任務(wù)是通過(guò)調(diào)用來(lái)執(zhí)行的，而且只有在調(diào)用時(shí)才執(zhí)行

2023-06-05 標(biāo)簽：寄存器 Verilog 全加器 2.3k 0

SystemVerilog中的package和`include有什么不同？

肯定很多人會(huì)問(wèn)為什么有的地方使用package，有的地方使用`include，二者是不是等價(jià)的呢？

2022-11-14 標(biāo)簽：Verilog System Package 2.3k 0

基于Verilog計(jì)算精度可調(diào)的整數(shù)除法器的設(shè)計(jì)

除法器是電子技術(shù)領(lǐng)域的基礎(chǔ)模塊，在電子電路設(shè)計(jì)中得到廣泛應(yīng)用。目前，實(shí)現(xiàn)除法器的方法有硬件實(shí)現(xiàn)和軟件實(shí)現(xiàn)兩種方法。硬件實(shí)現(xiàn)的方法主要是以硬件的消耗為代價(jià)...

2012-05-24 標(biāo)簽：Verilog 精度可調(diào)整數(shù)除法器 2.3k 0

Verilog的語(yǔ)言要素

本章介紹Verilog HDL的基本要素，包括標(biāo)識(shí)符、注釋、數(shù)值、編譯程序指令、系統(tǒng)任務(wù)和系統(tǒng)函數(shù)。另外，本章還介紹了Verilog硬件描述語(yǔ)言中的兩種...

2017-02-11 標(biāo)簽：FPGA Verilog 2.3k 0

RTL級(jí)機(jī)器人電機(jī)控制器的FPGA設(shè)計(jì)

借助Verilog，在FPGA中實(shí)現(xiàn)了帶編碼器的兩臺(tái)電機(jī)的電機(jī)控制系統(tǒng)的RTL級(jí)設(shè)計(jì)。

2025-07-07 標(biāo)簽：FPGA 機(jī)器人 Verilog 2.3k 0

基于Verilog的開關(guān)級(jí)建模

開關(guān)級(jí)建模是比門級(jí)建模更為低級(jí)抽象層次上的設(shè)計(jì)。在極少數(shù)情況下，設(shè)計(jì)者可能會(huì)選擇使用晶體管作為設(shè)計(jì)的底層模塊。隨著電路設(shè)計(jì)復(fù)雜度及相關(guān)先進(jìn)工具的出現(xiàn)，以...

2023-03-30 標(biāo)簽：開關(guān)電路設(shè)計(jì)信號(hào) 2.3k 0

Fpga Verilog SDRAM模塊—單字讀寫案例

筆者與SDRAM有段不短的孽緣，它作為冤魂日夜不斷糾纏筆者。筆者嘗試過(guò)許多方法將其退散，不過(guò)屢試屢敗的筆者，最終心情像橘子一樣橙。

2023-12-15 標(biāo)簽：fpga SDRAM Verilog 2.3k 0

IC設(shè)計(jì)之Verilog代碼規(guī)范

Verilog規(guī)范對(duì)于一個(gè)好的IC設(shè)計(jì)至關(guān)重要。

2023-08-17 標(biāo)簽：IC設(shè)計(jì)Verilog 程序 2.3k 0

Verilog HDL的歷史 FPGA硬件描述語(yǔ)言設(shè)計(jì)流程

硬件描述語(yǔ)言(HDL)是一種用形式化方法來(lái)描述數(shù)字電路和系統(tǒng)的語(yǔ)言。數(shù)字電路系統(tǒng)的設(shè)計(jì)者利用這種語(yǔ)言可以從上層到下層(從抽象到具體)逐層描述自己的設(shè)計(jì)思...

2023-08-08 標(biāo)簽：fpga Verilog HDL 2.3k 0

如何使用verilog參數(shù)和generate語(yǔ)句來(lái)編寫可重用的verilog代碼？

與大多數(shù)編程語(yǔ)言一樣，我們應(yīng)該嘗試使盡可能多的代碼可重用。這使我們能夠減少未來(lái)項(xiàng)目的開發(fā)時(shí)間，因?yàn)槲覀兛梢愿p松地將代碼從一個(gè)設(shè)計(jì)移植到另一個(gè)設(shè)計(jì)。

2023-05-08 標(biāo)簽：Verilog 計(jì)數(shù)器編程語(yǔ)言 2.2k 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
AD10

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識(shí)別

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FPGA開發(fā)板

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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車電子產(chǎn)品的開發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

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PCB封裝庫(kù)

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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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Protel 99 se

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面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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