verilog

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Verilog HDL是一種硬件描述語(yǔ)言（HDL:Hardware Description Language），以文本形式來(lái)描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語(yǔ)言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

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verilog技術(shù)

SystemVerilog中的“l(fā)et”語(yǔ)法

相比`define的全局scope，“l(fā)et” 可以只作用在局部scope。

2022-12-05 標(biāo)簽：Verilog System LET 2417 0

Verilog基礎(chǔ)：介紹幾個(gè)常用的按位操作符

位操作符是對(duì)二進(jìn)制位進(jìn)行操作的運(yùn)算符。以下是一些常用的位操作符

2023-11-09 標(biāo)簽：Verilog 狀態(tài)機(jī)XOR 2414 0

verilog中數(shù)據(jù)的符號(hào)屬性（有符號(hào)數(shù)和無(wú)符號(hào)數(shù)）探究根源

為了省流，還是先甩結(jié)論。有符號(hào)數(shù)和無(wú)符號(hào)數(shù)的最本質(zhì)區(qū)別就是：符號(hào)位的識(shí)別和高位拓展。除此之外，另一個(gè)區(qū)別就是從人的角度如何如何讀這個(gè)數(shù)，或者說(shuō)$disp...

2023-12-10 標(biāo)簽：Verilog 運(yùn)算符號(hào) 2414 0

ZYNQ7000系列FPGA資源對(duì)比

對(duì)于軟硬件技術(shù)開(kāi)發(fā)人員，ZYNQ是比較好的入門(mén)級(jí)FPGA，你可以在FPGA上用verilog編寫(xiě)RTL代碼，也可以在ARM中用C語(yǔ)言編寫(xiě)應(yīng)用程序。而入手...

2023-09-06 標(biāo)簽：fpga arm Verilog 2411 0

Verilog的兩個(gè)誤區(qū)

Reg類(lèi) 型只在過(guò)程塊中被賦值;而Net類(lèi)型則在過(guò) 程塊外面被賦值或者驅(qū)動(dòng).

2017-02-11 標(biāo)簽：Verilog 2407 0

SystemVerilog的隨機(jī)約束方法

上一篇文章《暗藏玄機(jī)的SV隨機(jī)化》介紹了SystemVerilog的各種隨機(jī)化方法，本文將在其基礎(chǔ)上引入SystemVerilog的隨機(jī)約束方法（con...

2023-09-24 標(biāo)簽：仿真器 Verilog System 2399 0

verilog同步和異步的區(qū)別 verilog阻塞賦值和非阻塞賦值的區(qū)別

Verilog是一種硬件描述語(yǔ)言，用于設(shè)計(jì)和模擬數(shù)字電路。在Verilog中，同步和異步是用來(lái)描述數(shù)據(jù)傳輸和信號(hào)處理的兩種不同方式，而阻塞賦值和非阻塞賦...

2024-02-22 標(biāo)簽：數(shù)據(jù)傳輸信號(hào)處理 Verilog 2382 0

SystemVerilog中的fork-join_any

fork-join_any和fork-join有所不同，fork-join_any的父進(jìn)程一直阻塞，直到任何一個(gè)并行的子進(jìn)程結(jié)束。

2022-12-09 標(biāo)簽：Verilog System 進(jìn)程 2379 0

FPGA協(xié)處理的優(yōu)勢(shì)有哪些？如何去使用FPGA協(xié)處理？

傳統(tǒng)的、基于通用DSP處理器并運(yùn)行由C語(yǔ)言開(kāi)發(fā)的算法的高性能DSP平臺(tái)，正在朝著使用FPGA預(yù)處理器和/或協(xié)處理器的方向發(fā)展。這一最新發(fā)展能夠?yàn)楫a(chǎn)品提供...

2023-10-21 標(biāo)簽：fpga Xilinx Verilog 2357 0

Interface端口的概念介紹

SystemVerilog Interface是modport的一種，但比簡(jiǎn)單的輸入、輸出或輸入輸出端口的功能更多。

2023-04-19 標(biāo)簽：AMBA總線 Verilog RTL 2353 0

考慮x和z在verilog條件語(yǔ)句中的使用情況

首先，考慮x和z在verilog條件語(yǔ)句中的使用情況，然后我們?cè)倏紤]在verilog中用x和z給其他reg/wire賦值的情況。

2023-11-02 標(biāo)簽：仿真器 Verilog HDL 2344 0

Verilog編碼中位寬不匹配的危害是什么？

位寬不匹配會(huì)導(dǎo)致綜合產(chǎn)生的網(wǎng)表與個(gè)人預(yù)期差異較大，導(dǎo)致功能不正確。VCS仿真能及時(shí)發(fā)現(xiàn)問(wèn)題，但VCS仿真存在部分場(chǎng)景沒(méi)有覆蓋的問(wèn)題，因此僅僅通過(guò)VCS仿...

2023-09-19 標(biāo)簽：Verilog VCS 2335 0

SystemVerilog中的“const”類(lèi)屬性

SystemVerilog中可以將類(lèi)屬性聲明為常量，即“只讀”。目的就是希望，別人可以讀但是不能修改它的值。

2022-11-29 標(biāo)簽：Verilog System 函數(shù) 2332 0

用Verilog函數(shù)實(shí)現(xiàn)一個(gè)數(shù)據(jù)大小端轉(zhuǎn)換的功能

在 Verilog 中，可以利用任務(wù)（關(guān)鍵字為 task）或函數(shù)（關(guān)鍵字為 function），將重復(fù)性的行為級(jí)設(shè)計(jì)進(jìn)行提取，并在多個(gè)地方調(diào)用，來(lái)避免重...

2023-06-01 標(biāo)簽：寄存器 Verilog 數(shù)碼管 2309 0

正點(diǎn)原子開(kāi)拓者FPGA視頻:Verilog高級(jí)知識(shí)點(diǎn)

Verilog HDL語(yǔ)言不僅定義了語(yǔ)法，而且對(duì)每個(gè)語(yǔ)法結(jié)構(gòu)都定義了清晰的模擬、仿真語(yǔ)義。因此，用這種語(yǔ)言編寫(xiě)的模型能夠使用Verilog仿真器進(jìn)行驗(yàn)證...

2019-09-19 標(biāo)簽：fpga 仿真器 verilog 2307 0

呼吸燈電路設(shè)計(jì)

2023-01-29 標(biāo)簽：led 電路電路設(shè)計(jì) 2285 0

Verilog設(shè)計(jì)增加延時(shí)的仿真技術(shù)

作者：bleauchat 在設(shè)計(jì)仿真激勵(lì)文件時(shí)，為了滿足和外部芯片接口的時(shí)序要求，經(jīng)常會(huì)用到延時(shí)賦值語(yǔ)句，由于不同的延時(shí)賦值語(yǔ)句在仿真過(guò)程中行為不同，會(huì)...

2020-11-25 標(biāo)簽：Verilog 2284 0

什么是移位運(yùn)算符

移位運(yùn)算符將向量的位向右或向左移位指定的次數(shù)。SystemVerilog具有按位和算術(shù)移位運(yùn)算符

2023-02-09 標(biāo)簽：Verilog System 運(yùn)算符 2282 0

verilog向量的部分選擇

最近在看verilog代碼時(shí)發(fā)現(xiàn)如下寫(xiě)法a[x*2+:4]這樣的寫(xiě)法，后來(lái)花了一點(diǎn)時(shí)間了解到，該寫(xiě)法稱為向量的部分選擇，還語(yǔ)法在verilog-2001...

2023-04-25 標(biāo)簽：Verilog 2272 0

一文詳解Verilog HDL

Verilog HDL（Hardware Description Language）是一種硬件描述語(yǔ)言，用于從算法級(jí)、門(mén)級(jí)到開(kāi)關(guān)級(jí)的多種抽象設(shè)計(jì)層次的數(shù)...

2025-03-17 標(biāo)簽：FPGA 寄存器 Verilog 2256 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

+關(guān)注

ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
AD10

AD10

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識(shí)別

識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

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PCB封裝庫(kù)

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AD09

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PDN

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QuickPcb

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Artix-7

Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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Protel 99 se

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powerlink

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candence

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面包板

面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
AXI

AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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verilog

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