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標簽 > vhdl
VHDL全名Very-High-Speed Integrated Circuit Hardware Description Language,誕生于1982年。1987年底,VHDL被IEEE和美國國防部確認為標準硬件描述語言 。
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寄存器是設(shè)備中用于存儲數(shù)據(jù)的常見電子元件。這些是最小的數(shù)據(jù)保存元素,用于存儲 CPU 正在處理的操作數(shù)或指令。有不同類型的寄存器,即指令寄存器、程序寄存...
采用VHDL語言在FPGA芯片上實現(xiàn)NAND Flash的數(shù)據(jù)存儲系統(tǒng)的設(shè)計
NAND Flash存儲設(shè)備是Flash內(nèi)存的一種,其內(nèi)部采用非線性宏單元模式,為固態(tài)大容量內(nèi)存的實現(xiàn)提供了廉價有效的解決方案。NAND Flash存儲...
本文主要介紹了C到VHDL的編譯器設(shè)計與實現(xiàn),首先介紹了C與VHDL的語言特征,其次闡述了設(shè)計方案,最后介紹了轉(zhuǎn)換過程及測試分析,具體的跟隨小編一起來了解一下。
利用VHDL語言與FPGA器件設(shè)計數(shù)字日歷
本文介紹如何利用VHDL硬件描述語言設(shè)計一個具有年、月、日、星期、時、分、秒計時顯示功能,時間調(diào)整功能和整點報時功能的數(shù)字日歷。在QuartusⅡ開發(fā)環(huán)...
幾乎所有的芯片設(shè)計、芯片驗證工程師,每天都在和VCS打交道,但是由于驗證環(huán)境的統(tǒng)一化管理,一般將不同的編譯仿真選項集成在一個文件里,只需要一兩個人維護即...
HDL(VHSIC Hardware Description Language)是一種硬件描述語言,主要用于描述數(shù)字電路和系統(tǒng)的結(jié)構(gòu)、行為和功能。它是一...
利用VHDL語言和BiSS協(xié)議實現(xiàn)光電編碼器的設(shè)計
位置編碼器是工業(yè)自動控制中重要的反饋環(huán)節(jié)執(zhí)行元件。位置編碼器按工作方式分為絕對式和增量式兩種。絕對位置式編碼器的數(shù)據(jù)輸出一般采用串行通信的方式。位置編碼...
基于VHDL語言和FPGA開發(fā)板實現(xiàn)數(shù)字秒表的設(shè)計
應(yīng)用VHDL語言設(shè)計數(shù)字系統(tǒng),很多設(shè)計工作可以在計算機上完成,從而縮短了系統(tǒng)的開發(fā)時間,提高了工作效率。本文介紹一種以FPGA為核心,以VHDL為開發(fā)工...
基于EDA技術(shù)和VHDL語言編程實現(xiàn)智能交通控制燈的設(shè)計
十字路口設(shè)計兩組交通燈分別控制東西和南北兩個方向的交通。如圖1所示,當東西方向的紅燈亮?xí)r,南北方向?qū)?yīng)綠燈亮,過渡階段黃燈亮,即東西方向紅燈亮的時間等于...
基于EDA技術(shù)與VHDL語言實現(xiàn)空調(diào)控制系統(tǒng)的設(shè)計
空調(diào)控制系統(tǒng)結(jié)構(gòu)如圖1所示。首先由傳感器檢測室內(nèi)溫度,并將采集來的數(shù)據(jù)傳輸?shù)娇刂葡到y(tǒng)的預(yù)處理單元。在預(yù)處理單元將采集來的溫度信號與設(shè)定值相比較,以判斷當...
2019-01-14 標簽:傳感器控制系統(tǒng)eda 3984 0
利用不恢復(fù)余數(shù)陣列除法和VHDL實現(xiàn)雷達數(shù)據(jù)接收/顯示系統(tǒng)的設(shè)計
根據(jù)系統(tǒng)要求,脈沖雷達高度表通過RS-422串行輸出高度數(shù)據(jù),要求數(shù)據(jù)接收模塊實時接收,并顯示雷達高度數(shù)據(jù)。接收模塊接收到的高度數(shù)據(jù)采用二進制(BIN)...
采用VHDL語言與FPGA芯片實現(xiàn)平均值相位差計的設(shè)計
相位差的測量在研究網(wǎng)絡(luò)特性中具有重要作用,如何快速、精確地測量相位差已成為生產(chǎn)科研中的重要課題。測量相位差的方法很多,有集成電路設(shè)計的,也有采用數(shù)字信號...
采用VHDL語言實現(xiàn)線性分組碼編/譯碼器的設(shè)計與仿真驗證
在通信系統(tǒng)中,由于信道存在大量的噪聲和干擾,使得經(jīng)信道傳輸后的接收碼與發(fā)送碼之間存在差異,出現(xiàn)誤碼。在數(shù)字通信系統(tǒng)中常采用差錯控制信道編碼技術(shù),以此來減...
基于VHDL和CPLD的智能數(shù)字電壓表設(shè)計
本系統(tǒng)是用CPLD實現(xiàn)的智能數(shù)字電壓表。隨著EDA技術(shù)的廣泛應(yīng)用,CPLD已成為現(xiàn)代數(shù)字系統(tǒng)設(shè)計的主要手段,CPLD目前正朝著更高速、更高集成度、更強功...
PYNQ設(shè)計案例:基于HDL語言+Vivado的自定義IP核創(chuàng)建
作者:Mculover666 1.實驗?zāi)康?用HDL語言+Vivado創(chuàng)建一個掛載在AXI總線上的自定義IP核 2.實驗步驟 2.1.創(chuàng)建一個新的項目 ...
實現(xiàn)PCM碼解調(diào)系統(tǒng)的VHDL程序模塊設(shè)計
圖1給出基于FPGA的硬件電路。其中,圖1(a)為FPGA配置模塊;圖1(b)為信號收發(fā)模塊及PCM碼接收模塊。
基于Altera公司EPM240芯片的智能撥號報警系統(tǒng)設(shè)計
本文采用CPLD控制核心實現(xiàn)了智能報警系統(tǒng)。由于利用EDA技術(shù)進行系統(tǒng)設(shè)計,外圍器件少、體積小、功耗低、可靠性高。通過修改VHDL源程序就可以增加一些新...
2013-01-17 標簽:CPLD報警系統(tǒng)VHDL 3608 0
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