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標(biāo)簽 > vhdl
VHDL全名Very-High-Speed Integrated Circuit Hardware Description Language,誕生于1982年。1987年底,VHDL被IEEE和美國國防部確認為標(biāo)準(zhǔn)硬件描述語言 。
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作為一個真正合格的數(shù)字IC設(shè)計工程師,你永遠都需要去不斷學(xué)習(xí)更加先進的知識和技術(shù)。因此,這里列出來的技能永遠都不會是完整的。我盡量每年都對這個列表進行一...
執(zhí)行算法邏輯(加、減、乘、除及復(fù)雜的組合運算)優(yōu)化。例如,乘法器有多種實現(xiàn)方式, 相應(yīng)地會產(chǎn)生多種時序、功耗及面積,如何根據(jù)目標(biāo)設(shè)定選出最合適的結(jié)構(gòu)將對...
基于Altera的FPGA器件和VHDL語言實現(xiàn)數(shù)據(jù)采集系統(tǒng)的設(shè)計
傳統(tǒng)的數(shù)據(jù)采集系統(tǒng),通常采用單片機或DSP作為主要控制模塊,控制ADC、存儲器和其他外圍電路的工作。隨著數(shù)據(jù)采集對速度性能的要求越來越高,傳統(tǒng)采集系統(tǒng)的...
2020-08-06 標(biāo)簽:fpga數(shù)據(jù)采集vhdl 1369 0
基于ASIC和VHDL語言實現(xiàn)成/解幀電路的設(shè)計
符合G.704 標(biāo)準(zhǔn)的E1 幀結(jié)構(gòu)如圖1 所示,每基本幀由32 個路時隙(ts0“ts31)組成,分別分配給30 個話音數(shù)據(jù)流和相應(yīng)輔助信息。每個路時隙...
在Altera CycIone II系列FPGA中用VHDL實現(xiàn)E2PROM控制器的設(shè)計
E2PROM存儲器存儲單元的損壞主要是由頻繁的寫操作造成的。若要解決問題,首先耍避免對同一單元進行頻繁的擦寫,降低存儲單元損壞的可能;其次當(dāng)某些單元損壞...
Verilog與VHDL的比較 Verilog HDL編程技巧
Verilog 與 VHDL 比較 1. 語法和風(fēng)格 Verilog :Verilog 的語法更接近于 C 語言,對于有 C 語言背景的工程師來說,學(xué)習(xí)...
基于可編程邏輯器件CPLD芯片和VHDL語言實現(xiàn)彩燈控制器系統(tǒng)的設(shè)計
彩燈作為一種景觀,安裝在建筑物的適當(dāng)?shù)胤揭皇亲鳛檠b飾增添節(jié)日氣氛,二是有一種廣告宣傳的作用,也可用在舞臺上增強晚會燈光效果。實現(xiàn)彩燈控制的方案很多,不同...
基于EP1K30TC144-3芯片實現(xiàn)溫控定時噴灌系統(tǒng)的設(shè)計和仿真分析
FPGA是新型的可編程邏輯器件,能夠?qū)⒋罅康倪壿嫻δ芗捎趩蝹€器件中,它所提供的門數(shù)從幾百門到上百萬門,符合系統(tǒng)芯片(SOC—System On Chi...
基于復(fù)雜可編程邏輯器件和VHDL語言實現(xiàn)半整數(shù)分頻器的設(shè)計
在數(shù)字系統(tǒng)設(shè)計中,根據(jù)不同的設(shè)計需要,經(jīng)常會遇到偶數(shù)分頻、奇數(shù)分頻、半整數(shù)分頻等,有的還要求等占空比。在基于cpld(復(fù)雜可編程邏輯器件)的數(shù)字系統(tǒng)設(shè)計...
深入開源處理器內(nèi)部,RISC-V技術(shù)分析
FPGA技術(shù)與(V)HDL的結(jié)合在電子專家中很受歡迎,RISC-V為專業(yè)應(yīng)用增加了開源途徑。在本文中,我們測試了一些在Elektor的“Alchitry...
在測控系統(tǒng)中用IP核實現(xiàn)D/A轉(zhuǎn)換
摘要:采用數(shù)字化技術(shù)、在測控系統(tǒng)中用IP核實現(xiàn)D/A轉(zhuǎn)換,并且在1片可編程邏輯器件中實現(xiàn)。它不受溫度的影響,既可保持高分辨率,又可降低對電路精度和穩(wěn)
基于Xilinx Spartan系列FPGA和VHDL語言設(shè)計衛(wèi)星數(shù)據(jù)存儲糾錯系統(tǒng)
空間飛器在太空環(huán)境中面臨的主要問題之一就是輻射。太空中的各種高能粒子(包括高能質(zhì)子、中子、α粒子、得離子等)具有很高的動能,通過時可能會影響半導(dǎo)體電路的...
Verilog和VHDL是兩種廣泛使用的硬件描述語言(HDL),它們用于描述和模擬數(shù)字電路系統(tǒng)的行為和結(jié)構(gòu)。這兩種語言的主要作用是幫助工程師設(shè)計、仿真和...
采用SOPC技術(shù)和VHDL語言實現(xiàn)圖像增強處理系統(tǒng)的應(yīng)用方案
圖像增強最早起源于人類的空間探索計劃。從衛(wèi)星或飛船上獲得的關(guān)于地球和太陽系中行星的圖像因為多種原因而降質(zhì),這些原因如成像設(shè)備受使用環(huán)境的限制,相機和對象...
采用VHDL語言在FPGA上實現(xiàn)WolfMCU體系結(jié)構(gòu)的設(shè)計
基于以上討論,可以看出ASIP+FPGA設(shè)計模式可以從很大程度上解決引言中提到的兩個難題。為了進行更深入的研究,我們對該設(shè)計模式進行了嘗試,用VHDL硬...
基于FPGA VHDL的ASK調(diào)制與解調(diào)
ASK即“幅移鍵控”又稱為“振幅鍵控”,也有稱為“開關(guān)鍵控”(通斷鍵控)的,所以又記作OOK信號。ASK是一種相對簡單的調(diào)制方式。
一種基于Petri網(wǎng)的并行控制器的VHDL實現(xiàn)
Petri網(wǎng)是離散事件系統(tǒng)建模的重要工具,本文使用硬件描述語言VHDL實現(xiàn)了基于Petri網(wǎng)的并行控制器。文中通過一個液位控制系統(tǒng)實例具體介紹了這一方法...
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