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火熱開賽,第五屆集成電路EDA設(shè)計(jì)精英挑戰(zhàn)賽概倫電子賽題發(fā)布

概倫電子Primarius ? 來源:未知 ? 2023-08-22 18:25 ? 次閱讀
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近日,第五屆集成電路EDA設(shè)計(jì)精英挑戰(zhàn)賽正式拉開帷幕。作為國(guó)內(nèi)首家EDA上市公司,也是集成電路設(shè)計(jì)自動(dòng)化(EDA)產(chǎn)教融合聯(lián)盟常務(wù)理事單位,概倫電子一直秉持與中國(guó)集成電路產(chǎn)業(yè)共同成長(zhǎng)的理念,始終致力于為中國(guó)集成電路產(chǎn)業(yè)打造多層次的專業(yè)人才培養(yǎng)機(jī)制,已連續(xù)五年支持和參與該項(xiàng)賽事。本次概倫電子全新發(fā)布“標(biāo)準(zhǔn)單元電路的版圖自動(dòng)生成”企業(yè)賽題,歡迎廣大同學(xué)們踴躍報(bào)名!

賽題名稱

標(biāo)準(zhǔn)單元電路的版圖自動(dòng)生成

賽題背景

數(shù)字電路標(biāo)準(zhǔn)單元庫(kù)的開發(fā)中,版圖設(shè)計(jì)是最重要的環(huán)節(jié)之一。目前標(biāo)準(zhǔn)單元的版圖繪制仍然以人工繪制為主,而庫(kù)中單元的數(shù)量往往多達(dá)上千顆,導(dǎo)致整個(gè)標(biāo)準(zhǔn)單元庫(kù)的開發(fā)周期較長(zhǎng)。如果能夠提高標(biāo)準(zhǔn)單元版圖設(shè)計(jì)自動(dòng)化的程度,整個(gè)庫(kù)的開發(fā)周期將大大縮減。標(biāo)準(zhǔn)單元的版圖設(shè)計(jì)中,通常包含兩個(gè)環(huán)節(jié)——晶體管布局和布線。本賽題重點(diǎn)關(guān)注布局環(huán)節(jié),主要考慮組合邏輯和時(shí)序邏輯的標(biāo)準(zhǔn)單元,包含NMOS 和 PMOS 晶體管。在本題中,平面工藝下簡(jiǎn)化后的布局問題如圖1所示,標(biāo)準(zhǔn)單元將被放在兩條電源軌道(Power Rail)之間,高度固定,寬度不定。

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在標(biāo)準(zhǔn)單元的內(nèi)部,晶體管按兩行依次放置,PMOS晶體管在上面一行,NMOS 晶體管放在下面一行,本題中所有晶體管的有源區(qū)向電源軌道對(duì)齊,如圖 2,詳細(xì)描述見賽題描述。

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注:1. 晶體管由兩個(gè)矩形表示,垂直矩形為柵極,藍(lán)色矩形為有源區(qū)。2. 圖中上下兩側(cè)的綠色矩形為電源軌道,分別連接VDD 和VSS。3. 整個(gè)標(biāo)準(zhǔn)單元被等分為兩個(gè)部分,上半部分為PMOS 晶體管可放置的區(qū)域,下半部分為 NMOS 晶體管可放置的區(qū)域。4. 所有晶體管有源區(qū)向兩側(cè)的電源軌道對(duì)齊。5. 同一水平位置的晶體管柵極會(huì)直接相連。6. 若兩個(gè)晶體管的有源區(qū)重疊,則其柵極間距為1個(gè)單位長(zhǎng)度,此時(shí)要求重疊部分所連線網(wǎng)相同;若不重疊,則其柵極間距至少為2個(gè)單位長(zhǎng)度。7. 本題中任意兩個(gè)晶體管的柵極間距都為整數(shù)個(gè)單位長(zhǎng)度。

在進(jìn)行晶體管布局時(shí),版圖工程師通常需要考慮以下這些內(nèi)容:

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在現(xiàn)有的標(biāo)準(zhǔn)單元布局算法的研究中,對(duì)面積和可布線性的優(yōu)化算法已經(jīng)有較多的參考。但是由于缺乏對(duì)其他內(nèi)容的考慮,算法自動(dòng)生成的布局通常無法直接被使用,尤其是在一些較為復(fù)雜的標(biāo)準(zhǔn)單元中,版圖工程師往往需要花上 1-2 周的時(shí)候去調(diào)整和優(yōu)化布局。

賽題Chair介紹

葉佐昌

清華大學(xué)

ef47c16a-40d5-11ee-a2ef-92fbcf53809c.jpg博士,畢業(yè)于清華大學(xué)微電子研究所。曾在美國(guó)Cadence伯克利實(shí)驗(yàn)室擔(dān)任研究員,目前為清華大學(xué)集成電路學(xué)院副研究員,研究領(lǐng)域包括集成電路仿真、建模和自動(dòng)化設(shè)計(jì)方法學(xué)。目前研究方向主要用于模擬全流程敏捷設(shè)計(jì)的EDA工具開發(fā)

賽題描述

ef5aecea-40d5-11ee-a2ef-92fbcf53809c.jpgef8edf46-40d5-11ee-a2ef-92fbcf53809c.jpgefbdd918-40d5-11ee-a2ef-92fbcf53809c.jpgefe4a084-40d5-11ee-a2ef-92fbcf53809c.jpgf002659c-40d5-11ee-a2ef-92fbcf53809c.jpgf019ff04-40d5-11ee-a2ef-92fbcf53809c.jpgf03ec294-40d5-11ee-a2ef-92fbcf53809c.jpgf064f130-40d5-11ee-a2ef-92fbcf53809c.jpgf07cb572-40d5-11ee-a2ef-92fbcf53809c.jpgf097a53a-40d5-11ee-a2ef-92fbcf53809c.jpgf0b57326-40d5-11ee-a2ef-92fbcf53809c.jpg

向左滑動(dòng)查看更多內(nèi)容>>

大賽概況

2023 (第五屆)集成電路EDA設(shè)計(jì)精英挑戰(zhàn)賽賽程時(shí)間安排如下:

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EDA設(shè)計(jì)精英挑戰(zhàn)賽現(xiàn)已正式開放報(bào)名,關(guān)注官網(wǎng)(http://eda.icisc.cn),獲取更多大賽信息。

獎(jiǎng)項(xiàng)設(shè)置

麒麟杯(1支):20萬菁英杯(1-2支):8萬一等獎(jiǎng)(最高15%):2萬二等獎(jiǎng)(最高30%):1萬

關(guān)于概倫

上海概倫電子股份有限公司(688206.SH)作為國(guó)內(nèi)首家EDA上市公司,是關(guān)鍵核心技術(shù)具備國(guó)際市場(chǎng)競(jìng)爭(zhēng)力的EDA領(lǐng)軍企業(yè),致力于打造應(yīng)用驅(qū)動(dòng)的、覆蓋集成電路設(shè)計(jì)與制造的EDA全流程解決方案,支撐各類高端芯片研發(fā)的持續(xù)發(fā)展,并聯(lián)合產(chǎn)業(yè)鏈上下游和EDA合作伙伴,建設(shè)有競(jìng)爭(zhēng)力和生命力的EDA生態(tài)。通過EDA方法學(xué)創(chuàng)新,概倫電子推動(dòng)集成電路設(shè)計(jì)和制造的深度聯(lián)動(dòng),加快工藝開發(fā)和芯片設(shè)計(jì)進(jìn)程,提高集成電路產(chǎn)品的良率和性能,增強(qiáng)了集成電路企業(yè)整體市場(chǎng)競(jìng)爭(zhēng)力。 f0e5c54e-40d5-11ee-a2ef-92fbcf53809c.jpg ?掃描二維碼
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