NVMe IP高速傳輸卻不依賴XDMA設(shè)計(jì)之六：性能監(jiān)測(cè)單元設(shè)計(jì)
性能監(jiān)測(cè)單元負(fù)責(zé)監(jiān)測(cè) NVMe over PCIe 邏輯加速引擎的運(yùn)行狀態(tài)和統(tǒng)計(jì)信息， 包括復(fù)位后運(yùn)行時(shí)間信息、 NVMe 指令數(shù)量統(tǒng)計(jì)信息、 數(shù)據(jù)操作數(shù)量統(tǒng)計(jì)信息、 IOPS 性能統(tǒng)計(jì)信息、 指令延遲統(tǒng)計(jì)信息等。 這些信息存儲(chǔ)在性能監(jiān)測(cè)單元中的性能監(jiān)測(cè)寄存器組中，性能監(jiān)測(cè)寄存器組定義如表1 所示。
表1 性能監(jiān)測(cè)寄存器組定義
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