如何使用電源管理系統(tǒng)使FPGA收發(fā)器的容差保持很小
ADI Guneet Chadha演示如何使用電源系統(tǒng)管理使FPGA內(nèi)核或I/O（例如：高速收發(fā)器）的電源輸出電壓(1V)保持在很小的容差范圍內(nèi)(0.25%)還顯示了“如何確定電源裕量”
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發(fā)表于 01-13 06:29
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