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標(biāo)簽 > vhdl
VHDL全名Very-High-Speed Integrated Circuit Hardware Description Language,誕生于1982年。1987年底,VHDL被IEEE和美國國防部確認為標(biāo)準(zhǔn)硬件描述語言 。
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基于Altera CPLD的水輪發(fā)電機組轉(zhuǎn)速監(jiān)控系統(tǒng)的設(shè)計
電子發(fā)燒友網(wǎng)核心提示 :本文給出了采用CPLD的水輪發(fā)電機組轉(zhuǎn)速監(jiān)控系統(tǒng)的設(shè)計原理和VHDL的語言描述,該設(shè)計具有結(jié)構(gòu)簡單、成本低和抗干擾性能強等特點。...
使用VHDL語言和FPGA技術(shù)實現(xiàn)高效微控制器內(nèi)核的設(shè)計
與傳統(tǒng)投片實現(xiàn)ASIC相比,F(xiàn)PGA具有實現(xiàn)速度快、風(fēng)險小、可編程、可隨時更改升級等一系列優(yōu)點,因而得到了越米越廣泛的應(yīng)用。MCS-51應(yīng)用時間長、范圍...
使用CPLD器件和VHDL語言實現(xiàn)USB收發(fā)模塊的硬件功能設(shè)計
當(dāng)前,高密度可編程邏輯器件CPLD,由于具有巨大的靈活性而廣泛應(yīng)用于狀態(tài)機、同步、譯碼、解碼、計數(shù)、總線接口、串并轉(zhuǎn)換等很多方面,而且在信號處理領(lǐng)域的應(yīng)...
為了提高傳輸速率,擴大通信容量,減少信道數(shù)量,通常把多路信號復(fù)用成一路信號進行傳輸。在多種復(fù)用方式中,時分復(fù)用是一種常用的方式。時分復(fù)用是多路信號按照時...
基于VHDL語言及SOPC技術(shù)實現(xiàn)全數(shù)字調(diào)頻信號發(fā)生器的設(shè)計
在常用的信號源及信號處理設(shè)計方案中,RC/LC振蕩電路頻率調(diào)整方便,但是它的工作頻率穩(wěn)定度較低。頻率穩(wěn)定度較低導(dǎo)致系統(tǒng)的工作穩(wěn)定度降低,使其不適用于對精...
采用VHDL實現(xiàn)有線電視機頂盒數(shù)據(jù)格式轉(zhuǎn)換的設(shè)計方案
VHDL是隨著可編輯邏輯器件(PLD)的發(fā)展而發(fā)展起來的一種硬件描述語言。它是1980年美國國防部VHSIC(超高速集成電路)計劃的一部分,并于1986...
基于FPGA/CPLD的嵌入式VGA顯示系統(tǒng)設(shè)計
VGA(Video GraphICs Array)即視頻圖形陣列,是IBM在1987年隨PS/2機(PS/2 原是Personal System 2的意...
采用單片CPLD器件及VHDL源程序?qū)崿F(xiàn)單個載客箱的電梯控制系統(tǒng)
隨著社會的發(fā)展。使用電梯越來越普遍,已從原來只在商業(yè)大廈、賓館過渡到在辦公室、居民樓等多種建筑中,并且對電梯功能的要求也不斷提高,其相應(yīng)控制方式也在不斷...
基于FPGA和VHDL語言編程實現(xiàn)液晶屏信號發(fā)生器的設(shè)計
液晶顯示已成為目前平板電視與計算機顯示終端的主流,液晶顯示器的研究設(shè)計、生產(chǎn)、檢驗等部門甚至消費者需要用一些定量或定性的方法和指標(biāo)去檢驗液晶顯示器的質(zhì)量和特性。
采用VHDL語言在CPLD內(nèi)部編程實現(xiàn)Flash讀取控制設(shè)計
本設(shè)計已實用于國家863計劃“可擴展到T比特的高性能IPv4/v6路由器基礎(chǔ)平臺及實驗系統(tǒng)”項目中。其主要功能是對主控部分的FPGA讀取Flash進行控制。
基于可編程邏輯器件和VHDL語言實現(xiàn)信號源的方案設(shè)計
在高速數(shù)據(jù)采集系統(tǒng)中,信號源作為一種校驗設(shè)備,需要及時、有效地向采集設(shè)備提供高頻信號,用于檢驗數(shù)據(jù)采集器的工作情況;同時信號源還應(yīng)該能夠提供一些必要的控...
為什么設(shè)計復(fù)雜系統(tǒng)如此之難?淺談利用仿真攻克汽車系統(tǒng)設(shè)計
當(dāng)今汽車行業(yè)所面臨的挑戰(zhàn)與電信行業(yè)十多年前所經(jīng)歷的類似?;旌蟿恿﹄妱悠嚭腿剂想姵仄嚨刃录夹g(shù)也促進了研發(fā)活動的日趨活躍,正如我們在手機演變成多媒體設(shè)備...
2018-02-02 標(biāo)簽:仿真vhdl系統(tǒng)設(shè)計 1527 0
采用Spartan2系列FPGA器件實現(xiàn)全數(shù)字鎖相環(huán)路的設(shè)計和仿真驗證
數(shù)字鎖相環(huán)路已在數(shù)字通信、無線電電子學(xué)及電力系統(tǒng)自動化等領(lǐng)域中得到了極為廣泛的應(yīng)用。傳統(tǒng)的全數(shù)字鎖相環(huán)路(DPLL)是由中、小規(guī)模TTL集成電路構(gòu)成。這...
幾年前設(shè)計專用集成電路(ASIC) 還是少數(shù)集成電路設(shè)計工程師的事, 隨著硅的集成度不斷提高,百萬門的ASIC 已不難實現(xiàn), 系統(tǒng)制造公司的設(shè)計人員正越...
設(shè)計FPGA系統(tǒng)的三個基本原則是什么,了解一下
在這種方法中面積的復(fù)制可以換取速度的提高。支持的速度越高,就意味著可以實現(xiàn)更高的產(chǎn)品性能。一些注重產(chǎn)品性能的應(yīng)用領(lǐng)域可以采用并行處理技術(shù),實現(xiàn)面積換速度。
SIGNAL C: STD_LOGIC_VECTOR(3 DOWNTO 0); SIGNAL A: STD_LOGIC_VECTOR(3 DOWNTO...
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