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標(biāo)簽 > xilinx
Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級集成電路、軟件設(shè)計工具以及作為預(yù)定義系統(tǒng)級功能的IP(Intellectual Property)核。
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Xilinx高速收發(fā)器GTX/GTH的2D眼圖測量功能
隨著高速數(shù)據(jù)傳輸?shù)钠占埃琒erdes已經(jīng)成為FPGA上重要的I/O接口。而線速率也不斷的提高。更高的線速率也就帶來了更大的通道衰減影響。通常,Serde...
隨著需求的多樣化,F(xiàn)PGA的功能也進一步的增強。其中,高速收發(fā)器從本來是只有高端FPGA才有的模塊,已經(jīng)變?yōu)橄鄬ζ占暗纳踔帘貍涞墓δ苣K。而10G的線速...
Xilinx 7系列FPGA內(nèi)置ADC XADC獲取模擬信號
XADC內(nèi)部可以直接獲取芯片結(jié)溫和FPGA的若干供電電壓(7系列不包括VCCO),用于監(jiān)控FPGA內(nèi)部狀況。同時提供了17對差分管腳,其中一對專用的模擬...
在遠程更新的時候,有時候需要雙鏡像來保護設(shè)計的穩(wěn)定性。在進行更新設(shè)計的時候,只更新一個鏡像,另一個鏡像在部署之前就測試過沒問題并不再更新。當(dāng)更新出錯時,...
XADC模擬輸入包括專用模擬輸入VP/VN和16組復(fù)用模擬信號輸入VAUX(15:0);XADC轉(zhuǎn)換結(jié)果可以通過動態(tài)重配接口(DRP)或者JTAG接口輸...
當(dāng)FPGA復(fù)位扇出較多時 有以下辦法可以解決
xilinx推薦盡量不復(fù)位,利用上電初始化,如果使用過程中需要復(fù)位,采用同步高復(fù)位。
利用FPGA設(shè)計工具減少設(shè)計周期時間和降低風(fēng)險
推出的FPGA設(shè)計工具集搭配Zynq UltraScale+ RFSoC會提供所有生產(chǎn)用的IP以及一些通用功能的IP庫,用戶在搭建自己設(shè)計時可以用到。這...
基于Xilinx Zynq SoC的“小傻瓜(Snickerdoodle)”開發(fā)套件
今天向大家推薦一款基于Xilinx Zynq SoC的低價開發(fā)板,這款開發(fā)板命名為“小傻瓜(Snickerdoodle)”,是位于美國舊金山的設(shè)計工作室...
一種基于Xilinx FPGA的部分動態(tài)可重構(gòu)技術(shù)的信號解調(diào)系統(tǒng)詳解
隨著現(xiàn)代通信技術(shù)的迅速發(fā)展,信號的調(diào)制方式向多樣化發(fā)展,解淵技術(shù)也隨之不斷向前發(fā)展。為了對高速大帶寬的信號進行實時解調(diào),現(xiàn)在很多的解調(diào)關(guān)鍵算法都是在高速...
如果輸入信號需要反相,則要盡可能的調(diào)用輸入帶反相功能的符號,而不是使用分離的反相器來進行反相
Xilinx每一個FPGA都有一個獨特的ID,也就是Device DNA,這個ID相當(dāng)于我們的身份證,在FPGA芯片生產(chǎn)的時候就已經(jīng)寫死在芯片的eFus...
在Vivado Design Suite中,Vivado綜合能夠合成多種類型的屬性。在大多數(shù)情況下,這些屬性具有相同的語法和相同的行為。
Xilinx A7芯片內(nèi)部獨立于邏輯單元的專用存儲器
本篇主要總結(jié)的是塊狀Memory(Block Memory),實際上就是FPGA內(nèi)部獨立于邏輯單元的專用存儲器,更像是一種硬核。
詳解Xilinx公司Zynq? UltraScale+?MPSoC產(chǎn)品
Avnet公司的Ultra96 開發(fā)板是基于ARM的Xilinx ZynqUltraScale+? MPSoC系列產(chǎn)品的滿足Linaro 96板指標(biāo)的開...
Xilinx的社區(qū)教育生態(tài)系統(tǒng)
Xilinx的社區(qū)參與企業(yè)戰(zhàn)略圍繞著教育,與非營利組織合作,為Xilinx員工關(guān)聯(lián)和活躍的學(xué)校提供??支持。
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