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臺積電:規(guī)劃1萬億晶體管芯片封裝策略

微云疏影 ? 來源:綜合整理 ? 作者:綜合整理 ? 2023-12-28 15:20 ? 次閱讀
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據(jù)報(bào)道,臺積電在近期舉行的IEDM 2023會議上制定了芯片封裝計(jì)劃,其中包括提供擁有萬億晶體管能力的封裝產(chǎn)品,該計(jì)劃與早前英特爾所披露的規(guī)劃相似。然而,需要注意的是,這個萬億晶體管并非指單個芯片封裝的總量,而是源于多個3D封裝小芯片。盡管如此,臺積電仍在全力以赴提高單片芯片的制造潛能,爭取開發(fā)出含有兩千億晶體管的封裝芯片。

為達(dá)成此目標(biāo),公司正加緊推進(jìn)N2和N2P級別的2nm制造節(jié)點(diǎn)研究,并同步發(fā)展A14和A10級別的1.4nm加工工藝,預(yù)計(jì)到2030年可以實(shí)現(xiàn)。此外,臺積電預(yù)計(jì)封裝技術(shù),如CoWoS、InFO、SoIC等會不斷優(yōu)化升級,使他們有望在2030年前后打造出超萬億晶體管的大規(guī)模封裝解決方案。

值得一提的是,臺積電在本次會議中還透露他們已全面啟動1.4nm級制作流程研發(fā)工作。同樣,該公司再次確認(rèn),按照原定計(jì)劃,2nm級制造流程將從2025年起進(jìn)入大規(guī)模商業(yè)化。

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