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?CDCLVP111-SP 低電壓1:10 LVPECL可選擇性輸入時(shí)鐘驅(qū)動(dòng)器技術(shù)文檔總結(jié)

科技綠洲 ? 2025-09-13 09:52 ? 次閱讀
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CDCLVP111-SP時(shí)鐘驅(qū)動(dòng)器將1對LVPECL輸入差分時(shí)鐘(CLK0、CLK1)分配到10對差分LVPECL時(shí)鐘(Q0、Q9)輸出,時(shí)鐘分配偏斜最小。CDCLVP111-SP可以接受兩個(gè)時(shí)鐘源進(jìn)入輸入多路復(fù)用器。CDCLVP111-SP 專為驅(qū)動(dòng) 50Ω 傳輸線而設(shè)計(jì)。當(dāng)不使用輸出引腳時(shí),建議將引腳保持打開狀態(tài)以降低功耗。如果僅使用差分對的一個(gè)輸出引腳,則另一個(gè)輸出引腳必須相同端接至50Ω。
*附件:cdclvp111-sp.pdf

如果需要單端輸入作,則使用VBB基準(zhǔn)電壓輸出。在這種情況下,VBB 引腳必須連接到 CLK0,并使用 10nF 電容器旁路到 GND。

為了獲得高速性能,強(qiáng)烈建議使用差分模式。

CDCLVP111-SP 的工作溫度為 –55°C 至 125°C。

特性

  • 將一個(gè)差分時(shí)鐘輸入對LVPECL分配到10個(gè)差分LVPECL
  • 與 LVECL 和 LVPECL 完全兼容
  • 支持2.375V至3.8V的寬電源電壓范圍
  • 通過CLK_SEL可選擇時(shí)鐘輸入
  • 用于時(shí)鐘分配應(yīng)用的低輸出偏斜(典型值15ps)
    • 附加抖動(dòng)小于 1ps
    • 傳播延遲小于355ps
    • 打開輸入默認(rèn)狀態(tài)(Open Input Default State)
    • 兼容 LVDS、CML、SSTL 輸入
  • VBB基準(zhǔn)電壓輸出,用于單端時(shí)鐘
  • 頻率范圍從直流到3.5GHz
  • 支持國防、航空航天和醫(yī)療應(yīng)用
    • 受控基線
    • 一個(gè)組裝和測試站點(diǎn)
    • 一個(gè)制造現(xiàn)場
    • 提供軍用(–55°C 至 125°C)溫度范圍^(1)^
    • 延長產(chǎn)品生命周期
    • 擴(kuò)展產(chǎn)品變更通知
    • 產(chǎn)品可追溯性

參數(shù)

image.png

?1. 核心特性?

  • ?輸入/輸出配置?:支持1對差分LVPECL輸入(CLK0/CLK1)分配至10對差分LVPECL輸出(Q0-Q9),支持輸入選擇(CLK_SEL引腳控制)。
  • ?電氣性能?:
    • 工作電壓范圍:2.375V至3.8V(LVPECL模式)或±2.375V至±3.8V(LVECL模式)。
    • 低輸出偏斜:典型值15ps,最大值50ps。
    • 高頻率支持:DC至3.5GHz,傳播延遲<355ps,附加抖動(dòng)<1ps。
  • ?兼容性?:支持LVDS、CML、SSTL輸入,提供VBB參考電壓輸出用于單端時(shí)鐘輸入。

?2. 關(guān)鍵應(yīng)用場景?

  • ?高精度時(shí)鐘分配?:適用于國防、航空航天、醫(yī)療等嚴(yán)苛環(huán)境。
  • ?傳輸線驅(qū)動(dòng)?:專為50Ω傳輸線設(shè)計(jì),推薦未使用的輸出引腳懸空以降低功耗。
  • ?冗余設(shè)計(jì)?:雙輸入選擇(CLK0/CLK1)增強(qiáng)系統(tǒng)可靠性。

?3. 功能模塊與引腳?

  • ?功能框圖?:包含輸入多路復(fù)用器(IN_MUX)、VBB參考電壓生成器及10路LVPECL輸出緩沖器。
  • ?關(guān)鍵引腳?:
    • ?CLK_SEL?(引腳2):選擇輸入時(shí)鐘源(LVTTL/LVCMOS兼容)。
    • ?VBB?(引腳5):單端輸入時(shí)的參考電壓輸出。
    • ? Q[9:0]/Q[9:0] ?:差分輸出對,需匹配50Ω終端電阻

?4. 電氣規(guī)格?

  • ?絕對最大額定值?:電源電壓±4.6V,ESD防護(hù)(HBM±2000V,CDM±1000V)。
  • ?熱性能?:結(jié)至環(huán)境熱阻95.7°C/W(HFG封裝)。
  • ?AC特性?:輸出上升/下降時(shí)間240ps(20%-80%),相位噪聲優(yōu)化設(shè)計(jì)。

?5. 應(yīng)用設(shè)計(jì)指南?

  • ?終端匹配?:
    • ?LVPECL輸出?:推薦50Ω至VCC-2V終端(DC耦合)或AC耦合方案(見圖7-2/7-3)。
    • ?輸入接口?:支持DC耦合(LVCMOS/LVDS)和AC耦合(差分輸入),需靠近驅(qū)動(dòng)端布局。
  • ?電源濾波?:建議使用0.1μF高頻去耦電容及鐵氧體磁珠抑制噪聲(見圖7-12)。

?6. 封裝與訂購信息?

  • ?封裝?:36引腳陶瓷扁平封裝(HFG),尺寸9.08mm×9.08mm。
  • ?型號(hào)選項(xiàng)?:包括工業(yè)級(CDCLVP111-SP)和工程樣品(CDCLVP111HFG/EM)。

?7. 文檔支持?

  • 提供評估模塊(EVM)用戶指南,可通過TI官網(wǎng)訂閱文檔更新通知。

?總結(jié)?:CDCLVP111-SP是一款高性能、低抖動(dòng)的時(shí)鐘分配器,適用于高可靠性和高頻場景,設(shè)計(jì)時(shí)需注意終端匹配、電源去耦及熱管理。

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報(bào)投訴
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