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標(biāo)簽 > 賽靈思
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Xilinx 戰(zhàn)略應(yīng)用高級工程師。專注于 C/C++ 高層次綜合,擁有多年利用 Xilinx FPGA 實現(xiàn)數(shù)字信號處理算法的經(jīng)驗,對 Xilinx F...
基于 Zynq All Programmable SoC 的電機控制器
在本次網(wǎng)絡(luò)研討會中,Mathworks 的工程師會談到 SoC (片上系統(tǒng)) 的 軟硬件聯(lián)合設(shè)計 挑戰(zhàn),并為大家介紹如何采用 基于模型的設(shè)計方法 進行 ...
使用Spartan-6 FPGA視頻平臺加速DTV設(shè)計中視頻算法的開發(fā)
使用Spartan-6 FPGA消費類視頻套件加速DTV設(shè)計中高級視頻算法的開發(fā)。 與消費者部門主管Harry Raftopoulos近距離觀看套件。
UltraFAST設(shè)計方法培訓(xùn)將幫助您時序收斂階段實現(xiàn)“Sign-off” 質(zhì)量XDC約束。另外,還幫助您顯著提高時序收斂實現(xiàn)效率,無論該設(shè)計有多么復(fù)雜。
Xilinx教育生態(tài)系統(tǒng)是公私合作伙伴關(guān)系的一個明確的綜合模型,創(chuàng)建了一條管道,全面支持學(xué)生,同時加強他們在科學(xué),技術(shù),工程,藝術(shù)和數(shù)學(xué)方面的教育
UltraScale+器件設(shè)計的科學(xué)成果分享
加入Xilinx技術(shù)營銷工程師Eric Crabill,他分享了我們商用UltraScale +器件設(shè)計中應(yīng)用的科學(xué)成果,該器件具有出色的可靠性,可用性...
FPGA為復(fù)雜的算法提供計算效率的優(yōu)勢并且功耗低
在本次研討會當(dāng)中,賽靈思將要向您展示一種全新的方法,該方法可以使對硬件設(shè)計不太熟悉的設(shè)計者輕松而方便地釋放 FPGA 硬件加速的優(yōu)勢,比如利用經(jīng)過硬件調(diào)...
Xilinx的2x100G MuxMapSAR參考設(shè)計
了解Xilinx的2x100G MuxMapSAR參考設(shè)計,該設(shè)計在VC730 OTN測試開發(fā)平臺上運行。 (簡明版)
2018-11-29 標(biāo)簽:賽靈思操作系統(tǒng)應(yīng)用程序 2.4k 0
賽靈思收發(fā)器具有無與倫比的信號質(zhì)量和自動適應(yīng)性均衡特性,能確保最高水平的信號完整性和最快的串行鏈路實現(xiàn)方案。
Xilinx高級副總裁Victor Peng討論了業(yè)界首個All Programmable ASIC級架構(gòu)背后的戰(zhàn)略。
關(guān)于CNN的當(dāng)前技術(shù)最新發(fā)展水平以及包括清華大學(xué)等在內(nèi)的研究結(jié)果
繼續(xù)使用定點算法 — 16 位定點解析可最大限度減少與 32 位定浮點計算有關(guān)的精確度退化問題,而且如果逐層使用動態(tài)量化,8 位計算也能產(chǎn)生良好的結(jié)果。
mMIMO有源天線單元結(jié)構(gòu)設(shè)計
AAU中的天線的性能特征包括增益、等效全向輻射功率(EIRP)、旁瓣電平、轉(zhuǎn)向角和仰角傾斜。
賽靈思的產(chǎn)品和方案成為培養(yǎng)創(chuàng)新型設(shè)計人才理想的設(shè)計平臺
賽靈思是 All Programmable 半導(dǎo)體技術(shù)的全球領(lǐng)導(dǎo)者,不僅致力于開發(fā)先進的創(chuàng)新型器件,支持全球數(shù)萬家用戶實現(xiàn)各種各樣的創(chuàng)新讓我們所居住的世...
加入我們,成為ONEXILINX團隊的一員。 我們正在招聘創(chuàng)新者,幫助我們開發(fā)最先進的All Programmable硬件和軟件技術(shù),改變世界生活和工作方式。
了解如何為UltraScale +設(shè)計添加額外的安全級別。 該視頻演示了如何防止差分功耗分析(DPA),以在比特流配置之上增加額外的安全性。
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