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First Input First Output的縮寫，先入先出隊列，這是一種傳統(tǒng)的按序執(zhí)行方法，先進入的指令先完成并引退，跟著才執(zhí)行第二條指令。

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大規(guī)模ASIC或FPGA設計中異步FIFO設計闡述

一、概述在大規(guī)模ASIC或FPGA設計中，多時鐘系統(tǒng)往往是不可避免的，這樣就產生了不同時鐘域數(shù)據(jù)傳輸?shù)膯栴}，其中一個比較好的解決方案就是使用異步FIF...

2021-09-30 標簽：fpga asic fifo 2017 0

采用FPGA協(xié)處理器實現(xiàn)算法加速教程

當今的設計工程師受到面積、功率和成本的約束，不能采用GHz級的計算機實現(xiàn)嵌入式設計。在嵌入式系統(tǒng)中，通常是由相對數(shù)量較少的算法決定最大的運算需求。使用設...

2021-09-28 標簽：fpga cpu 數(shù)據(jù) 4215 0

Verilog HDL-同步技術你了解多少

同步技術在芯片設計中，數(shù)據(jù)同步和在不同時鐘域之間進行數(shù)據(jù)傳輸會經常出現(xiàn)。為避免任何差錯、系統(tǒng)故障和數(shù)據(jù)破壞，正確的同步和數(shù)據(jù)傳輸就顯得格外重要。這些問...

2021-09-18 標簽：usb fifo Verilog 2435 0

你們知道FIFO最小深度計算嗎

FIFO 最小深度計算例子 - 1：f_wr 》 f_rd，連續(xù)讀寫寫時鐘80MHz。讀時鐘50MHz。 Burst_Len = 120，也就是要...

2021-09-10 標簽：數(shù)據(jù)fifo 計算 2199 0

在FPGA設計中FIFO的使用技巧

FIFO是在FPGA設計中使用的非常頻繁，也是影響FPGA設計代碼穩(wěn)定性以及效率等得關鍵因素。在數(shù)據(jù)連續(xù)讀取時，為了能不間斷的讀出數(shù)據(jù)而又不導致FIFO...

2021-09-09 標簽：fpga Xilinx fifo 7223 0

FPGA中的FWFT神秘操作你知道嗎？

QAFirst-Word Fall-Through（FWFT）讀取操作在查看Xilinx KINTEX-7 FPGA存儲器資源時，你會發(fā)現(xiàn)它的FIFO...

2021-06-25 標簽：fpga 存儲器 fifo 4024 0

探究華芯微特MCU引領低成本屏驅解決方案

隨著工業(yè)產品越來越注重用戶體驗，通過TFT LCD屏實現(xiàn)人機交互的應用也越來越多。 SWM32SRE超高的性價比，在中小尺寸TFT LCD屏驅應用中，是...

2021-06-04 標簽：寄存器 PWM 晶振 5150 0

超全面解析FIFO的原理及應用

First Input First Output的縮寫，先入先出隊列，這是一種傳統(tǒng)的按序執(zhí)行方法，先進入的指令先完成并引退，跟著才執(zhí)行第二條指令。是一種...

2021-05-29 標簽：單片機存儲器數(shù)據(jù)傳輸 3.2萬 0

全面介紹ZYNQ-AXI互聯(lián)IP

學習內容近期設計需要用到AXI總線的IP，所以就對應常用的IP進行簡要的說明，本文主要對AXI互聯(lián)IP進行介紹。基礎架構IP 基礎的IP是用于幫助組...

2021-05-11 標簽：控制器數(shù)據(jù)IP 6829 0

FIFO最小深度計算所有情況

由于平時我們工作中，F(xiàn)IFO都是直接調用IP核，對于FIFO深度選擇并沒有很在意，而在筆試面試過程中，經常被問及的問題之一就是如何計算FIFO深度。當...

2021-05-11 標簽：fifo 2296 0

關于Video out IP和Video Timing Controller IP的介紹

本文對Video out IP和Video Timing Controller IP進行簡要介紹，為后文完成使用帶有HDMI接口的顯示器構建圖像視頻顯示...

2021-05-08 標簽：顯示器發(fā)生器 fifo 7276 0

為什么有時候FIF不能正常工作？

同步控制信號對于讀/寫時鐘相互獨立的FIFO（讀/寫時鐘獨立意味著這兩個時鐘是異步的，例如來自于不同的MMCM），要確保相應的控制信號只在與之對應的時...

2021-04-26 標簽：fifo 同步控制 2703 0

探究FPGA與ARM的無人機陀螺儀數(shù)據(jù)接口設計

在無人機系統(tǒng)與地面站通信過程中，機載陀螺儀姿態(tài)數(shù)據(jù)的高速產生與外部相對低速的無線數(shù)據(jù)模塊傳輸?shù)拿苋找?/p>

2021-05-05 標簽：fpga arm fifo 2988 0

關于RTOS任務間通信和全局變量之間的區(qū)別解析

隊列（queue）是一種只能在一端插入元素、在另一端刪除元素的數(shù)據(jù)結構，遵循先入先出（FIFO）的規(guī)則。

2021-04-19 標簽：fifo RTOS 消息隊列 3480 0

淺談一種用于MEMS姿態(tài)檢測的FIFO設計

通過在MEMS信號處理電路中設計一個異步結構的FIFO，可以有效地降低系統(tǒng)對MEMS的頻繁訪問。設計一個具有多種工作模

2021-04-15 標簽：mems RAM fifo 2037 0

FPGA驗證簡介之FPGA開發(fā)分析一個testbench

很多FPGA/IC開發(fā)工具都提供設計例子，方便使用者學習和練習，例如，Xilinx ISE提供了很多設計實例，放在ISE5.X的安裝目錄下的ISEexa...

2021-04-11 標簽：IC fifo CLK 3435 0

詳解同步FIFO和異步FIFO?

1.定義 FIFO是英文First In First Out 的縮寫，是一種先進先出的數(shù)據(jù)緩存器，他與普通存儲器的區(qū)別是沒有外部讀寫地址線，這樣使用起來...

2021-04-09 標簽：fifo 異步FIFO 同步FIFO 5718 0

探究USB接口的VSAT基帶數(shù)據(jù)采集系統(tǒng)的設計

針對衛(wèi)星接收設備數(shù)據(jù)采集的實際需要，提出一種基于USB接口的VSAT（甚小口徑衛(wèi)星終端）基帶數(shù)據(jù)采集系統(tǒng)的設計方

2021-04-08 標簽：芯片 cpld USB接口 2606 0

解析MIPS內核的HDTV-SoC平臺總線接口模塊

介紹了使用MIPS32TM4KcTM處理器作為CPU內核的高清晰度電視（HDTV）SoC平臺，著重提出了該平臺上系統(tǒng)總線接口（HIF）模塊

2021-04-07 標簽：處理器 RAM fifo 2983 0

如何在Altera FPGA中使用FIFO實現(xiàn)功能設計？

一：fifo是什么 FIFO的完整英文拼寫為FirstIn First Out，即先進先出。FPGA或者ASIC中使用到的FIFO一般指的是對數(shù)據(jù)的存儲...

2021-03-12 標簽：fpga fifo 3471 0

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