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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎上進一步發(fā)展的產(chǎn)物。
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Xilinx被AMD收購的事情把我震出來了，看了看上上一篇文章講了下仿真的文件操作，這篇隔了很久遠，不知道該從何講起，就說說FPGA的在線調試的一些簡單...
FLow Control 暫時選擇為None。（有必要后面專門研究，暫時最主要的還是弄懂用戶接口信號的用法?。?/p>
增量實現(xiàn)由兩個流程構成：原始流程和增量流程，如圖所示。其中，原始流程提供網(wǎng)表。
開放式無線接入網(wǎng)（Open Radio Access Network，簡稱 O-RAN）是一種無線接入網(wǎng) (RAN)。
速度-面積互換原則是貫穿FPGA設計的重要原則：速度是指工程穩(wěn)定運行所能達到的最高時鐘頻率，通常決定了FPGA內部寄存器的運行時序；面積是指工程運行所消...
隨著大數(shù)據(jù)的興起以及信息技術的快速發(fā)展，數(shù)據(jù)傳輸對總線帶寬的要求越來越高，并行傳輸技術的發(fā)展受到了時序同步困難、信號偏移嚴重，抗干擾能力弱以及設計復雜度...
異步復位異步釋放會有什么問題？FPGA異步復位為什么要同步釋放呢？
一般來說，復位信號有效后會保持比較長一段時間，確保 register 被復位完成。但是復位信號釋放時，因為其和時鐘是異步的關系，我們不知道它會在什么時刻被釋放。
在數(shù)字電路中，跨時鐘域處理是個很龐大的問題，因此將會作為一個專題來陸續(xù)分享。今天先來從處理單bit跨時鐘域信號同步問題來入手。
LWIP 是使用裸機設計以太網(wǎng)的良好起點，在此基礎上我們可以輕松調整軟件應用程序以提供更詳細的應用程序。LWIP Echo 服務器的使用首先使我們能夠確...
有一個有趣的現(xiàn)象，眾多數(shù)字設計特別是與FPGA設計相關的教科書都特別強調整個設計最好采用唯一的時鐘域。
隨著尖端工藝的代工成本和現(xiàn)代片上系統(tǒng)（system-on-a-chip，SoC）平臺設計復雜性的不斷提高，曾經(jīng)局限于一個國家甚至一家公司的IC供應鏈已經(jīng)...
ASIC和FPGA到底選哪個好？兩者的流程有什么區(qū)別？
ASIC (Application Specific Integrated Circuit)，即專用集成電路，是指應特定用戶要求和特定電子系統(tǒng)的需要而設...
每次我們更改硬件時，我們都需要告訴 HLS 將其導出為硬件描述語言并生成 Vivado 需要的所有各種源數(shù)據(jù)。
軟件仿真(Simulation)，F(xiàn)PGA原型驗證(FPGA Based Prototyping)和硬件仿真加速(Emulation)這三種有效的功能驗...
當前業(yè)內領先的FPGA公司里工作的應用工程師每天都會面對很多設計問題，而且他們已經(jīng)提出了一些將令你的設計工作變得更輕松的設計指導原則和解決方案。掌握FP...
當你需要使用千兆網(wǎng)發(fā)送數(shù)據(jù)的時候，你需要先傳輸8字節(jié)的前導碼，也就是7個字節(jié)的0xAA和1個字節(jié)的0xAB
如何使用FPGA來設計智能網(wǎng)卡（SmartNIC）？
智能服務器適配器或智能網(wǎng)卡（SmartNIC）通過從服務器的CPU上卸載網(wǎng)絡處理工作負載和任務，提高云端和私有數(shù)據(jù)中心中的服務器性能。
AXI4：高性能內存映射需求（如讀寫DDR、使用BRAM控制器讀寫B(tài)RAM等），為了區(qū)別，有時候也叫這個為 AXI4-Full；
什么是同步有限狀態(tài)機？為什么要用狀態(tài)機？怎么表示狀態(tài)機？
同步：所有的狀態(tài)跳轉都是在時鐘的作用下進行
2023-07-17 標簽：FPGA設計有限狀態(tài)機狀態(tài)機 2.3k 0
模塊化設計是FPGA設計中一個很重要的技巧，它能夠使一個大型設計的分工協(xié)作、仿真測試更加容易，代碼維護或升級也更加便利。
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