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fpga設(shè)計(jì)

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。

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fpga設(shè)計(jì)技術(shù)

使用OSERDES發(fā)送高速串行數(shù)據(jù)

OSERDES實(shí)現(xiàn)并串轉(zhuǎn)換，只需要管發(fā)送并不需要管接收到的數(shù)據(jù)如何，所以它的操作相對(duì)于ISERDES來(lái)說(shuō)簡(jiǎn)單；

2023-06-16 標(biāo)簽：FPGA設(shè)計(jì)DDR SDR 1602 0

你真的會(huì)Xilinx FPGA的復(fù)位嗎？

對(duì)于復(fù)位信號(hào)的處理，為了方便我們習(xí)慣上采用全局復(fù)位，博主在很長(zhǎng)一段時(shí)間內(nèi)都是將復(fù)位信號(hào)作為一個(gè)I/O口，通過(guò)撥碼開關(guān)硬件復(fù)位。

2023-06-21 標(biāo)簽：FPGA設(shè)計(jì)觸發(fā)器狀態(tài)機(jī) 1598 0

通過(guò)小腳丫FPGA核心開發(fā)板來(lái)進(jìn)行門電路的設(shè)計(jì)

在數(shù)字電路中，門電路是最基本的構(gòu)成單位，可以說(shuō)，任何復(fù)雜的數(shù)字電路系統(tǒng)都可以通過(guò)我們耳熟能詳?shù)呐c門，非門，或門，與非門，異或門等等組合實(shí)現(xiàn)。

2023-06-20 標(biāo)簽：FPGA設(shè)計(jì)led燈 MOS管 1588 0

深入探討在FPGA設(shè)計(jì)中要避免的10大錯(cuò)誤

本文列出了FPGA設(shè)計(jì)中常見(jiàn)的十個(gè)錯(cuò)誤。我們收集了 FPGA 工程師在其設(shè)計(jì)中犯的 10 個(gè)最常見(jiàn)錯(cuò)誤，并提供了解決方案的建議和替代方案。

2023-06-01 標(biāo)簽：FPGA設(shè)計(jì)DSP技術(shù)時(shí)鐘緩沖器 1578 0

基于FPGA創(chuàng)建一個(gè)簡(jiǎn)單的電機(jī)控制程序

FPGA 非常適合精密電機(jī)控制，在這個(gè)項(xiàng)目中，我們將創(chuàng)建一個(gè)簡(jiǎn)單的電機(jī)控制程序，在此基礎(chǔ)上可以構(gòu)建更復(fù)雜的應(yīng)用。

2023-08-11 標(biāo)簽：微控制器 fpga FPGA設(shè)計(jì) 1578 0

乘法器的Verilog HDL實(shí)現(xiàn)方案

兩個(gè)N位二進(jìn)制數(shù)x、y的乘積用簡(jiǎn)單的方法計(jì)算就是利用移位操作來(lái)實(shí)現(xiàn)。

2023-06-21 標(biāo)簽：FPGA設(shè)計(jì)HDL 乘法器 1566 0

FPGA設(shè)計(jì)中動(dòng)態(tài)時(shí)鐘的使用方法

時(shí)鐘是每個(gè) FPGA 設(shè)計(jì)的核心。如果我們正確地設(shè)計(jì)時(shí)鐘架構(gòu)、沒(méi)有 CDC 問(wèn)題并正確進(jìn)行約束設(shè)計(jì)，就可以減少與工具斗爭(zhēng)的時(shí)間。

2023-07-12 標(biāo)簽：FPGA設(shè)計(jì)寄存器 CDC 1508 0

在大算力芯片領(lǐng)域“彎道超車”的機(jī)會(huì)

關(guān)于“彎道超車”，行業(yè)內(nèi)很多人士對(duì)此嗤之以鼻，他們認(rèn)為：做事情要腳踏實(shí)地，持之以恒，才有可能超越。

2023-08-02 標(biāo)簽：處理器電動(dòng)車 FPGA設(shè)計(jì) 1508 0

如何正確使用in_system_ibert呢？

對(duì)應(yīng)的IP端口處也會(huì)出現(xiàn)相應(yīng)的端口，例如上圖選擇了2個(gè)Quad，也就是8個(gè)通道的串行收發(fā)器，那么對(duì)應(yīng)的drp接口就有8個(gè)。

2023-06-21 標(biāo)簽：收發(fā)器 FPGA設(shè)計(jì)串行收發(fā)器 1500 0

賽靈思FPGA設(shè)計(jì)技巧與應(yīng)用創(chuàng)新（二）

前面的博文中已經(jīng)提到了基于Sigma-Delta ADC采樣的數(shù)據(jù)采集系統(tǒng)，并詳細(xì)說(shuō)了Sinc3抽樣濾波器的設(shè)計(jì)方法，在有詳細(xì)介紹。后來(lái)將前面的ADC也...

2017-02-11 標(biāo)簽：FPGA FPGA設(shè)計(jì)賽靈思 1499 0

如何設(shè)計(jì)一個(gè)參數(shù)化的數(shù)據(jù)選擇器

在FPGA設(shè)計(jì)中，大部分情況下我們都得使用到數(shù)據(jù)選擇器。并且為了設(shè)計(jì)參數(shù)化，可調(diào)，通常情況下我們需要一個(gè)參數(shù)可調(diào)的數(shù)據(jù)選擇器，比如M選1，M是可調(diào)的參數(shù)。

2023-11-20 標(biāo)簽：FPGA設(shè)計(jì)Verilog 數(shù)據(jù)選擇器 1494 0

Vivado Schematic中的實(shí)線和虛線有什么區(qū)別？

2023-06-16 標(biāo)簽：FPGA設(shè)計(jì)Vivado 1488 0

VVAS調(diào)用HLS生成硬件加速器的主要流程介紹

我們以smartcam的預(yù)處理作為例子。xf_pp_pipeline的作用是將輸入圖像的格式從NV12轉(zhuǎn)換為BGR，再進(jìn)行減均值和歸一化操作。

2023-06-26 標(biāo)簽：FPGA設(shè)計(jì)計(jì)算機(jī)視覺(jué)opencv 1475 0

FPGA設(shè)計(jì)中二分法查表算法的實(shí)現(xiàn)

二分化查找算法是在軟件中廣泛應(yīng)用的一種算法，那么在FPGA的設(shè)計(jì)中是否可以用這種算法呢？什么場(chǎng)景下會(huì)可能用到這種算法呢？

2023-09-06 標(biāo)簽：fpga FPGA設(shè)計(jì)算法 1457 0

PCIe例程理解之用戶邏輯接收模塊仿真分析

下圖給出了反相器相位插指器的基本結(jié)構(gòu)。結(jié)構(gòu)很簡(jiǎn)單，兩個(gè)反相器陣列輸入分別接兩個(gè)時(shí)鐘，輸出直接短接在一起，數(shù)字信號(hào)控制反相器陣列選通的數(shù)目。

2023-06-21 標(biāo)簽：FPGA設(shè)計(jì)寄存器存儲(chǔ)器 1450 0

FPGA設(shè)計(jì)中經(jīng)常犯的10個(gè)錯(cuò)誤

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2023-05-31 標(biāo)簽：fpga FPGA設(shè)計(jì)RTL 1399 1

FPGA設(shè)計(jì)全流程：ModelsimSynplify.ProISE

介紹如何編譯HDL必須的Xilinx庫(kù)和結(jié)構(gòu)仿真。創(chuàng)建將被編譯庫(kù)的目錄在編譯庫(kù)之前，最好先建立一個(gè)目錄（事實(shí)上必須建立一個(gè)目錄），步驟如下

2017-02-11 標(biāo)簽：FPGA FPGA設(shè)計(jì)Xilinx 1392 0

FPGA設(shè)計(jì)存在的4類時(shí)序路徑

命令set_multicycle_path常用來(lái)約束放松路徑的約束。通常情況下，這種路徑具有一個(gè)典型的特征：數(shù)據(jù)多個(gè)周期翻轉(zhuǎn)一次，如下圖所示。因此，我們...

2023-09-14 標(biāo)簽：fpga FPGA設(shè)計(jì)命令 1383 0

AMBA4—無(wú)聊的Narrow transfers介紹

AMBA總線無(wú)論FPGA還是ASIC，應(yīng)該都是比較常用的一組總線協(xié)議。

2023-06-11 標(biāo)簽：FPGA設(shè)計(jì)AMBA總線 ASIC芯片 1369 0

如何又快又好的梳理和利用驗(yàn)證feature文檔

我們不再繼續(xù)細(xì)化贅述，相信大家從舉例中已經(jīng)有點(diǎn)感覺(jué)了，什么叫“粗”，什么叫“細(xì)”，這里說(shuō)到的粗細(xì)，其實(shí)就是指的是驗(yàn)證feature的顆粒度。

2022-10-09 標(biāo)簽：FPGA設(shè)計(jì)EDA工具中斷 1334 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

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ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
AD10

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識(shí)別

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FPGA開發(fā)板

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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車電子產(chǎn)品的開發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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candence

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面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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