chinese直男口爆体育生外卖, 99久久er热在这里只有精品99, 又色又爽又黄18禁美女裸身无遮挡, gogogo高清免费观看日本电视,私密按摩师高清版在线,人妻视频毛茸茸,91论坛 兴趣闲谈,欧美 亚洲 精品 8区,国产精品久久久久精品免费

搜索歷史

清空
搜索熱詞
      0
      • 聊天消息
      • 系統(tǒng)消息
      • 評論與回復(fù)
      VIP于 到期 續(xù)費
      登錄后你可以
      • 下載海量資料
      • 學習在線課程
      • 觀看技術(shù)視頻
      • 寫文章/發(fā)帖/加入社區(qū)
      會員中心
      創(chuàng)作中心
      發(fā)布
      創(chuàng)作活動

      完善資料讓更多小伙伴認識你，還能領(lǐng)取20積分哦，立即完善>

      3天內(nèi)不再提示

      FPGA之家

      文章：882 被閱讀：440w 粉絲數(shù)：211 關(guān)注數(shù)：0 點贊數(shù)：74

      廣告

      FDCE/FDPE/FDRE/FDSE觸發(fā)器簡介

      每個 Slice 有 8 個 FF 。四個可以配置為 D 型觸發(fā)器或電平敏感鎖存器，另外四個只能配置....
      的頭像 FPGA之家 發(fā)表于 03-15 11:59 ?14615次閱讀

      Verilog賦值和結(jié)構(gòu)說明語句

      從仿真結(jié)果可以看出：在順序塊中，15ns的時候，l1被賦值為8’h2，在25ns的時候，l2被賦值為....
      的頭像 FPGA之家 發(fā)表于 03-15 11:51 ?2364次閱讀

      Verilog邏輯設(shè)計中的循環(huán)語句和運算符

      “ 本文主要分享了在Verilog設(shè)計過程中一些經(jīng)驗與知識點，主要包括循環(huán)語句(forever、re....
      的頭像 FPGA之家 發(fā)表于 03-15 11:41 ?5802次閱讀

      gpio和pinctrl子系統(tǒng)的關(guān)系與區(qū)別

      gpio 和 pinctrl 子系統(tǒng)在內(nèi)核里的使用率非常高，和嵌入式產(chǎn)品的關(guān)聯(lián)非常大。從這兩個子系統(tǒng)....
      的頭像 FPGA之家 發(fā)表于 03-15 11:40 ?5955次閱讀

      Verilog HDL中常用預(yù)編譯命令介紹

      `timescale命令用于在文件中指明時間單位和時間精度，通常在對文件進行仿真時體現(xiàn)。EDA工具可....
      的頭像 FPGA之家 發(fā)表于 03-15 11:24 ?3491次閱讀

      函數(shù)模板與類模板的基本概念及實現(xiàn)原理

      [導讀] 最近使用C++做些編程，把日常遇到的些比較重要的概念總結(jié)分享一下。本文來分享一下模板類的原....
      的頭像 FPGA之家 發(fā)表于 03-15 11:21 ?2152次閱讀

      如何通過采用modelsim仿真波形圖實現(xiàn)字符點陣顯示

      將字符點陣文件中的提示信息，備注，標點符號等全部刪除，只留下點陣的編碼。并將相鄰奇偶兩行的數(shù)據(jù)調(diào)整到....
      的頭像 FPGA之家 發(fā)表于 03-15 11:17 ?2129次閱讀

      詳解時序約束的基本方法

      在系統(tǒng)同步接口中，同一個系統(tǒng)時鐘既傳輸數(shù)據(jù)也獲取數(shù)據(jù)?？紤]到板子路徑延時和時鐘抖動，接口的操作頻率不....
      的頭像 FPGA之家 發(fā)表于 03-15 10:50 ?5232次閱讀

      Verilog進行組合邏輯設(shè)計時的注意事項

      由于賦值語句有阻塞賦值和非阻塞賦值兩類，建議讀者使用阻塞賦值語句“=”，原因?qū)⒃凇白枞x值和非阻塞賦....
      的頭像 FPGA之家 發(fā)表于 03-15 10:40 ?2653次閱讀

      I2C通信理解與三種IIC數(shù)據(jù)幀傳遞過程

      很多朋友在進行IIC通信協(xié)議開發(fā)的時候比較迷茫，可能長時間沒有用了，就有所忘卻，也算正常，不過如果重....
      的頭像 FPGA之家 發(fā)表于 03-15 10:29 ?6181次閱讀

      摩爾型狀態(tài)機與米利型狀態(tài)機的區(qū)別是什么

      FSM有限狀態(tài)機，序列產(chǎn)生，序列檢測，是FPGA和數(shù)字IC相關(guān)崗位必須要掌握的知識點，在筆試和面試中....
      的頭像 FPGA之家 發(fā)表于 03-14 17:42 ?19764次閱讀

      如何解決STM32芯片F(xiàn)lash寫保護的問題

      本文介紹了如何解決STM32芯片F(xiàn)lash寫保護導致無法下載程序，無法在線調(diào)試的問題;如果您遇到相同....
      的頭像 FPGA之家 發(fā)表于 03-14 17:24 ?12599次閱讀

      高速串行收發(fā)器的重要概念和注意事項

      此篇文章深入淺出介紹了關(guān)于高速串行收發(fā)器的幾個重要概念和注意事項，為方便知識點復(fù)習總結(jié)和后續(xù)查閱特此....
      的頭像 FPGA之家 發(fā)表于 03-14 17:19 ?3747次閱讀

      FPGA與MCU的程序思路

      FPGA以9600的波特率向單片機發(fā)送32位數(shù)據(jù)，然后單片機對數(shù)據(jù)進行解析，顯示在顯示屏上面
      的頭像 FPGA之家 發(fā)表于 03-14 14:07 ?6745次閱讀

      Xilinx FPGA的上電模式類型分類

      典型的主模式都是加載片外非易失（ 斷電不丟數(shù)據(jù)） 性存儲器中的配置比特流，配置所需的時鐘信號（ 稱為....
      的頭像 FPGA之家 發(fā)表于 03-14 14:02 ?2172次閱讀

      VIVADO時序約束及STA基礎(chǔ)

      時序約束的目的就是告訴工具當前的時序狀態(tài)，以讓工具盡量優(yōu)化時序并給出詳細的分析報告。一般在行為仿真后....
      的頭像 FPGA之家 發(fā)表于 03-11 14:39 ?10762次閱讀

      異步FIFO設(shè)計原理及應(yīng)用需要分析

      在大規(guī)模ASIC或FPGA設(shè)計中，多時鐘系統(tǒng)往往是不可避免的，這樣就產(chǎn)生了不同時鐘域數(shù)據(jù)傳輸?shù)膯栴}，....
      的頭像 FPGA之家 發(fā)表于 03-09 16:29 ?3310次閱讀

      淺析嵌入式編程上下文切換及完美解耦的一種方法

      ? 上下文快速切換 - cpost應(yīng)用 我們通常認為，在中斷中，不能執(zhí)行耗時的操作，否則會影響系統(tǒng)的....
      的頭像 FPGA之家 發(fā)表于 11-05 14:43 ?1900次閱讀

      System Verilog與verilog的概念有何不同

      SystemVerilog是一種 硬件描述和驗證語言 （HDVL），它 基于IEEE1364-200....
      的頭像 FPGA之家 發(fā)表于 10-19 10:58 ?5007次閱讀

      SystemVerilog語言介紹匯總

      作者:limanjihe ?https://blog.csdn.net/limanjihe/arti....
      的頭像 FPGA之家 發(fā)表于 10-11 10:35 ?2856次閱讀

      FPGA的約束、時序分析的概念詳解

      A 時序約束的概念和基本策略 時序約束主要包括周期約束（FFS到FFS，即觸發(fā)器到觸發(fā)器）和偏移約束....
      的頭像 FPGA之家 發(fā)表于 10-11 10:23 ?6316次閱讀
      FPGA的約束、時序分析的概念詳解

      大規(guī)模ASIC或FPGA設(shè)計中異步FIFO設(shè)計闡述

      一、概述 在大規(guī)模ASIC或FPGA設(shè)計中，多時鐘系統(tǒng)往往是不可避免的，這樣就產(chǎn)生了不同時鐘域數(shù)據(jù)傳....
      的頭像 FPGA之家 發(fā)表于 09-30 09:57 ?2260次閱讀
      大規(guī)模ASIC或FPGA設(shè)計中異步FIFO設(shè)計闡述

      什么是門控時鐘 門控時鐘降低功耗的原理

      門控時鐘的設(shè)計初衷是實現(xiàn)FPGA的低功耗設(shè)計，本文從什么是門控時鐘、門控時鐘實現(xiàn)低功耗的原理、推薦的....
      的頭像 FPGA之家 發(fā)表于 09-23 16:44 ?15188次閱讀
      什么是門控時鐘 門控時鐘降低功耗的原理

      FPGA中多時鐘域和異步信號處理的問題

      有一個有趣的現(xiàn)象，眾多數(shù)字設(shè)計特別是與FPGA設(shè)計相關(guān)的教科書都特別強調(diào)整個設(shè)計最好采用唯一的時鐘域....
      的頭像 FPGA之家 發(fā)表于 09-23 16:39 ?3464次閱讀

      對DDR3/4控制器進行探討

      參考資料 《pg150-ultrascale-memory-ip》 以該手冊的脈絡(luò)為主線，對DDR3....
      的頭像 FPGA之家 發(fā)表于 09-22 10:28 ?3342次閱讀
      對DDR3/4控制器進行探討

      Zynq UltraScale + MPSoC的DDR接口

      本篇主要針對Zynq UltraScale + MPSoC的DDR接口，從硬件設(shè)計的角度進行詳細介紹....
      的頭像 FPGA之家 發(fā)表于 09-16 10:17 ?7461次閱讀
      Zynq UltraScale + MPSoC的DDR接口

      嵌入式開發(fā)中實用的宏打印函數(shù)

      宏打印函數(shù)在我們的嵌入式開發(fā)中，使用printf打印一些信息是一種常用的調(diào)試手段。但是，在打印的信息....
      的頭像 FPGA之家 發(fā)表于 09-16 10:05 ?2088次閱讀
      嵌入式開發(fā)中實用的宏打印函數(shù)

      先進微控制總線結(jié)構(gòu)介紹

      1.1.AMBA發(fā)展史 AMAB1.0 AMBA2.0 AMBA3.0 AMBA4.0 AMBA1.....
      的頭像 FPGA之家 發(fā)表于 09-06 09:57 ?4233次閱讀

      介紹AMBA2.0總線

      1.1.AMBA發(fā)展史 AMAB1.0 AMBA2.0 AMBA3.0 AMBA4.0 AMBA1.....
      的頭像 FPGA之家 發(fā)表于 09-06 09:53 ?3678次閱讀
      介紹AMBA2.0總線

      常見的ADC類型及原理

      ［導讀］本文來梳理ADC兩個方面的內(nèi)容，常見的ADC類型及原理，以及可能容易掉進去的坑。 談?wù)勎覟槭?...
      的頭像 FPGA之家 發(fā)表于 09-06 09:52 ?9997次閱讀
      常見的ADC類型及原理