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FPGA之家

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基于FPGA的直方圖線性拉伸的解決方案與對(duì)比分析

但是實(shí)際應(yīng)用中并不會(huì)直接采用上述的A和B,這是由于圖像中可能存在噪聲的原因。想象如果圖像中存在幾個(gè)純....
的頭像 FPGA之家 發(fā)表于 07-02 10:38 ?2671次閱讀
基于FPGA的直方圖線性拉伸的解決方案與對(duì)比分析

剖析FPGA灰度直方圖線性拉伸

純工程師社群 直方圖線性拉伸相對(duì)于直方圖均衡化來(lái)說(shuō)就更好理解一些了,即用線性變化將灰度直方圖較窄的部....
的頭像 FPGA之家 發(fā)表于 07-02 10:37 ?3710次閱讀
剖析FPGA灰度直方圖線性拉伸

SoC設(shè)計(jì)AHB高級(jí)高性能總線的詳細(xì)介紹

AHB(高級(jí)高性能總線):用于高性能高時(shí)鐘頻率的系統(tǒng)模塊,AHB 擔(dān)當(dāng)高性能系統(tǒng)的中樞總線。AHB ....
的頭像 FPGA之家 發(fā)表于 07-02 10:35 ?4045次閱讀
SoC設(shè)計(jì)AHB高級(jí)高性能總線的詳細(xì)介紹

如何基于DDS IP實(shí)現(xiàn)線性調(diào)頻信號(hào)

利用DDS IP實(shí)現(xiàn)線性調(diào)頻信號(hào) 1 DDS技術(shù)簡(jiǎn)介隨著電子技術(shù)的不斷發(fā)展,傳統(tǒng)的頻率合成技術(shù)逐漸不....
的頭像 FPGA之家 發(fā)表于 07-02 10:27 ?5055次閱讀
如何基于DDS IP實(shí)現(xiàn)線性調(diào)頻信號(hào)

基于FPGA的DDS IP實(shí)現(xiàn)線性調(diào)頻信號(hào)的設(shè)計(jì)方案

利用DDS IP實(shí)現(xiàn)線性調(diào)頻信號(hào)1 DDS技術(shù)簡(jiǎn)介隨著電子技術(shù)的不斷發(fā)展,傳統(tǒng)的頻率合成技術(shù)逐漸不能....
的頭像 FPGA之家 發(fā)表于 07-02 10:27 ?8493次閱讀
基于FPGA的DDS IP實(shí)現(xiàn)線性調(diào)頻信號(hào)的設(shè)計(jì)方案

Verilog HDL語(yǔ)言中任務(wù)與函數(shù)的比較

其中,返回值的類型和位寬是可選項(xiàng),如果缺省會(huì)返回一位寄存器類型數(shù)據(jù)。Verilog HDL認(rèn)為函數(shù)的....
的頭像 FPGA之家 發(fā)表于 07-02 10:24 ?2784次閱讀

什么是零點(diǎn)和極點(diǎn)?時(shí)域上系統(tǒng)穩(wěn)定性和S域的穩(wěn)定性有什么關(guān)系?

PID是十分優(yōu)美的控制算法,在工業(yè)控制應(yīng)用地十分廣泛,有的時(shí)候,無(wú)需知道系統(tǒng)模型的情況下,只要經(jīng)驗(yàn)法....
的頭像 FPGA之家 發(fā)表于 07-01 09:14 ?13752次閱讀
什么是零點(diǎn)和極點(diǎn)?時(shí)域上系統(tǒng)穩(wěn)定性和S域的穩(wěn)定性有什么關(guān)系?

Verilog HDL語(yǔ)言的數(shù)據(jù)類型和運(yùn)算符與表達(dá)式解析

標(biāo)識(shí)符可以是一組字母、數(shù)字、下劃線和$符號(hào)的組合,且標(biāo)識(shí)符的第一個(gè)字符必須是字母或者下劃線。另外,標(biāo)....
的頭像 FPGA之家 發(fā)表于 06-30 11:18 ?7198次閱讀
Verilog HDL語(yǔ)言的數(shù)據(jù)類型和運(yùn)算符與表達(dá)式解析

如何利用Vivado集成開(kāi)發(fā)環(huán)境進(jìn)行FPGA的應(yīng)用開(kāi)發(fā)

隨著5G、AI、航天等領(lǐng)域迅猛發(fā)展,高速信號(hào)處理需求日益突出,硬件加速勢(shì)在必行。異構(gòu)多核架構(gòu)近年來(lái)得....
的頭像 FPGA之家 發(fā)表于 06-30 11:11 ?3336次閱讀
如何利用Vivado集成開(kāi)發(fā)環(huán)境進(jìn)行FPGA的應(yīng)用開(kāi)發(fā)

利用3D Layout解決PCB設(shè)計(jì)流程集成到機(jī)電設(shè)計(jì)的難題

Xpedition/PADS Professional Layout 為 PCB 設(shè)計(jì)人員提供了通過(guò)....
的頭像 FPGA之家 發(fā)表于 06-30 11:05 ?4532次閱讀
利用3D Layout解決PCB設(shè)計(jì)流程集成到機(jī)電設(shè)計(jì)的難題

你們知道always,assign和always@(*)之間的區(qū)別嗎

1.always@后面內(nèi)容是敏感變量,always@(*)里面的敏感變量為*,意思是說(shuō)敏感變量由綜合....
的頭像 FPGA之家 發(fā)表于 06-27 11:47 ?16163次閱讀

XILINX FPGA的硬件設(shè)計(jì)總結(jié)之PCIE硬件設(shè)計(jì)避坑指南

隨著FPGA的不斷發(fā)展,F(xiàn)PGA本身自帶的PCIE硬核的數(shù)量越來(lái)越多,本文以ZU11EG為例介紹,如....
的頭像 FPGA之家 發(fā)表于 06-27 11:20 ?7366次閱讀
XILINX FPGA的硬件設(shè)計(jì)總結(jié)之PCIE硬件設(shè)計(jì)避坑指南

簡(jiǎn)述FPGA的圖像高斯濾波

在知乎上看到一個(gè)比較有意思的話題,卷積為什么叫”卷“積?哈哈哈哈哈 其中有個(gè)動(dòng)圖用卷毛巾生動(dòng)形象的比....
的頭像 FPGA之家 發(fā)表于 06-27 11:08 ?2474次閱讀
簡(jiǎn)述FPGA的圖像高斯濾波

常用的Linux常用操作命令及其技巧必看

IC設(shè)計(jì)是在linux環(huán)境下,很多操作需要在Terminal中進(jìn)行,因此想要學(xué)習(xí)IC設(shè)計(jì),就必須先需....
的頭像 FPGA之家 發(fā)表于 06-26 10:39 ?2395次閱讀
常用的Linux常用操作命令及其技巧必看

怎樣利用modelsim仿真波形圖案來(lái)顯示字符?

這個(gè)小工程利用modelsim仿真波形圖案來(lái)顯示字符。
的頭像 FPGA之家 發(fā)表于 06-26 10:26 ?3623次閱讀
怎樣利用modelsim仿真波形圖案來(lái)顯示字符?

如何更好地去掌握I2C通信?

雖然每個(gè)器件對(duì)IIC通信的波形要求不是太相同,但I(xiàn)IC的通信時(shí)序容忍度非常高,基本上相關(guān)參數(shù)和驅(qū)動(dòng)都....
的頭像 FPGA之家 發(fā)表于 06-26 10:13 ?1775次閱讀
如何更好地去掌握I2C通信?

深度解讀AMBA、AHB、APB、AXI總線介紹及對(duì)比

什么是AMBA? 現(xiàn)如今,集成電路芯片的規(guī)模越來(lái)越大。數(shù)字IC從基于時(shí)序驅(qū)動(dòng)的設(shè)計(jì)方法,發(fā)展到基于I....
的頭像 FPGA之家 發(fā)表于 06-25 11:22 ?11876次閱讀

Verilog設(shè)計(jì)過(guò)程中狀態(tài)機(jī)的設(shè)計(jì)方法

“本文主要分享了在Verilog設(shè)計(jì)過(guò)程中狀態(tài)機(jī)的一些設(shè)計(jì)方法。 關(guān)于狀態(tài)機(jī) 狀態(tài)機(jī)本質(zhì)是對(duì)具有邏輯....
的頭像 FPGA之家 發(fā)表于 06-25 11:04 ?3168次閱讀

分享可應(yīng)用于單片機(jī)的內(nèi)存管理模塊mem_malloc

本次給大家分享一位大佬寫(xiě)的應(yīng)用于單片機(jī)內(nèi)存管理模塊mem_malloc,這個(gè)mem_malloc的使....
的頭像 FPGA之家 發(fā)表于 06-25 08:54 ?3591次閱讀
分享可應(yīng)用于單片機(jī)的內(nèi)存管理模塊mem_malloc

如何在VScode中自動(dòng)生成Verilog仿真文件

一、實(shí)現(xiàn)功能 1、可以自動(dòng)創(chuàng)建文件夾 2、根據(jù)Verilog文件自動(dòng)生成測(cè)試文件模板(TB文件名字是....
的頭像 FPGA之家 發(fā)表于 06-23 17:48 ?4235次閱讀

Verilog進(jìn)行組合邏輯設(shè)計(jì)時(shí)有哪些注意事項(xiàng)

一、邏輯設(shè)計(jì) (1)組合邏輯設(shè)計(jì) 下面是一些用Verilog進(jìn)行組合邏輯設(shè)計(jì)時(shí)的一些注意事項(xiàng): ①組....
的頭像 FPGA之家 發(fā)表于 06-23 17:45 ?5859次閱讀
Verilog進(jìn)行組合邏輯設(shè)計(jì)時(shí)有哪些注意事項(xiàng)

SPI、UART、IIC總線之間有什么區(qū)別與聯(lián)系

SPI 總線 SPI(Serial Peripheral Interface,串行外設(shè)接口)是一種高....
的頭像 FPGA之家 發(fā)表于 06-21 16:46 ?5505次閱讀

Linux中的軟鏈接、硬鏈接都用在哪些場(chǎng)合?

最近,看到很多文章都在介紹 Linux 中的文件系統(tǒng),其中就包括:inode 節(jié)點(diǎn)、軟鏈接、硬鏈接等....
的頭像 FPGA之家 發(fā)表于 06-21 16:33 ?2034次閱讀

高速信號(hào)處理時(shí)片間信號(hào)傳輸?shù)撵o態(tài)時(shí)許分析

之前做的一個(gè)超寬帶非均勻采樣系統(tǒng)中遇到的一些問(wèn)題,雖然本文所述方法并未實(shí)際用到并解決遇到的問(wèn)題,但也....
的頭像 FPGA之家 發(fā)表于 06-18 16:22 ?1842次閱讀
高速信號(hào)處理時(shí)片間信號(hào)傳輸?shù)撵o態(tài)時(shí)許分析

Zynq-7000系列可編程邏輯PL是什么?

剛學(xué)ZYNQ的時(shí)候,看到里面反復(fù)提到PS和PL,還以為PS是PhotoShop的意思,PL是哪種型號(hào)....
的頭像 FPGA之家 發(fā)表于 06-18 16:09 ?10713次閱讀

芯片技術(shù)中就有了“層”的概念是什么?

前言:集成電路(芯片)是用光刻為特征的制造工藝,一層一層制造而成。所以,芯片技術(shù)中就有了“層”的概念....
的頭像 FPGA之家 發(fā)表于 06-18 16:04 ?10939次閱讀

芯片能屯一堆十年后暴漲再賣掉嗎?

何止?jié)q 5 倍,聽(tīng)說(shuō)有的 MCU 都漲了幾十倍。所以有人建議多囤點(diǎn)芯片,十年后再賣。酒越存越香,股票....
的頭像 FPGA之家 發(fā)表于 06-18 15:31 ?4661次閱讀

時(shí)序問(wèn)題常見(jiàn)的跨時(shí)鐘域亞穩(wěn)態(tài)問(wèn)題

今天寫(xiě)一下時(shí)序問(wèn)題常見(jiàn)的跨時(shí)鐘域的亞穩(wěn)態(tài)問(wèn)題。 先說(shuō)明一下亞穩(wěn)態(tài)問(wèn)題: D觸發(fā)器有個(gè)明顯的特征就是建....
的頭像 FPGA之家 發(fā)表于 06-18 15:28 ?3469次閱讀

Verilog的兩種塊語(yǔ)句解析

1. 塊語(yǔ)句有兩種,一種是 begin-end 語(yǔ)句, 通常用來(lái)標(biāo)志()執(zhí)行的語(yǔ)句;一種是 fork....
的頭像 FPGA之家 發(fā)表于 06-18 15:16 ?3393次閱讀

將FPGA集成進(jìn)SoC的好處顯而易見(jiàn)

FPGA以其強(qiáng)大的靈活性和適應(yīng)性見(jiàn)長(zhǎng)。系統(tǒng)設(shè)計(jì)師在設(shè)計(jì)大容量復(fù)雜應(yīng)用時(shí),越來(lái)越多的考慮使用SoC中集....
的頭像 FPGA之家 發(fā)表于 06-18 15:11 ?3140次閱讀