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      XILINX開發(fā)者社區(qū)

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      AMD Versal自適應SoC內(nèi)置自校準的工作原理

      本文提供有關(guān) AMD Versal 自適應 SoC 內(nèi)置自校準 (BISC) 工作方式的詳細信息。此....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-21 08:18 ?1862次閱讀

      如何利用XPIO構(gòu)建并實現(xiàn)帶有Strobe的高速接口設(shè)計

      在 AMD Versal 自適應 SoC 器件中，SelectIO 是實現(xiàn)高速接口的重要組成部分。它....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-17 09:22 ?902次閱讀
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      AMD Vivado IP integrator的基本功能特性

      我們還將帶您了解在 AMD Zynq UltraScale+ MPSoC 開發(fā)板與 AMD Vers....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-07 13:02 ?1531次閱讀
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      如何使用PetaLinux檢查RFDC IP狀態(tài)

      本篇博客演示了在 ZCU208 評估板和 ZCU216 評估板中通過運行簡單的 RFDC 示例來快速....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-23 16:08 ?432次閱讀
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      如何解決I/O時鐘布局器錯誤

      在 I/O 時鐘布局器階段可能會發(fā)生錯誤，指出該工具無法對該時鐘結(jié)構(gòu)進行布局，直至最后 BUFG 仍....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-23 16:05 ?378次閱讀

      AMD Vivado ChipScope助力硬件調(diào)試

      許多硬件問題只有在整個集成系統(tǒng)實時運行的過程中才會顯現(xiàn)出來。AMD Vivado ChipScope....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-05 17:08 ?738次閱讀

      高扇出信號線優(yōu)化技巧（下）

      該屬性會將每個驅(qū)動程序的扇出限制告知工具，并通過指示布局器了解扇出限制來指引該工具對高扇出的負載進行....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-28 10:47 ?1294次閱讀
      高扇出信號線優(yōu)化技巧（下）

      高扇出信號線優(yōu)化技巧（上）

      高扇出信號線 (HFN) 是具有大量負載的信號線。作為用戶，您可能遇到過高扇出信號線相關(guān)問題，因為將....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-28 10:45 ?1382次閱讀
      高扇出信號線優(yōu)化技巧（上）

      AMD 2025.1版嵌入式軟件和工具的新增功能

      AMD 2025.1 版嵌入式軟件和工具是面向新一代嵌入式系統(tǒng)開發(fā)而打造的綜合平臺，全面加速概念構(gòu)想....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-15 15:32 ?880次閱讀

      如何在AMD Vitis Unified 2024.2中連接到QEMU

      在本篇文章我們將學習如何在 AMD Vitis Unified 2024.2 中連接到 QEMU。 ....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-06 17:24 ?1304次閱讀
      如何在AMD Vitis Unified 2024.2中連接到QEMU

      在AMD Versal自適應SoC上使用QEMU+協(xié)同仿真示例

      在任意設(shè)計流程中，仿真都是不可或缺的關(guān)鍵組成部分。它允許用戶在無任何物理硬件的情況下對硬件系統(tǒng)進行確....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-06 17:21 ?1364次閱讀
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      AMD Versal自適應SoC上的級聯(lián)模式示例

      本篇博文主要講解在 PL 中如何使用 AXI Interrupt Controller (INTC)....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 07-22 17:41 ?1236次閱讀
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      Vivado無法選中開發(fā)板的常見原因及解決方法

      在使用 AMD Vivado Design Suite 對開發(fā)板（Evaluation Board）....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 07-15 10:19 ?1128次閱讀
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      AMD Power Design Manager 2025.1現(xiàn)已推出

      AMD Power Design Manager 2025.1 版（PDM）現(xiàn)已推出——增加了對第二....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 07-09 14:33 ?665次閱讀

      AMD FPGA異步模式與同步模式的對比

      本文講述了AMD UltraScale /UltraScale+ FPGA 原生模式下，異步模式與同....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 07-07 13:47 ?1285次閱讀

      如何在Unified IDE中創(chuàng)建視覺庫HLS組件

      最近我們分享了開發(fā)者分享｜AMD Vitis HLS 系列 1 - AMD Vivado IP 流程....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 07-02 10:55 ?959次閱讀
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      全新AMD Vitis統(tǒng)一軟件平臺2025.1版本發(fā)布

      全新 AMD Vitis 統(tǒng)一軟件平臺 2025.1 版正式上線！此最新版本為使用 AMD Vers....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 06-24 11:44 ?1066次閱讀

      使用AMD Vitis Unified IDE創(chuàng)建HLS組件

      這篇文章在開發(fā)者分享｜AMD Vitis HLS 系列 1 - AMD Vivado IP 流程（V....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 06-20 10:06 ?1660次閱讀
      使用AMD Vitis Unified IDE創(chuàng)建HLS組件

      AMD Vivado Design Suite 2025.1現(xiàn)已推出

      AMD Vivado Design Suite 2025.1 現(xiàn)已推出，支持 AMD Spartan....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 06-16 15:16 ?1055次閱讀

      如何使用AMD Vitis HLS創(chuàng)建HLS IP

      本文逐步演示了如何使用 AMD Vitis HLS 來創(chuàng)建一個 HLS IP，通過 AXI4 接口從....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 06-13 09:50 ?1078次閱讀
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      ATS失效請求報文問題的故障排除步驟

      本篇文章提供了解決 ATS 失效請求報文問題的故障排除步驟，主要聚焦在 CQ 接口上未顯示主機發(fā)送的....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 06-09 15:17 ?967次閱讀
      ATS失效請求報文問題的故障排除步驟

      利用AMD VERSAL自適應SoC的設(shè)計基線策略

      您是否準備將設(shè)計遷移到 AMD Versal 自適應 SoC？設(shè)計基線是一種行之有效的時序收斂方法，....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 06-04 11:40 ?481次閱讀

      AMD Versal Adaptive SoC Clock Wizard AXI DRP示例

      本文將使用 Clocking Wizard 文檔 PG321 中的“通過 AXI4-Lite 進行動....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 05-27 10:42 ?844次閱讀
      AMD Versal Adaptive SoC Clock Wizard AXI DRP示例

      如何使用One Spin檢查AMD Vivado Design Suite Synth的結(jié)果

      本文講述了如何使用 One Spin 檢查 AMD Vivado Design Suite Synt....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 05-19 14:22 ?872次閱讀
      如何使用One Spin檢查AMD Vivado Design Suite Synth的結(jié)果

      AMD Vivado Design Tool綜合中的門控時鐘轉(zhuǎn)換

      傳統(tǒng)上，使用門控時鐘是 ASIC 設(shè)計中降低系統(tǒng)功耗的常見方法。通過門控時鐘，可在非必要時阻止整組寄....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 05-14 09:05 ?1870次閱讀
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      在任何平臺上使用PetaLinux的先決條件

      本篇文章介紹了在任何平臺上使用 PetaLinux 的先決條件。PetaLinux 是一種嵌入式 L....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 04-24 10:40 ?1103次閱讀
      在任何平臺上使用PetaLinux的先決條件

      關(guān)于eDP的介紹

      最新的 DisplayPort TX/RX 1.4 Subsystem IP v3.1 支持 eDP....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 03-13 14:52 ?1371次閱讀
      關(guān)于eDP的介紹

      如何修改DisplayPort EDID

      在最新的 DisplayPort 1.4 RX Subsystem IP GUI 界面，修改 Dis....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 03-06 10:23 ?1256次閱讀
      如何修改DisplayPort EDID

      AMD Versal自適應SoC器件Advanced Flow概覽（下）

      在 AMD Vivado Design Suite 2024.2 版本中，Advanced Flow....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 01-23 09:33 ?1130次閱讀
      AMD Versal自適應SoC器件Advanced Flow概覽（下）

      AMD Versal自適應SoC器件Advanced Flow概覽（上）

      在最新發(fā)布的 AMD Vivado Design Suite 2024.2 中，引入的新特性之一是啟....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 01-17 10:09 ?1050次閱讀
      AMD Versal自適應SoC器件Advanced Flow概覽（上）