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      XILINX開發(fā)者社區(qū)

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      使用Aurora 6466b協(xié)議實現(xiàn)AMD UltraScale+ FPGA與AMD Versal自適應(yīng)SoC的對接

      在本博客中，我們將介紹使用 Aurora 6466b 協(xié)議實現(xiàn) AMD UltraScale+ FP....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 01-13 14:04 ?2469次閱讀
      使用Aurora 6466b協(xié)議實現(xiàn)AMD UltraScale+ FPGA與AMD Versal自適應(yīng)SoC的對接

      鎖存器中的時間借用概念與靜態(tài)時序分析

      對于基于鎖存器的設(shè)計，靜態(tài)時序分析會應(yīng)用一個稱為時間借用的概念。本篇博文解釋了時間借用的概念，若您的....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 12-31 15:25 ?4806次閱讀
      鎖存器中的時間借用概念與靜態(tài)時序分析

      AMD Power Design Manager 2025.2版本現(xiàn)已發(fā)布

      AMD Power Design Manager 2025.2 版本現(xiàn)已發(fā)布，并正式支持第二代 AM....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 12-24 11:08 ?524次閱讀

      一文詳解SystemC仿真庫的編譯

      AMD Vivado 設(shè)計套件以文件和庫的形式提供仿真模型。仿真庫包含器件和 IP 的行為和時序模型....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 12-12 15:08 ?4622次閱讀
      一文詳解SystemC仿真庫的編譯

      全新AMD Vitis統(tǒng)一軟件平臺2025.2版本發(fā)布

      AMD Vitis統(tǒng)一軟件平臺 2025.2 版現(xiàn)已推出，此版本為使用 AMD Versal AI ....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 12-12 15:06 ?574次閱讀

      AMD Vivado Design Suite 2025.2版本現(xiàn)已發(fā)布

      AMD Vivado Design Suite 2025.2 版本現(xiàn)已發(fā)布，新增對 AMD Vers....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 12-09 15:11 ?797次閱讀

      NoC性能監(jiān)控器調(diào)試指南

      本篇博客展示了如何訪問 NPI 為 NoC（片上網(wǎng)絡(luò)）公開的 Performance Monitor....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 12-01 14:38 ?1604次閱讀
      NoC性能監(jiān)控器調(diào)試指南

      如何在AMD Vitis Unified IDE中使用系統(tǒng)設(shè)備樹

      您將在這篇博客中了解系統(tǒng)設(shè)備樹 (SDT) 以及如何在 AMD Vitis Unified IDE ....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 11-18 11:13 ?3028次閱讀
      如何在AMD Vitis Unified IDE中使用系統(tǒng)設(shè)備樹

      Video Processing Subsystem與HDMI示例設(shè)計

      在撰寫本文時，HDMI Transmitter Subsystem IP 核與 Video Proc....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 11-07 10:35 ?574次閱讀
      Video Processing Subsystem與HDMI示例設(shè)計

      AMD Vitis AI 5.1測試版發(fā)布

      AMD Vitis AI 5.1全新發(fā)布——新增了對 AMD Versal AI Edge 系列神經(jīng)....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-31 12:46 ?705次閱讀

      如何在應(yīng)用程序調(diào)試期間分析棧和堆使用情況

      隨著 AMD Vitis 統(tǒng)一軟件平臺 2021.2 的發(fā)布，Vitis 引入了一個 Tcl 腳本，....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-24 16:54 ?762次閱讀
      如何在應(yīng)用程序調(diào)試期間分析棧和堆使用情況

      AMD Versal自適應(yīng)SoC內(nèi)置自校準(zhǔn)的工作原理

      本文提供有關(guān) AMD Versal 自適應(yīng) SoC 內(nèi)置自校準(zhǔn) (BISC) 工作方式的詳細信息。此....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-21 08:18 ?4087次閱讀

      如何利用XPIO構(gòu)建并實現(xiàn)帶有Strobe的高速接口設(shè)計

      在 AMD Versal 自適應(yīng) SoC 器件中，SelectIO 是實現(xiàn)高速接口的重要組成部分。它....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-17 09:22 ?2316次閱讀
      如何利用XPIO構(gòu)建并實現(xiàn)帶有Strobe的高速接口設(shè)計

      AMD Vivado IP integrator的基本功能特性

      我們還將帶您了解在 AMD Zynq UltraScale+ MPSoC 開發(fā)板與 AMD Vers....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 10-07 13:02 ?2008次閱讀
      AMD Vivado IP integrator的基本功能特性

      如何使用PetaLinux檢查RFDC IP狀態(tài)

      本篇博客演示了在 ZCU208 評估板和 ZCU216 評估板中通過運行簡單的 RFDC 示例來快速....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-23 16:08 ?908次閱讀
      如何使用PetaLinux檢查RFDC IP狀態(tài)

      如何解決I/O時鐘布局器錯誤

      在 I/O 時鐘布局器階段可能會發(fā)生錯誤，指出該工具無法對該時鐘結(jié)構(gòu)進行布局，直至最后 BUFG 仍....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-23 16:05 ?878次閱讀

      AMD Vivado ChipScope助力硬件調(diào)試

      許多硬件問題只有在整個集成系統(tǒng)實時運行的過程中才會顯現(xiàn)出來。AMD Vivado ChipScope....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-05 17:08 ?1067次閱讀

      高扇出信號線優(yōu)化技巧（下）

      該屬性會將每個驅(qū)動程序的扇出限制告知工具，并通過指示布局器了解扇出限制來指引該工具對高扇出的負載進行....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-28 10:47 ?1725次閱讀
      高扇出信號線優(yōu)化技巧（下）

      高扇出信號線優(yōu)化技巧（上）

      高扇出信號線 (HFN) 是具有大量負載的信號線。作為用戶，您可能遇到過高扇出信號線相關(guān)問題，因為將....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-28 10:45 ?2004次閱讀
      高扇出信號線優(yōu)化技巧（上）

      AMD 2025.1版嵌入式軟件和工具的新增功能

      AMD 2025.1 版嵌入式軟件和工具是面向新一代嵌入式系統(tǒng)開發(fā)而打造的綜合平臺，全面加速概念構(gòu)想....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-15 15:32 ?1180次閱讀

      如何在AMD Vitis Unified 2024.2中連接到QEMU

      在本篇文章我們將學(xué)習(xí)如何在 AMD Vitis Unified 2024.2 中連接到 QEMU。 ....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-06 17:24 ?1675次閱讀
      如何在AMD Vitis Unified 2024.2中連接到QEMU

      在AMD Versal自適應(yīng)SoC上使用QEMU+協(xié)同仿真示例

      在任意設(shè)計流程中，仿真都是不可或缺的關(guān)鍵組成部分。它允許用戶在無任何物理硬件的情況下對硬件系統(tǒng)進行確....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 08-06 17:21 ?1874次閱讀
      在AMD Versal自適應(yīng)SoC上使用QEMU+協(xié)同仿真示例

      AMD Versal自適應(yīng)SoC上的級聯(lián)模式示例

      本篇博文主要講解在 PL 中如何使用 AXI Interrupt Controller (INTC)....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 07-22 17:41 ?1587次閱讀
      AMD Versal自適應(yīng)SoC上的級聯(lián)模式示例

      Vivado無法選中開發(fā)板的常見原因及解決方法

      在使用 AMD Vivado Design Suite 對開發(fā)板（Evaluation Board）....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 07-15 10:19 ?1566次閱讀
      Vivado無法選中開發(fā)板的常見原因及解決方法

      AMD Power Design Manager 2025.1現(xiàn)已推出

      AMD Power Design Manager 2025.1 版（PDM）現(xiàn)已推出——增加了對第二....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 07-09 14:33 ?1018次閱讀

      AMD FPGA異步模式與同步模式的對比

      本文講述了AMD UltraScale /UltraScale+ FPGA 原生模式下，異步模式與同....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 07-07 13:47 ?1526次閱讀

      如何在Unified IDE中創(chuàng)建視覺庫HLS組件

      最近我們分享了開發(fā)者分享｜AMD Vitis HLS 系列 1 - AMD Vivado IP 流程....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 07-02 10:55 ?1302次閱讀
      如何在Unified IDE中創(chuàng)建視覺庫HLS組件

      全新AMD Vitis統(tǒng)一軟件平臺2025.1版本發(fā)布

      全新 AMD Vitis 統(tǒng)一軟件平臺 2025.1 版正式上線！此最新版本為使用 AMD Vers....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 06-24 11:44 ?1635次閱讀

      使用AMD Vitis Unified IDE創(chuàng)建HLS組件

      這篇文章在開發(fā)者分享｜AMD Vitis HLS 系列 1 - AMD Vivado IP 流程（V....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 06-20 10:06 ?2137次閱讀
      使用AMD Vitis Unified IDE創(chuàng)建HLS組件

      AMD Vivado Design Suite 2025.1現(xiàn)已推出

      AMD Vivado Design Suite 2025.1 現(xiàn)已推出，支持 AMD Spartan....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 06-16 15:16 ?1389次閱讀