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標(biāo)簽 > 芯片設(shè)計(jì)
《芯片設(shè)計(jì)》是2009年11月上海科學(xué)技術(shù)出版社出版的圖書,作者是(德)B.科爾特,(德)J.菲根。
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使用OLI進(jìn)行硅光芯片耦合質(zhì)量檢測(cè)
硅光是以光子和電子為信息載體的硅基電子大規(guī)模集成技術(shù),能夠突破傳統(tǒng)電子芯片的極限性能,是5G通信、大數(shù)據(jù)、人工智能、物聯(lián)網(wǎng)等新型產(chǎn)業(yè)的基礎(chǔ)支撐。光纖到硅...
2023-08-15 標(biāo)簽:耦合芯片設(shè)計(jì)診斷儀 1.6k 0
芯片設(shè)計(jì)問(wèn)題須知及設(shè)計(jì)策略
長(zhǎng)期可靠性的問(wèn)題,比如電子遷移(EM)失效機(jī)制,歷來(lái)屬于晶圓廠的處理范疇。但隨著納米設(shè)計(jì)中可靠性實(shí)現(xiàn)的愈加困難,對(duì)設(shè)計(jì)人員而言,不能再把問(wèn)題扔給制造...
2012-05-02 標(biāo)簽:芯片設(shè)計(jì)電子遷移可靠性 1.6k 0
Siemens的Calibre是業(yè)內(nèi)權(quán)威的版圖驗(yàn)證軟件,被各大Foundry廠廣泛認(rèn)可。用戶可以直接在Virtuoso界面集成Calibre接口,調(diào)用版...
2023-07-25 標(biāo)簽:芯片設(shè)計(jì)仿真器SWAP 1.6k 0
晶圓清洗:芯片設(shè)計(jì)與生產(chǎn)中的關(guān)鍵一環(huán)
蒸汽脫脂工藝一旦建立并經(jīng)過(guò)測(cè)試,就會(huì)保持恒定,并且可以實(shí)現(xiàn)自動(dòng)化以提高效率。清潔結(jié)果保持可重復(fù)且一致。
2024-03-21 標(biāo)簽:晶圓芯片設(shè)計(jì) 1.6k 0
芯片設(shè)計(jì)這個(gè)行當(dāng),從大的方面講,主要分模擬和數(shù)字兩大塊,而每大塊又分前端和后端,我想大部分同學(xué)對(duì)這個(gè)肯定是非常清楚的,下面就數(shù)字電路聊聊芯片設(shè)計(jì)的一些事...
2023-11-25 標(biāo)簽:寄存器芯片設(shè)計(jì)RTL 1.6k 0
設(shè)計(jì)開發(fā)開關(guān)電源DC-DC控制芯片需要注意的幾點(diǎn)
電流型控制是指將誤差放大器輸出信號(hào)與采樣到的電感峰值電流進(jìn)行比較。從而對(duì)輸出脈沖的占空比進(jìn)行控制,使輸出的電感峰值電流隨誤差電壓變化而變化。
2020-05-01 標(biāo)簽:芯片設(shè)計(jì)開關(guān)器件DC-DC變換器 1.5k 0
機(jī)器學(xué)習(xí)如何影響計(jì)算機(jī)硬件設(shè)計(jì)3
為什么芯片設(shè)計(jì)需要很長(zhǎng)時(shí)間?能不能加速芯片設(shè)計(jì)周期?能否在幾天或幾周之內(nèi)完成芯片的設(shè)計(jì)?這是一個(gè)非常有野心的目標(biāo)。過(guò)去十年,機(jī)器學(xué)習(xí)的發(fā)展離不開系統(tǒng)和硬...
2023-02-20 標(biāo)簽:計(jì)算機(jī)芯片設(shè)計(jì)硬件設(shè)計(jì) 1.5k 0
PCIe 6.0的優(yōu)化設(shè)計(jì)方案探討分析
為了實(shí)現(xiàn)64GT/s的鏈路速度,PCIe 6.0采用脈沖幅度調(diào)制4級(jí) (PAM4) 信號(hào),在與32GT/s PCIe相同的單元間隔(UI)中提供4個(gè)幅度...
2023-08-05 標(biāo)簽:soc芯片設(shè)計(jì)SSD 1.5k 0
產(chǎn)生高質(zhì)量芯片:熱設(shè)計(jì)注意事項(xiàng)須知
當(dāng)所設(shè)計(jì)的芯片需要滿足經(jīng)常不一致的規(guī)格要求時(shí),先進(jìn)的工藝和設(shè)計(jì)技術(shù)也會(huì)帶來(lái)艱巨的挑戰(zhàn)。在納米級(jí)設(shè)計(jì)中,功耗已經(jīng)成為限制性能的主要因素。納米工藝中使用...
2012-05-03 標(biāo)簽:芯片設(shè)計(jì)熱設(shè)計(jì) 1.5k 0
芯片設(shè)計(jì)的核心技術(shù)與關(guān)鍵優(yōu)勢(shì)概述
應(yīng)對(duì)網(wǎng)絡(luò)威脅正在成為芯片和系統(tǒng)設(shè)計(jì)的一個(gè)組成部分,并且更加昂貴和復(fù)雜。
2023-12-11 標(biāo)簽:soc芯片設(shè)計(jì)OTA 1.5k 0
機(jī)器學(xué)習(xí)如何影響計(jì)算機(jī)硬件設(shè)計(jì)2
為什么芯片設(shè)計(jì)需要很長(zhǎng)時(shí)間?能不能加速芯片設(shè)計(jì)周期?能否在幾天或幾周之內(nèi)完成芯片的設(shè)計(jì)?這是一個(gè)非常有野心的目標(biāo)。過(guò)去十年,機(jī)器學(xué)習(xí)的發(fā)展離不開系統(tǒng)和硬...
2023-02-20 標(biāo)簽:Google芯片設(shè)計(jì)硬件設(shè)計(jì) 1.5k 0
異步電路不能根據(jù)時(shí)鐘是否同源來(lái)界定,時(shí)鐘之間沒(méi)有確定的相位關(guān)系是唯一準(zhǔn)則。
2023-06-27 標(biāo)簽:FPGA設(shè)計(jì)芯片設(shè)計(jì)異步電路 1.5k 0
軟硬件聯(lián)合仿真在確保高效云解決方案的質(zhì)量、降低風(fēng)險(xiǎn)、節(jié)省時(shí)間和成本方面發(fā)揮著關(guān)鍵作用。
2023-10-16 標(biāo)簽:芯片設(shè)計(jì)RTLTLM 1.5k 0
直接在網(wǎng)表中插入RTL來(lái)快速做芯片功能ECO
近幾年,芯片設(shè)計(jì)規(guī)模越來(lái)越大,這使得重跑一次綜合需要長(zhǎng)達(dá)數(shù)小時(shí),甚至幾天時(shí)間。
2023-06-15 標(biāo)簽:芯片設(shè)計(jì)RTLECO 1.5k 0
后端在floorplan階段,如何擺放macro是一個(gè)很重要的問(wèn)題。如果采用層次化設(shè)計(jì),對(duì)于每一個(gè)block來(lái)說(shuō)都需要在block內(nèi)部把所分配的macro擺好。
2023-12-06 標(biāo)簽:芯片設(shè)計(jì)STD機(jī)器學(xué)習(xí) 1.5k 0
邏輯和互聯(lián)更加清晰,更接近于底層電路實(shí)現(xiàn)對(duì)工具友好。同時(shí)我的習(xí)慣是用xx_d、xx_q、xx_en來(lái)命名信號(hào),那么在寫邏輯時(shí),代碼中用到了xx_q我就會(huì)...
2023-11-10 標(biāo)簽:寄存器芯片設(shè)計(jì)RTL 1.5k 0
機(jī)器學(xué)習(xí)如何影響計(jì)算機(jī)硬件設(shè)計(jì)1
為什么芯片設(shè)計(jì)需要很長(zhǎng)時(shí)間?能不能加速芯片設(shè)計(jì)周期?能否在幾天或幾周之內(nèi)完成芯片的設(shè)計(jì)?這是一個(gè)非常有野心的目標(biāo)。過(guò)去十年,機(jī)器學(xué)習(xí)的發(fā)展離不開系統(tǒng)和硬...
2023-02-20 標(biāo)簽:Google芯片設(shè)計(jì)硬件設(shè)計(jì) 1.5k 0
使用硬件描述語(yǔ)言(VHDL,Verilog HDL,業(yè)界公司一般都是使用后者)將模塊功能以代碼來(lái)描述實(shí)現(xiàn),也就是將實(shí)際的硬件電路功能通過(guò)HDL語(yǔ)言描述出...
2023-07-09 標(biāo)簽:機(jī)器人芯片設(shè)計(jì)仿真 1.5k 0
在選擇數(shù)字IP時(shí),客戶的要求是否可以更大膽一些?答案是肯定的。SoC設(shè)計(jì)人員當(dāng)然非常希望能夠比較數(shù)字IP的PPA。然而這在很大程度上是不可能的,因?yàn)榭捎?..
2023-09-15 標(biāo)簽:處理器soc芯片設(shè)計(jì) 1.4k 0
近年來(lái),半導(dǎo)體封裝變得越發(fā)復(fù)雜,更加強(qiáng)調(diào)設(shè)計(jì)的重要性。半導(dǎo)體封裝設(shè)計(jì)工藝需要各類工程師和業(yè)內(nèi)人士的共同參與,以共享材料信息、開展可行性測(cè)試、并優(yōu)化封裝特...
2023-08-07 標(biāo)簽:半導(dǎo)體芯片設(shè)計(jì)封裝設(shè)計(jì) 1.4k 0
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